| 大会名称 |
| 2021年 総合大会 |
| 大会コ－ド |
| 2021G |
| 開催年 |
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2021
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| 発行日 |
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2021-02-23
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| セッション番号 |
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D-6
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| セッション名 |
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コンピュータシステム
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| 講演日 |
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2021/3/10
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| 講演場所(会議室等) |
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Meeting 18
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| 講演番号 |
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D-6-1
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| タイトル |
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多倍長計算の仮数部計算高速化のための粗粒度再構成可能なアーキテクチャの検討
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| 著者名 |
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◎宮内亮太, 川端英之, 弘中哲夫,
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| キーワード |
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多倍長計算, アクセラレータ, 粗粒度再構成可能プロセッサ
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| 抄録 |
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多倍長計算とは仮数部の桁数が指定できる浮動小数点演算のことであり，有名なライブラリとしてMPFR がある．しかし多倍長計算はソフトウェアで多くの命令を組み合わせて実現されることが多く，計算に長い時間がかかる．本稿では，粗粒度再構成可能プロセッサ技術を用いることで，任意精度に対応できるアクセラレータ実現を目的とし，多倍長演算において最も処理時間が大きい仮数部計算を以下の2つの方法で高速化する方法を示す．1つ目は加減算・シフトの連続する仮数部要素の並列計算である．2つ目は乗算における乗数の各要素が行う「部分積の計算」と「部分積の加算」のパイプライン処理である．提案方式の有効性を示すため，性能評価としてRTLレベルシミュレータを作成し，評価した結果を示す予定である．
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