| 講演名 | 2014-10-10 プリント板の配線寄生成分を考慮した電源回路シミュレーション(部品・照明・デバイス・材料技術関連,一般) 松尾 真人, 速水 数徳, 山口 達也, 山中 俊宏, 荒井 無我, |
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| 抄録(和) | 近年、部品(FPGAなど)の低電圧・大電流化に伴い、電源電流急変時の電圧変化による誤動作が多く見られるようになっている。このため、通信装置用電源回路は、高速制御可能な電源制御ICを使用するケースが増えている。一般に高速制御可能な電源制御ICは、高速応答実現のためフィードバックループ帯域を広帯域化している。広帯域化に伴い、フィードバックループのゼロクロス周波数(Gainが0dbとなる周波数)近傍の特性が、プリント板の配線寄生成分の影響を受けやすくなってきており、配線寄生成分の影響を無視できない。したがって、電源回路は設計どおりのフィードバックループの安定性を確保できず、プリント板の作り直しが必要となる課題がある。これを解決するには、電源回路はプリント板の配線寄生成分を含めたシミュレーションが必要となる。 |
| 抄録(英) | In recent years, a power supply circuit is a tendency of the low voltage and high current. This is for evolution of devices (FPGA etc.). In connection with this, the problem has occurred by voltage change when load current changes rapidly. For this reason, the power supply circuit's for telecom communication equipment using control IC which can control fast switching is expanding. As for the feedback loop characteristic of the power supply, 0 crossing frequency (frequency that Gain becomes 0db) shifts to the high frequency along with the fast switching. The power supply circuit is subject to the influence of parasitic capacitance & parasitic inductance of the printed-circuit board in order to control by high frequency. It is likely to become re-manufacturing the printed-circuit board, and it notices at the influence of parasitic capacitance & parasitic inductance. As for the power supply circuit, the simulation including parasitic capacitance & parasitic inductance of the printed-circuit board is indispensable to solve this. |
| キーワード(和) | 電源回路シミュレーション / プリント板配線寄生成分 |
| キーワード(英) | Power supply circuit simulation / Printed circuit board parasitic capacitance & parasitic inductance |
| 資料番号 | EE2014-17 |
| 発行日 |
| 研究会情報 | |
| 研究会 | EE |
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| 開催期間 | 2014/10/3(から1日開催) |
| 開催地（和） | |
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| テーマ（和） | |
| テーマ（英） | |
| 委員長氏名（和） | |
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| 幹事氏名（和） | |
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| 幹事補佐氏名（和） | |
| 幹事補佐氏名（英） | |
| 講演論文情報詳細 | |
| 申込み研究会 | Energy Engineering in Electronics and Communications (EE) |
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| 本文の言語 | JPN |
| タイトル（和） | プリント板の配線寄生成分を考慮した電源回路シミュレーション(部品・照明・デバイス・材料技術関連,一般) |
| サブタイトル（和） | |
| タイトル（英） | The power supply circuit simulation in consideration of the wiring parasitism ingredient of the printed circuit board |
| サブタイトル（和） | |
| キーワード(1)（和/英） | 電源回路シミュレーション / Power supply circuit simulation |
| キーワード(2)（和/英） | プリント板配線寄生成分 / Printed circuit board parasitic capacitance & parasitic inductance |
| 第 1 著者 氏名（和/英） | 松尾 真人 / Masato MATSUO |
| 第 1 著者 所属（和/英） | 富士通九州ネットワークテクノロジーズ株式会社 Fujitsu Kyushu Network Technologies Ltd. |
| 第 2 著者 氏名（和/英） | 速水 数徳 / Kazunori HAYAMI |
| 第 2 著者 所属（和/英） | 富士通九州ネットワークテクノロジーズ株式会社 Fujitsu Kyushu Network Technologies Ltd. |
| 第 3 著者 氏名（和/英） | 山口 達也 / Tatsuya YAMAGUCHI |
| 第 3 著者 所属（和/英） | 富士通九州ネットワークテクノロジーズ株式会社 Fujitsu Kyushu Network Technologies Ltd. |
| 第 4 著者 氏名（和/英） | 山中 俊宏 / Toshihiro YAMANAKA |
| 第 4 著者 所属（和/英） | 富士通九州ネットワークテクノロジーズ株式会社 Fujitsu Kyushu Network Technologies Ltd. |
| 第 5 著者 氏名（和/英） | 荒井 無我 / Muga ARAI |
| 第 5 著者 所属（和/英） | 富士通アドバンストテクノロジ株式会社 Fujitsu Advanced Technologies Ltd. |
| 発表年月日 | 2014-10-10 |
| 資料番号 | EE2014-17 |
| 巻番号（vol） | vol.114 |
| 号番号（no） | 240 |
| ページ範囲 | pp.- |
| ページ数 | 4 |
| 発行日 | |