| 講演名 | 2010-04-23 65nm CMOS GPU-0.1μm DRAM間8Tb/s 1pJ/b 0.8mm^2/Tb/s QDR誘導結合インタフェース(非接触メモリインターフェース,メモリ(DRAM, SRAM,フラッシュ,新規メモリ)技術) 三浦 典之, 春日 一貴, 齊藤 美都子, 黒田 忠広, |
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| 抄録(和) | 65nm CMOS GPUと0.1μm DRAM間で通信する誘導結合インタフェースを開発した。1024チャネルの並列誘導結合インタフェースで8Tb/s BER<10^<-16>動作を確認した。最新の40nm DRAM有線インタフェースの32倍の通信帯域を1/8の消費電力と1/22の消費面積で実現した。 |
| 抄録(英) | An 8Tb/s 1pJ/b 0.8mm^2/Tb/s inductive-coupling interface between 65nm CMOS GPU and 0.1μm DRAM is developed. BER<10^<-16> operation is examined in 1024-bit parallel links. Compared to the latest 40nm DRAM wired interface, the bandwidth is increased 32× and the energy consumption and layout area are reduced by 8× and 22×, respectively. |
| キーワード(和) | |
| キーワード(英) | |
| 資料番号 | ICD2010-18 |
| 発行日 |
| 研究会情報 | |
| 研究会 | ICD |
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| 開催期間 | 2010/4/15(から1日開催) |
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| 委員長氏名（和） | |
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| 副委員長氏名（英） | |
| 幹事氏名（和） | |
| 幹事氏名（英） | |
| 幹事補佐氏名（和） | |
| 幹事補佐氏名（英） | |
| 講演論文情報詳細 | |
| 申込み研究会 | Integrated Circuits and Devices (ICD) |
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| 本文の言語 | JPN |
| タイトル（和） | 65nm CMOS GPU-0.1μm DRAM間8Tb/s 1pJ/b 0.8mm^2/Tb/s QDR誘導結合インタフェース(非接触メモリインターフェース,メモリ(DRAM, SRAM,フラッシュ,新規メモリ)技術) |
| サブタイトル（和） | |
| タイトル（英） | An 8Tb/s 1pJ/b 0.8mm^2/Tb/s QDR Inductive-Coupling Interface Between 65nm CMOS GPU and 0.1μm DRAM |
| サブタイトル（和） | |
| キーワード(1)（和/英） | |
| 第 1 著者 氏名（和/英） | 三浦 典之 / Noriyuki Miura |
| 第 1 著者 所属（和/英） | 慶應義塾大学 Keio University |
| 第 2 著者 氏名（和/英） | 春日 一貴 / Kazutaka Kasuga |
| 第 2 著者 所属（和/英） | 慶應義塾大学 Keio University |
| 第 3 著者 氏名（和/英） | 齊藤 美都子 / Mitsuko Saito |
| 第 3 著者 所属（和/英） | 慶應義塾大学 Keio University |
| 第 4 著者 氏名（和/英） | 黒田 忠広 / Tadahiro Kuroda |
| 第 4 著者 所属（和/英） | 慶應義塾大学 Keio University |
| 発表年月日 | 2010-04-23 |
| 資料番号 | ICD2010-18 |
| 巻番号（vol） | vol.110 |
| 号番号（no） | 9 |
| ページ範囲 | pp.- |
| ページ数 | 5 |
| 発行日 | |