| 講演名 | 2009-03-10 ハッシュ関数ファミリーAURORAのハードウェア実装評価(情報通信基礎サブソサイエティ合同研究会) 秋下 徹, 山本 忠興, 阿部 広幸, |
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| 抄録(和) | 本稿では,ハッシュ関数ファミリーAURORAのハードウェア実装に関する最適化手法および実装性能評価について報告する.AURORAはF関数内の各コンポーネントがそれぞれ小型かつ高速に実装可能であり,またAURORAの構成は高速実装から小型実装までバラエティに富んだ実装を可能としている.0.13μm CMOS標準セルライブラリを用いた評価結果では,256ビット出力のAURORA-256は高速版実装において35.0Kgateで10.4Gbpsを,小型版実装において8.9Kgateで1.1Gbpsを達成している.また,512ビット出力のAURORA-512は高速版実装において9.1Gbpsを,小型版実装において12.1Kgateを実現している.これらの数値はSHA-2の最良の実装結果と比較して十分なアドバンテージを持っており,AURORAが高いハードウェア実装性能を持ったハッシュ関数であることを示している. |
| 抄録(英) | This paper presents optimization techniques and evaluation results in hardware implementations of the hash function family AURORA. Each component in F-functions of AURORA can be implemented efficiently in hardware, and its design enables a variety of implementations, from high-speed to area-restricted implementations. In our evaluations using a 0.13μm CMOS ASIC library, AURORA-256 achieves the highest throughput of 10.4Gbps with area of 35.0Kgate in a speed-optimized implementation, and the smallest area of 8.9Kgate with throughput of 1.1Gbps in an area-optimized implementation. AURORA-512 achieves the highest throughput of 9.1Gbps in a speed-optimized implementation, and the smallest area of 12.1Kgate in an area-optimized implementation. These figures are so advantageous to the best known results of hardware performance of SHA-2 that AURORA is a highly efficient hash function family in hardware implementation. |
| キーワード(和) | ハッシュ関数 / AURORA / ハードウェア実装 |
| キーワード(英) | hash function / AURORA / hardware implementation |
| 資料番号 | IT2008-88,ISEC2008-146,WBS2008-101 |
| 発行日 |
| 研究会情報 | |
| 研究会 | WBS |
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| 開催期間 | 2009/3/2(から1日開催) |
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| 幹事補佐氏名（和） | |
| 幹事補佐氏名（英） | |
| 講演論文情報詳細 | |
| 申込み研究会 | Wideband System(WBS) |
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| 本文の言語 | JPN |
| タイトル（和） | ハッシュ関数ファミリーAURORAのハードウェア実装評価(情報通信基礎サブソサイエティ合同研究会) |
| サブタイトル（和） | |
| タイトル（英） | Hardware Implementations of the Cryptographic Hash Function Family AURORA |
| サブタイトル（和） | |
| キーワード(1)（和/英） | ハッシュ関数 / hash function |
| キーワード(2)（和/英） | AURORA / AURORA |
| キーワード(3)（和/英） | ハードウェア実装 / hardware implementation |
| 第 1 著者 氏名（和/英） | 秋下 徹 / Toru AKISHITA |
| 第 1 著者 所属（和/英） | ソニー株式会社 Sony Corporation |
| 第 2 著者 氏名（和/英） | 山本 忠興 / Tadaoki YAMAMOTO |
| 第 2 著者 所属（和/英） | ソニー・エルエスアイ・デザイン株式会社 Sony LSI Design Inc. |
| 第 3 著者 氏名（和/英） | 阿部 広幸 / Hiroyuki ABE |
| 第 3 著者 所属（和/英） | ソニー・エルエスアイ・デザイン株式会社 Sony LSI Design Inc. |
| 発表年月日 | 2009-03-10 |
| 資料番号 | IT2008-88,ISEC2008-146,WBS2008-101 |
| 巻番号（vol） | vol.108 |
| 号番号（no） | 474 |
| ページ範囲 | pp.- |
| ページ数 | 8 |
| 発行日 | |