講演名 2008-10-07
DVFS制御向け動きベクトル検出アルゴリズムとこれを適用した動きベクトル検出プロセッサの開発(プロセッサ,システムLSIの応用と要素技術,プロセッサ,DSP,画像処理技術及び一般)
小林 伸彰, 石川 雄悟, 榎本 忠儀,
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抄録(和) 動的電圧周波数協調(Dynamic Voltage and Frequency Scaling; DVFS)制御技術の電力削減効果を最大限に引き出すために、信号処理量を予測するAdaptively Assigned Breaking-off Condition Search (A^2BCS)と呼ぶ高速動きベクトル検出(ME)アルゴリズム、ならびにDVFS制御技術、A^2BCSアルゴリズムを適応した90-nm MEプロセッサを開発した。A^2BCSアルゴリズムはマクロブロック毎にMEプロセッサへ供給する最適な電源電圧(V_
)と最適なクロック周波数(f_c)を予め予測することができるアルゴリズムで、これをH.264に準拠したソフトウェアエンコーダに実装し、画像解析した。MEプロセッサは差分絶対値和回路、DVFS制御回路、小形DC/DCコンバータ、PLLクロックドライバより構成される。DVFS制御とA^2BCSを併用した結果、本MEプロセッサの消費電力は28.3μWであった。これは、全探索法を適用し、DVFS制御を用いない従来形MEプロセッサの消費電力の2.42%であった。
抄録(英) To make full use of an effective power reduction capability of dynamic voltage and frequency scaling (DVFS), a fast motion estimation (ME) algorithm called adaptively assigned breaking-off condition search (A^2BCS) and an ME processor that employs both A^2BCS and DVFS were developed. The A^2BCS algorithm can adaptively predict the optimum supply voltage (V_D) and the optimum clock frequency (f_c) before each block matching process starts. The 90-nm CMOS ME processor consisted of a two-stage pipelined absolute difference accumulator, a DVFS controller, a small DC/DC converter, and a PLL clock driver. Power dissipation of the ME processor was 28.3μW which was 2.42% that of a conventional ME processor adopting a full search ME algorithm.
キーワード(和) H.264 / 動きベクトル検出プロセッサ / DVFS / PLL
キーワード(英) motion estimation / DVFS / power dissipation / DC/DC converter / PLL clock driver
資料番号 SIP2008-115,IE2008-79
発行日

研究会情報
研究会 SIP
開催期間 2008/9/29(から1日開催)
開催地(和)
開催地(英)
テーマ(和)
テーマ(英)
委員長氏名(和)
委員長氏名(英)
副委員長氏名(和)
副委員長氏名(英)
幹事氏名(和)
幹事氏名(英)
幹事補佐氏名(和)
幹事補佐氏名(英)

講演論文情報詳細
申込み研究会 Signal Processing (SIP)
本文の言語 JPN
タイトル(和) DVFS制御向け動きベクトル検出アルゴリズムとこれを適用した動きベクトル検出プロセッサの開発(プロセッサ,システムLSIの応用と要素技術,プロセッサ,DSP,画像処理技術及び一般)
サブタイトル(和)
タイトル(英) Fast Motion Estimation Algorithm for a Low Power Motion Estimation Processor Implementing Dynamic Voltage and Frequency Scaling
サブタイトル(和)
キーワード(1)(和/英) H.264 / motion estimation
キーワード(2)(和/英) 動きベクトル検出プロセッサ / DVFS
キーワード(3)(和/英) DVFS / power dissipation
キーワード(4)(和/英) PLL / DC/DC converter
第 1 著者 氏名(和/英) 小林 伸彰 / Nobuaki Kobayashi
第 1 著者 所属(和/英) 中央大学大学院理工学研究科情報工学専攻
Graduate School of Science and Engineering, Chuo University
第 2 著者 氏名(和/英) 石川 雄悟 / Yugo Ishikawa
第 2 著者 所属(和/英) 中央大学大学院理工学研究科情報工学専攻
Graduate School of Science and Engineering, Chuo University
第 3 著者 氏名(和/英) 榎本 忠儀 / Tadayoshi Enomoto
第 3 著者 所属(和/英) 中央大学大学院理工学研究科情報工学専攻
Graduate School of Science and Engineering, Chuo University
発表年月日 2008-10-07
資料番号 SIP2008-115,IE2008-79
巻番号(vol) vol.108
号番号(no) 228
ページ範囲 pp.-
ページ数 6
発行日