| 講演名 | 2008-03-28 完全差動ヒステリシス2ポートVCCSカオス発振器 濱田 卓矢, 堀尾 喜彦, 合原 一幸, |
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| 抄録(和) | ヒステリシス2P-VCCSカオス発振器の完全差動回路構成を提案する.完全差動回路化することにより,偶数次高調波歪みを抑制することができる等の利点がある.特に同相で混入するディジタルノイズに強いため,アナログ回路とディジタル回路を混載したミックスド・シグナル大規模集積回路に適している.また,通常ではシングルエンド構成を完全差動回路化することで回路構成が2倍程度になる.しかし,提案する完全差動回路構成では,元となるシングルエンド回路中の回路構成要素の出力部分を差動化することで回路全体の差動化を行うことにより,回路規模の増加を抑えている.さらに,提案する完全差動ヒステリシス2P-VCCSカオス発振回路をTSMC0.35μmCMOSプロセスを用いて集積回路化する.また,SPICEシミュレーションから得られたクワッドスクリューアトラクタ等を含む多彩なカオスアトラクタの例を示す. |
| 抄録(英) | We propose a fully-differential hysteresis two-port VCCS chaotic oscillator. The fully-differential circuit structure has some advantages over the single-ended counterpart such as cancellation of even-order harmonic distortions. In particular, the proposed circuit is suitable for a mixed analog/digital signal LSI because it is insensitive to the common-mode digital noise. In general, a differential circuit occupies almost twice as much area as its single-ended version. In contrast, the proposed circuit is simple and small, because we derive the fully-differential circuit by only modifying the output ports of the constituent circuits of the original single-ended two-port VCCS circuit. Moreover, we implement the fully-differential hysteresis 2P-VCCS chaotic circuit using TSMC 0.35μm CMOS process. We illustrate through SPICE simulations a variety of dynamics from the proposed circuit including a quad screw attractor. |
| キーワード(和) | カオス / ヒステリシス / 完全差動回路 |
| キーワード(英) | Chaos / Hysteresis / Fully-Differential Circuit |
| 資料番号 | NLP2007-180 |
| 発行日 |
| 研究会情報 | |
| 研究会 | NLP |
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| 開催期間 | 2008/3/21(から1日開催) |
| 開催地（和） | |
| 開催地（英） | |
| テーマ（和） | |
| テーマ（英） | |
| 委員長氏名（和） | |
| 委員長氏名（英） | |
| 副委員長氏名（和） | |
| 副委員長氏名（英） | |
| 幹事氏名（和） | |
| 幹事氏名（英） | |
| 幹事補佐氏名（和） | |
| 幹事補佐氏名（英） | |
| 講演論文情報詳細 | |
| 申込み研究会 | Nonlinear Problems (NLP) |
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| 本文の言語 | JPN |
| タイトル（和） | 完全差動ヒステリシス2ポートVCCSカオス発振器 |
| サブタイトル（和） | |
| タイトル（英） | A Fully-Differential Hysteresis Two-Port VCCS Chaotic Oscillator |
| サブタイトル（和） | |
| キーワード(1)（和/英） | カオス / Chaos |
| キーワード(2)（和/英） | ヒステリシス / Hysteresis |
| キーワード(3)（和/英） | 完全差動回路 / Fully-Differential Circuit |
| 第 1 著者 氏名（和/英） | 濱田 卓矢 / Takuya HAMADA |
| 第 1 著者 所属（和/英） | 東京電機大学大学院工学研究科 Graduate School of Engineering, Tokyo Denki University |
| 第 2 著者 氏名（和/英） | 堀尾 喜彦 / Yoshihiko HORIO |
| 第 2 著者 所属（和/英） | 東京電機大学大学院工学研究科:ERATO,JST合原複雑数理モデルプロジェクト Graduate School of Engineering, Tokyo Denki University:Aihara Complexity Modelling Project, ERATO, JST |
| 第 3 著者 氏名（和/英） | 合原 一幸 / Kazuyuki AIHARA |
| 第 3 著者 所属（和/英） | ERATO,JST合原複雑数理モデルプロジェクト:東京大学生産技術研究所 Aihara Complexity Modelling Project, ERATO, JST:Institute of Industrial Science, The University of Tokyo |
| 発表年月日 | 2008-03-28 |
| 資料番号 | NLP2007-180 |
| 巻番号（vol） | vol.107 |
| 号番号（no） | 561 |
| ページ範囲 | pp.- |
| ページ数 | 6 |
| 発行日 | |