| 講演名 | 2008-01-17 高圧電源線を用いたオンチップ電源線ノイズキャンセラ(<特集>チップ・パッケージ・ボードにおけるパワーインテグリティの設計評価,LSIシステムの実装・モジュール化・インタフェース技術、テスト技術、一般) 中村 安見, 高宮 真, 桜井 貴康, |
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| 抄録(和) | 高圧電源線を用いたオンチップ電源線ノイズキャンセラを提案した.このキャンセラを90nm CMOSプロセスにより試作し,2.0%の消費電力増で68%ノイズを低減できることを確認した.また,提案したキャンセラの設計手法を示し,従来手法であるオンチップデカップリングキャパシタ及び電源線の追加に比べてそれぞれ1/77及び1/45の面積増加で同等のノイズ低減効果が得られた.また,キャンセラを早めに動作させることによってノイズを完全に消すことができることがシミュレーションで示された. |
| 抄録(英) | An on-chip noise canceller with high voltage supply lines for the nanosecond-range power supply noise is proposed. The canceller fabricated with 90-nm CMOS achieves 68% noise reduction with 2.0% power increase. The design methodology for the proposed canceller is shown. Under the same noise reduction conditions, the area penalty for the canceller is 1/77 and 1/45 of those for the additional on-chip decoupling capacitors and the power supply lines respectively. Also it is shown by simulation that when the canceller is turned on earlier, all the noise is reduced. |
| キーワード(和) | ノイズキャンセラ / パワーインテグリティ / VLSI / 電源 / 高圧 / デカップリング / ナノ秒 |
| キーワード(英) | Noise Canceller / Power Integrity / VLSI / Power Supply / High Voltage / Decoupling / Nanosecond |
| 資料番号 | CPM2007-132,ICD2007-143 |
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| 研究会情報 | |
| 研究会 | ICD |
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| 開催期間 | 2008/1/10(から1日開催) |
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| 委員長氏名（和） | |
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| 幹事氏名（和） | |
| 幹事氏名（英） | |
| 幹事補佐氏名（和） | |
| 幹事補佐氏名（英） | |
| 講演論文情報詳細 | |
| 申込み研究会 | Integrated Circuits and Devices (ICD) |
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| 本文の言語 | JPN |
| タイトル（和） | 高圧電源線を用いたオンチップ電源線ノイズキャンセラ(<特集>チップ・パッケージ・ボードにおけるパワーインテグリティの設計評価,LSIシステムの実装・モジュール化・インタフェース技術、テスト技術、一般) |
| サブタイトル（和） | |
| タイトル（英） | An On-Chip Noise Canceller with High Voltage Supply Lines for Nanosecond-Range Power Supply Noise |
| サブタイトル（和） | |
| キーワード(1)（和/英） | ノイズキャンセラ / Noise Canceller |
| キーワード(2)（和/英） | パワーインテグリティ / Power Integrity |
| キーワード(3)（和/英） | VLSI / VLSI |
| キーワード(4)（和/英） | 電源 / Power Supply |
| キーワード(5)（和/英） | 高圧 / High Voltage |
| キーワード(6)（和/英） | デカップリング / Decoupling |
| キーワード(7)（和/英） | ナノ秒 / Nanosecond |
| 第 1 著者 氏名（和/英） | 中村 安見 / Yasumi NAKAMURA |
| 第 1 著者 所属（和/英） | 東京大学国際・産学共同研究センター Center for Collaborative Research, University of Tokyo |
| 第 2 著者 氏名（和/英） | 高宮 真 / Makoto TAKAMIYA |
| 第 2 著者 所属（和/英） | 東京大学大規模集積システム設計教育研究センター VLSI Design and Education Center, University of Tokyo |
| 第 3 著者 氏名（和/英） | 桜井 貴康 / Takayasu SAKURAI |
| 第 3 著者 所属（和/英） | 東京大学国際・産学共同研究センター Center for Collaborative Research, University of Tokyo |
| 発表年月日 | 2008-01-17 |
| 資料番号 | CPM2007-132,ICD2007-143 |
| 巻番号（vol） | vol.107 |
| 号番号（no） | 426 |
| ページ範囲 | pp.- |
| ページ数 | 5 |
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