講演名 2005/3/4
エネルギ最小周波数を利用したタスク再配置によるマルチプロセッサ向け消費エネルギ削減手法(設計手法, システムオンシリコン設計技術並びにこれを活用した VLSI)
高務 祐哲, 小林 和淑, 小野寺 秀俊,
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抄録(和) マルチプロセッサシステムにDVFS(Dynamic Voltage Frequency Scaling)を適用した場合, 負荷分散の度合いやプロセッサ間の負荷不均衡が問題となり, 消費エネルギ削減効果が減少してしまう.本稿では1サイクルあたりのプロセッサの消費エネルギが最小になる周波数を負荷の分散度合いの指標として使用する.さらにプロセッサ間の負荷の不均衡が発生した際に行うタスク再配置でもエネルギ最小周波数を使用することで, 再配置を行わない場合と比較して最大25%の消費エネルギを削減できる.
抄録(英) In this paper, we propose a task relocation technique to resolve load imbalance among processors and over-scattering, which diminish the efficiency of DVFS (Dynamic Voltage Frequency Scaling). Our method uses the energy-minimum-frequency in which energy per clock cycle becomes minimum as the index of task load scattering. Task relocation also uses energy-minimum-frequency to resolve load imbalances. Our task relocation technique reduces 25% of energy on simulation.
キーワード(和) 低消費電力化 / リーク電流 / マルチプロセッサ
キーワード(英) Dynamic Voltage Frequency Scaling / Low power / Multiprocessor / Leakage current
資料番号 VLD2004-143,ICD2004-239
発行日

研究会情報
研究会 VLD
開催期間 2005/3/4(から1日開催)
開催地(和)
開催地(英)
テーマ(和)
テーマ(英)
委員長氏名(和)
委員長氏名(英)
副委員長氏名(和)
副委員長氏名(英)
幹事氏名(和)
幹事氏名(英)
幹事補佐氏名(和)
幹事補佐氏名(英)

講演論文情報詳細
申込み研究会 VLSI Design Technologies (VLD)
本文の言語 JPN
タイトル(和) エネルギ最小周波数を利用したタスク再配置によるマルチプロセッサ向け消費エネルギ削減手法(設計手法, システムオンシリコン設計技術並びにこれを活用した VLSI)
サブタイトル(和)
タイトル(英) An Energy Reduction Technique by Task Relocation Considering Energy Minimum Execution Frequency for Multiprocessor Systems
サブタイトル(和)
キーワード(1)(和/英) 低消費電力化 / Dynamic Voltage Frequency Scaling
キーワード(2)(和/英) リーク電流 / Low power
キーワード(3)(和/英) マルチプロセッサ / Multiprocessor
第 1 著者 氏名(和/英) 高務 祐哲 / Yutetsu TAKATSUKASA
第 1 著者 所属(和/英) 京都大学大学院情報学研究科
Graduate School of Informatics, Kyoto University
第 2 著者 氏名(和/英) 小林 和淑 / Kazutoshi KOBAYASHI
第 2 著者 所属(和/英) 京都大学大学院情報学研究科
Graduate School of Informatics, Kyoto University
第 3 著者 氏名(和/英) 小野寺 秀俊 / Hidetoshi ONODERA
第 3 著者 所属(和/英) 京都大学大学院情報学研究科
Graduate School of Informatics, Kyoto University
発表年月日 2005/3/4
資料番号 VLD2004-143,ICD2004-239
巻番号(vol) vol.104
号番号(no) 709
ページ範囲 pp.-
ページ数 6
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