| 講演名 | 2001/11/23 プラスティックセルアーキテクチャへの回路実装密度に関する一考察 曽我 祐紀, 杉本 成範, 泉 知論, 尾上 孝雄, 中村 行宏, |
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| 抄録(和) | PLD(Programmable Logic Device)の発展のひとつとしてPCA(Plastic Cell Architecture)が提案されている。PCAはパイプライン通信によるチップ上の大域的配線遅延の削減、リコンフィギュラブル・コンピューティングヘの応用を視野に入れた高い再構成能力などの特徴をもつ。本稿では我々の試作デバイスであるPCA-Chip2を対象とし、リソースの使用効率の改善のため回路構成の基本となるブロックの大きさ(粒度)の検討を行う。様々な粒度に対しMCNCのベンチマーク回路を合成し、論理実装のためのリソース量が最小となる粒度を求める。これらの検討により平均リソース使用量が3.2%削減された。 |
| 抄録(英) | PCA (Plastic cell Architecture) is proposed as an extension of PLD (Programmable Logic Device), aiming for higher performance and reconfigurability. This paper describes an analysis of a size (granularity) of basic logic blocks in our trial PCA device named PCA-Chip2. MCNC benchmark circuits are implemented into PCA-Chip2 and the granularity with the minimum use of hardware resources is determined. Based on the analysis, the average use of resourees is reduced by 3.2%. |
| キーワード(和) | プラスティックセルアーキテクチャ / プログラマブル論理デバイス / 論理ブロック / 粒度 |
| キーワード(英) | PCA(Plastic Cell Architecture) / PLD(Programmable Logic Device) / Logic block / granularity |
| 資料番号 | VLD2001-115,ICD2001-160,FTS2001-62 |
| 発行日 |
| 研究会情報 | |
| 研究会 | VLD |
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| 開催期間 | 2001/11/23(から1日開催) |
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| テーマ（英） | |
| 委員長氏名（和） | |
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| 副委員長氏名（和） | |
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| 幹事氏名（和） | |
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| 幹事補佐氏名（和） | |
| 幹事補佐氏名（英） | |
| 講演論文情報詳細 | |
| 申込み研究会 | VLSI Design Technologies (VLD) |
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| 本文の言語 | JPN |
| タイトル（和） | プラスティックセルアーキテクチャへの回路実装密度に関する一考察 |
| サブタイトル（和） | |
| タイトル（英） | Analysis of efficiency of logic implementation for Plastic Cell Architecture |
| サブタイトル（和） | |
| キーワード(1)（和/英） | プラスティックセルアーキテクチャ / PCA(Plastic Cell Architecture) |
| キーワード(2)（和/英） | プログラマブル論理デバイス / PLD(Programmable Logic Device) |
| キーワード(3)（和/英） | 論理ブロック / Logic block |
| キーワード(4)（和/英） | 粒度 / granularity |
| 第 1 著者 氏名（和/英） | 曽我 祐紀 / Yuuki SOGA |
| 第 1 著者 所属（和/英） | 京都大学大学院情報学研究科通信情報システム専攻 Department of Communications and Computer Engineering, Graduate School of Informatics, Kyoto University |
| 第 2 著者 氏名（和/英） | 杉本 成範 / Shigenori SUGIMOTO |
| 第 2 著者 所属（和/英） | 京都大学大学院情報学研究科通信情報システム専攻 Department of Communications and Computer Engineering, Graduate School of Informatics, Kyoto University |
| 第 3 著者 氏名（和/英） | 泉 知論 / Tomonori IZUMI |
| 第 3 著者 所属（和/英） | / / / / |
| 第 4 著者 氏名（和/英） | 尾上 孝雄 / Takao ONOYE |
| 第 4 著者 所属（和/英） | |
| 第 5 著者 氏名（和/英） | 中村 行宏 / Yukihiro NAKAMURA |
| 第 5 著者 所属（和/英） | |
| 発表年月日 | 2001/11/23 |
| 資料番号 | VLD2001-115,ICD2001-160,FTS2001-62 |
| 巻番号（vol） | vol.101 |
| 号番号（no） | 468 |
| ページ範囲 | pp.- |
| ページ数 | 6 |
| 発行日 | |