講演名 2001/1/5
回路シミュレーションにおける並列分散デバイスモデル評価の実装
鈴木 毅, 八木 浩行, 壇 良,
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抄録(和) 我々は、回路シミュレーションにおける並列分散デバイスモデル評価を提案する.並列分散デバイスモデル評価は, デバイスモデル評価を並列化する事で, 精度を維持したまま高速化することができる.本論文では, ダイオードモデルにおいて並列分散デバイスモデル評価を実装し, 性能評価を行う.本手法を用いると, デバイスモデル評価時間は, 従来のSPICE2に比べ処理時間の53.5~68.15%を低減でき, 全体として最大で1.7倍の高速化が達成できる.
抄録(英) We propose a parallel distributed device model evaluation algorithm in the circuit simulation. Parallel distributed device model evaluation can speed up while maintaining accuracy, because the approach chosen to speed up SPICE is parallelizetion of device model evaluation. In this paper, we estimate the performance of this circuit simulator using the parallel distributed device model evaluation algorithm. The parallel distributed device model evaluation is able to reduce the device model evaluation to 53.5~68.15% in comparison with the original SPICE2. As a result, our circuit simulator can run 1.7 times faster than the original SPICE2 in the maximum speedup.
キーワード(和) デバイスモデル評価 / 回路シミュレーション / PCクラスタ / マルチスレッド
キーワード(英) circuit simulation / device model evaluation / cluster computing / multithread
資料番号 VLD2000-124,CPSY2000-79
発行日

研究会情報
研究会 VLD
開催期間 2001/1/5(から1日開催)
開催地(和)
開催地(英)
テーマ(和)
テーマ(英)
委員長氏名(和)
委員長氏名(英)
副委員長氏名(和)
副委員長氏名(英)
幹事氏名(和)
幹事氏名(英)
幹事補佐氏名(和)
幹事補佐氏名(英)

講演論文情報詳細
申込み研究会 VLSI Design Technologies (VLD)
本文の言語 JPN
タイトル(和) 回路シミュレーションにおける並列分散デバイスモデル評価の実装
サブタイトル(和)
タイトル(英) An Implementation of Parallel Distributed Device Model Evaluation on Circuit Simulation
サブタイトル(和)
キーワード(1)(和/英) デバイスモデル評価 / circuit simulation
キーワード(2)(和/英) 回路シミュレーション / device model evaluation
キーワード(3)(和/英) PCクラスタ / cluster computing
キーワード(4)(和/英) マルチスレッド / multithread
第 1 著者 氏名(和/英) 鈴木 毅 / Tsuyoshi SUZUKI
第 1 著者 所属(和/英) 法政大学
Hosei University
第 2 著者 氏名(和/英) 八木 浩行 / Hiroyuki YAGI
第 2 著者 所属(和/英) 法政大学
Hosei University
第 3 著者 氏名(和/英) 壇 良 / Ryo DANG
第 3 著者 所属(和/英) 法政大学
Hosei University
発表年月日 2001/1/5
資料番号 VLD2000-124,CPSY2000-79
巻番号(vol) vol.100
号番号(no) 532
ページ範囲 pp.-
ページ数 7
発行日