| 講演名 | 1998/6/26 2値パターン認識アルゴリズムの提案とその集積回路化に関する一考察 徳永 祐介, 井上 高宏, |
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| 抄録(和) | 画像パターンの重心を中心とする極座標系を用いたパターンマッチング手法と, 画像の解像度を粗くして大局的にパターンの重心を探索する手法を組み合わせて, 歪みがない画像という制限の下で位置, 大きさ, 回転, および雑音に対して頑健な2値パターン認識アルゴリズムを提案する.また同アルゴリズムの実時間化, 集積回路化に関する考察を行う. |
| 抄録(英) | A binary pattern recognition algorithm which can recognize a pattern under the condition that there is no distortion is proposed.The algorithm is based on a matching method using the polar-coordinates system whose origin is set to the centroid of the pattern and high-speed scanning of the centroid of the pattern using the low-resolution image.The proposed algorithm features conpactness and high-speed rocognition.Real-time digital hardware implementation of the proposed algorithm is also presented in this paper. |
| キーワード(和) | パターン認識 / テンプレートマッチング / ディジタルハードウェア化 / FPGA |
| キーワード(英) | Pattern recognition / template matching / digital hardware implementation / FPGA |
| 資料番号 | CAS98-18,VLD98-18,DSP98-47 |
| 発行日 |
| 研究会情報 | |
| 研究会 | VLD |
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| 開催期間 | 1998/6/26(から1日開催) |
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| 委員長氏名（和） | |
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| 幹事氏名（和） | |
| 幹事氏名（英） | |
| 幹事補佐氏名（和） | |
| 幹事補佐氏名（英） | |
| 講演論文情報詳細 | |
| 申込み研究会 | VLSI Design Technologies (VLD) |
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| 本文の言語 | JPN |
| タイトル（和） | 2値パターン認識アルゴリズムの提案とその集積回路化に関する一考察 |
| サブタイトル（和） | |
| タイトル（英） | A proposition of the binary pattern recognition algorithm and its digital hardware implementation |
| サブタイトル（和） | |
| キーワード(1)（和/英） | パターン認識 / Pattern recognition |
| キーワード(2)（和/英） | テンプレートマッチング / template matching |
| キーワード(3)（和/英） | ディジタルハードウェア化 / digital hardware implementation |
| キーワード(4)（和/英） | FPGA / FPGA |
| 第 1 著者 氏名（和/英） | 徳永 祐介 / Yusuke Tokunaga |
| 第 1 著者 所属（和/英） | 熊本大学工学部電気システム工学科 Dept.Of Electrical and Computer Engineering, Kumamoto University |
| 第 2 著者 氏名（和/英） | 井上 高宏 / Takahiro Inoue |
| 第 2 著者 所属（和/英） | 熊本大学工学部電気システム工学科 Dept.Of Electrical and Computer Engineering, Kumamoto University |
| 発表年月日 | 1998/6/26 |
| 資料番号 | CAS98-18,VLD98-18,DSP98-47 |
| 巻番号（vol） | vol.98 |
| 号番号（no） | 142 |
| ページ範囲 | pp.- |
| ページ数 | 8 |
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