| 講演名 | 1997/9/26 極微細半導体素子の特性解析のためのモンテカルロ専用並列計算機の開発及び性能評価 島谷 民夫, 平野 圭一, 栗野 浩之, 小柳 光正, |
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| 抄録(和) | ゲート長0.1μm以下の極微細半導体素子において, モンテカルロ法による半導体素子シミュレーションは, ホットキャリア効果等の物理現象を解析するのに有効である. しかしながら, モンテカルロ法による半導体素子シミュレーションは, 必要とする物理量を精度良く計算するために, 追跡する電子や正孔の数を増やしたり, 追跡時間を増やしたりする必要があり, 計算時間が膨大になるという欠点を持っている. 今回, その問題点を克服するために, モンテカルロ法による半導体素子シミュレーション用に最適化した専用並列計算機を設計した. 又, 実際に専用並列計算機を試作し, その計算機上で半導体素子シミュレーションを実行させることにより, 専用並列計算システム全体が正常に動作することを確認した. |
| 抄録(英) | In ultra small devices with the gate length of sub-0.1pm, device simuilation based on Monte Carlo method is effective to analyse the physical phenomena such as hot carrier effect. In Monte Carlo method, the number of particles or the tracing time is increased to obtain the precise solution. As a result, the computational time becomes tremendously long. To overcome such problem of huge computational time, we have designed and developed a parallel computer system specific for Monte Carlo device simulation. Successful operation of this system have been confirmed by running the parallel Monte Carlo device simulator on this system. |
| キーワード(和) | 半導体素子シミュレーション / モンテカルロ法 / 並列処理 / 専用プロセッサ / 単一方向リングバス結合 |
| キーワード(英) | Device simulation / Monte Carlo method / Parallel processing / Monte Carlo RISC chip / One-way ring bus connection |
| 資料番号 | VLD97-73,ED97-111,SDM97-132,ICD97-148 |
| 発行日 |
| 研究会情報 | |
| 研究会 | VLD |
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| 開催期間 | 1997/9/26(から1日開催) |
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| テーマ（和） | |
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| 委員長氏名（和） | |
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| 幹事氏名（和） | |
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| 幹事補佐氏名（和） | |
| 幹事補佐氏名（英） | |
| 講演論文情報詳細 | |
| 申込み研究会 | VLSI Design Technologies (VLD) |
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| 本文の言語 | JPN |
| タイトル（和） | 極微細半導体素子の特性解析のためのモンテカルロ専用並列計算機の開発及び性能評価 |
| サブタイトル（和） | |
| タイトル（英） | Development and Evaluation of Parallel Computer System Specific for Monte Carlo Device Simulation |
| サブタイトル（和） | |
| キーワード(1)（和/英） | 半導体素子シミュレーション / Device simulation |
| キーワード(2)（和/英） | モンテカルロ法 / Monte Carlo method |
| キーワード(3)（和/英） | 並列処理 / Parallel processing |
| キーワード(4)（和/英） | 専用プロセッサ / Monte Carlo RISC chip |
| キーワード(5)（和/英） | 単一方向リングバス結合 / One-way ring bus connection |
| 第 1 著者 氏名（和/英） | 島谷 民夫 / Tamio Shimatani |
| 第 1 著者 所属（和/英） | 東北大学工学部機械知能工学科知能システム設計学 Department of Machine Intelligence and System Engineering, Intelligent System Design Laboratory, Tohoku University |
| 第 2 著者 氏名（和/英） | 平野 圭一 / Keiichi Hirano |
| 第 2 著者 所属（和/英） | 東北大学工学部機械知能工学科知能システム設計学 Department of Machine Intelligence and System Engineering, Intelligent System Design Laboratory, Tohoku University |
| 第 3 著者 氏名（和/英） | 栗野 浩之 / Hiroyuki Kurino |
| 第 3 著者 所属（和/英） | 東北大学工学部機械知能工学科知能システム設計学 Department of Machine Intelligence and System Engineering, Intelligent System Design Laboratory, Tohoku University |
| 第 4 著者 氏名（和/英） | 小柳 光正 / Mitsumasa Koyanagi |
| 第 4 著者 所属（和/英） | 東北大学工学部機械知能工学科知能システム設計学 Department of Machine Intelligence and System Engineering, Intelligent System Design Laboratory, Tohoku University |
| 発表年月日 | 1997/9/26 |
| 資料番号 | VLD97-73,ED97-111,SDM97-132,ICD97-148 |
| 巻番号（vol） | vol.97 |
| 号番号（no） | 269 |
| ページ範囲 | pp.- |
| ページ数 | 8 |
| 発行日 | |