講演名 | 1996/7/27 ニューラルネットワークによる64ビットDWTプロセッサのチップ設計 安達 晴康, 神尾 武司, 二宮 洋, 浅井 秀樹, |
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抄録(和) | 離散ウォルシュ変換は信号処理を行う際に有効な直交変換の1つである. 以前, 我々はHopfield 型線形計画ニューラルネットワークに基づく8ビット離散ウォルシュ変換ニューロチップを設計し, SPICEシミュレーションによって誤差1%以下, 収束速度30ns以下で動作することを確かめた. 本稿では, この8ビット離散ウォルシュ変換ニューロチップをモジュールとして用いることで, さらに多ビットの離散ウォルシュ変換を行うプロセッサの設計方法を提案する. |
抄録(英) | Discrete Walsh transform (DWT) is one of the most important techniques in the field of signal processing. We have proposed the 8bit DWT neuro chip based on Hopfield linear programming neural networks. From SPICE simulations, it have been confirmed that our chip keeps the error less than 1% and carries out the DWT within 30 nano-seconds. In this report, we show the design of the 64bit DWT neuro processor, using the 8bit DWT neuro chips as modules. |
キーワード(和) | ニューラルネットワーク / 離散ウォルシュ変換 / 直交行列 / モジュール化 / アナログ設計 |
キーワード(英) | neural networks / discrete Walsh transform / orthogonal matrix / modularization / analog design |
資料番号 | NLP-96-52 |
発行日 |
研究会情報 | |
研究会 | NLP |
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開催期間 | 1996/7/27(から1日開催) |
開催地(和) | |
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幹事補佐氏名(英) |
講演論文情報詳細 | |
申込み研究会 | Nonlinear Problems (NLP) |
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本文の言語 | JPN |
タイトル(和) | ニューラルネットワークによる64ビットDWTプロセッサのチップ設計 |
サブタイトル(和) | |
タイトル(英) | Design of 64 bit Discrete Walsh Transform Processor Based on Neural Networks |
サブタイトル(和) | |
キーワード(1)(和/英) | ニューラルネットワーク / neural networks |
キーワード(2)(和/英) | 離散ウォルシュ変換 / discrete Walsh transform |
キーワード(3)(和/英) | 直交行列 / orthogonal matrix |
キーワード(4)(和/英) | モジュール化 / modularization |
キーワード(5)(和/英) | アナログ設計 / analog design |
第 1 著者 氏名(和/英) | 安達 晴康 / Haruyasu ADACHI |
第 1 著者 所属(和/英) | 三栄ハイテックス株式会社 SANEI HYTECHS Co.,Ltd. |
第 2 著者 氏名(和/英) | 神尾 武司 / Takeshi KAMIO |
第 2 著者 所属(和/英) | 静岡大学システム工学科 Dept. of Syst. Eng., Shizuoka Univ. |
第 3 著者 氏名(和/英) | 二宮 洋 / Hiroshi NINOMIYA |
第 3 著者 所属(和/英) | 静岡大学システム工学科 Dept. of Syst. Eng., Shizuoka Univ. |
第 4 著者 氏名(和/英) | 浅井 秀樹 / Hideki ASAI |
第 4 著者 所属(和/英) | 静岡大学システム工学科 Dept. of Syst. Eng., Shizuoka Univ. |
発表年月日 | 1996/7/27 |
資料番号 | NLP-96-52 |
巻番号(vol) | vol.96 |
号番号(no) | 208 |
ページ範囲 | pp.- |
ページ数 | 8 |
発行日 |