講演名 | 2001/8/31 アンチェイリアシング機能を組込んだ可変利得及びオフセット補償機能付きスイッチトキャパシタはしご形フィルタ 河間 修一, 東 慎一郎, 飯塚 邦彦, 宮本 雅之, |
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抄録(和) | LC無損失はしご形フィルタをシュミレートしたSCフィルタにおいて、一部の積分回路に連続時間動作の機能も持たせることで、アンチエイリアシングフィルタを不要にした.これをW-CDMA受信機チャンネル選択用のカットオフ周波数1.92MHz, 30.72MHzサンプリング5次カウアーローパスフィルタに適用, 0.35μmCMOSプロセスで試作した.試作チップの1.8V電源での消費電流は2.81mA.面積は0.62mm^2であった.このフィルタはエイリアシングを40dB以上抑え, カットオフ周波数精度を無調整で10±%以内に収める.さらに_13.3dB~16.4dBの可変利得機能と, オフセット補償機能を有する.入力に50mVのオフセットが印加された状態での最大出力オフセットは11mV以下であった. |
抄録(英) | A combination of continuous-time and switched capacitor integrators in a simulated LC loss-less ladder yields a response with suppressed aliasing without the use of continuous-time pre-filtering Fabricated in a 0.35-μm CMOS process, a fifth-order Cauer low-pass filterfor a W-CDMA cellular phone receiver has a cut-off frequency of 1.92MHz and aliasing suppression of better than 40dB for 30.72-MHz sampling.Without using any tuning mechanism, a ±10-% accuracy of the cut-off frequency is achieved.As additional features the filter has variable gain from -13.3dB to 16.4dB and an offset compensation mechanism. With the latter, a 50-mV DC offset added to the input is suppressed to 11mV or less at the filter output under the maximum gain setting. The filter consumes 2.81mA at 1.8-V power supply in a die-area of 0.62mm^2. |
キーワード(和) | スイッチトキャパシタフィルタ / 連続時間フィルタ / アンチエイリアシング / オフセット補償 / CMOS / LSI |
キーワード(英) | Switched-capacitor filter / Continuous-time filter / Anti-aliasing / Offset compensation / CMOS / LSI |
資料番号 | ICD2001-92 |
発行日 |
研究会情報 | |
研究会 | ICD |
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開催期間 | 2001/8/31(から1日開催) |
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幹事補佐氏名(和) | |
幹事補佐氏名(英) |
講演論文情報詳細 | |
申込み研究会 | Integrated Circuits and Devices (ICD) |
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本文の言語 | ENG |
タイトル(和) | アンチェイリアシング機能を組込んだ可変利得及びオフセット補償機能付きスイッチトキャパシタはしご形フィルタ |
サブタイトル(和) | |
タイトル(英) | Embedded Anti-Aliasing in Switched-Capacitor Ladder Filters with Variable Gain and Offset Compensation |
サブタイトル(和) | |
キーワード(1)(和/英) | スイッチトキャパシタフィルタ / Switched-capacitor filter |
キーワード(2)(和/英) | 連続時間フィルタ / Continuous-time filter |
キーワード(3)(和/英) | アンチエイリアシング / Anti-aliasing |
キーワード(4)(和/英) | オフセット補償 / Offset compensation |
キーワード(5)(和/英) | CMOS / CMOS |
キーワード(6)(和/英) | LSI / LSI |
第 1 著者 氏名(和/英) | 河間 修一 / Shuichi KAWAMA |
第 1 著者 所属(和/英) | シャープ株式会社基盤技術研究所 Sharp Corporation, Adv. Tech.Research Labo. |
第 2 著者 氏名(和/英) | 東 慎一郎 / Shinichiro ASUMA |
第 2 著者 所属(和/英) | シャープ株式会社基盤技術研究所 Sharp Corporation, Adv. Tech.Research Labo. |
第 3 著者 氏名(和/英) | 飯塚 邦彦 / Kunihiko IIZUKA |
第 3 著者 所属(和/英) | シャープ株式会社基盤技術研究所 Sharp Corporation, Adv. Tech.Research Labo. |
第 4 著者 氏名(和/英) | 宮本 雅之 / Masayuki MIYAMOTO |
第 4 著者 所属(和/英) | シャープ株式会社基盤技術研究所 Sharp Corporation, Adv. Tech.Research Labo. |
発表年月日 | 2001/8/31 |
資料番号 | ICD2001-92 |
巻番号(vol) | vol.101 |
号番号(no) | 282 |
ページ範囲 | pp.- |
ページ数 | 8 |
発行日 |