講演名 | 1994/8/25 メモリ集積型プロセッサIMAP-LSI 木村 亨, 山下 信行, 相本 代志治, 中村 和之, 真鍋 尚, 藤田 善弘, 岡崎 信一郎, 山品 正勝, |
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抄録(和) | 2MbのBiCMOS SRAMと、64個のプロセッサブロックを1チップ上に集積した、メモリ集積型プロセッサIMAPを開発した。IMAPは0.55μmBiCMOSプロセスを用い、1チップ上に1100万個のトランジスタを15.1mm×15.6mmに集積化している。電源電圧3.3V、最大消費電力4Wで、メモリ部80MHz、プロセッサ部40MHzで動作し、1.28GBIsの広いメモリバスバンド幅、3.82GIPSの演算性能を実現している。 |
抄録(英) | Integrated Memory Array Processor (IMAP),which has 2Mb BiCMOS SRAM and 64 × processor element (PE),is developed.The fabrication technology of IMAP is 0.55μm BiCMOS process and 11-million transis tors are integrated in 15.1 mm × 15.6mm area.IMAP shows the high m emory bus bandwidth of 1.28-GB, s and the superior performance of 3.84 GIPS at 40MHz,3.3V,4W operation. |
キーワード(和) | メモリ / プロセッサ / SRAM / SIMD / 画像処理 / システム・オン・シリコン |
キーワード(英) | Memory / Processor / SRAM / SIMD / Graphics / System on Si |
資料番号 | ICD94-81 |
発行日 |
研究会情報 | |
研究会 | ICD |
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開催期間 | 1994/8/25(から1日開催) |
開催地(和) | |
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テーマ(和) | |
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幹事氏名(和) | |
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幹事補佐氏名(和) | |
幹事補佐氏名(英) |
講演論文情報詳細 | |
申込み研究会 | Integrated Circuits and Devices (ICD) |
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本文の言語 | JPN |
タイトル(和) | メモリ集積型プロセッサIMAP-LSI |
サブタイトル(和) | |
タイトル(英) | Integrated Memory Array Processor IMAP-LSI |
サブタイトル(和) | |
キーワード(1)(和/英) | メモリ / Memory |
キーワード(2)(和/英) | プロセッサ / Processor |
キーワード(3)(和/英) | SRAM / SRAM |
キーワード(4)(和/英) | SIMD / SIMD |
キーワード(5)(和/英) | 画像処理 / Graphics |
キーワード(6)(和/英) | システム・オン・シリコン / System on Si |
第 1 著者 氏名(和/英) | 木村 亨 / Tohru Kimura |
第 1 著者 所属(和/英) | NEC NEC |
第 2 著者 氏名(和/英) | 山下 信行 / Nobuyuki Yamashita |
第 2 著者 所属(和/英) | NEC NEC |
第 3 著者 氏名(和/英) | 相本 代志治 / Yoshiharu Aimoto |
第 3 著者 所属(和/英) | NEC NEC |
第 4 著者 氏名(和/英) | 中村 和之 / Kazuyuki Nakamura |
第 4 著者 所属(和/英) | NEC NEC |
第 5 著者 氏名(和/英) | 真鍋 尚 / Takashi Manabe |
第 5 著者 所属(和/英) | NEC NEC |
第 6 著者 氏名(和/英) | 藤田 善弘 / Yoshihiro Fujita |
第 6 著者 所属(和/英) | NEC NEC |
第 7 著者 氏名(和/英) | 岡崎 信一郎 / Shin'ichiro Okazaki |
第 7 著者 所属(和/英) | NEC NEC |
第 8 著者 氏名(和/英) | 山品 正勝 / Masakazu Yamashina |
第 8 著者 所属(和/英) | NEC NEC |
発表年月日 | 1994/8/25 |
資料番号 | ICD94-81 |
巻番号(vol) | vol.94 |
号番号(no) | 203 |
ページ範囲 | pp.- |
ページ数 | 8 |
発行日 |