| 講演名 | 1995/5/26 多レベルしきい値制御に基づく高密度CAMとその応用 羽生 貴弘, 金川 直紀, 亀山 充隆, |
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| 抄録(和) | 連想メモリ(CAM)では、各メモリセル内に演算機能を付加しているため、その高密度化が重要であると考えられる。本稿では、多値論理に基づく新しいCAMの構成を提案する。各セルにおける記憶データに対する一致検出及び大小比較演算は、2種類のしきい演算を逐次的に実行することにより行なわれる。一方、多値符号化表現により、1ワード内のセル数が減少するため、マッチラインの長さを大幅に削減でさる。実際、同等機能の2値CAMと比較してセル面積を約19%に、処理速度を約1.9倍高速にできることを明らかにしている。さらに本稿では、提案の多値CAMを知能自動車用衝突チェックVLSIプロセッサへ応用し、その有用性を定量的に評価する。 |
| 抄録(英) | This paper presents a high-density content-addressable memory (CAM) based on multiple-valued logic. In the proposed CAM, various search operations in each cell are performed by a combination of two multiple-valued threshold operations with different thresholds. Since multiple-valued-encoded data corresponds to the threshold voltage of a transistor, each cell circuit can be simply designed using only a single floating-gate MOS transistor. As a result, the cell area of the proposed CAM is reduced to 19% in comparison with that of a conventional binary CAM cell. As a typical example, the proposed CAM is applied to a collision detection VLSI processor for an intelligent vehicle. The performance of the CAM-based VLSI processor is evaluated to be about 2.6 times higher than that of a conventional binary one. |
| キーワード(和) | 並列照合 / 多値論理 / しきい演算 / フローティングゲートMOSトランジスタ / 衝突チェックVLSIプロセッサ |
| キーワード(英) | parallel search operation / multiple-valued logic / threshold operation / floating-gate MOS / collision detection VLSI processor |
| 資料番号 | |
| 発行日 |
| 研究会情報 | |
| 研究会 | ICD |
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| 開催期間 | 1995/5/26(から1日開催) |
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| 幹事氏名（和） | |
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| 幹事補佐氏名（和） | |
| 幹事補佐氏名（英） | |
| 講演論文情報詳細 | |
| 申込み研究会 | Integrated Circuits and Devices (ICD) |
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| 本文の言語 | JPN |
| タイトル（和） | 多レベルしきい値制御に基づく高密度CAMとその応用 |
| サブタイトル（和） | |
| タイトル（英） | A High-Density CAM Based on Multi-Level Threshold Control and Its Application |
| サブタイトル（和） | |
| キーワード(1)（和/英） | 並列照合 / parallel search operation |
| キーワード(2)（和/英） | 多値論理 / multiple-valued logic |
| キーワード(3)（和/英） | しきい演算 / threshold operation |
| キーワード(4)（和/英） | フローティングゲートMOSトランジスタ / floating-gate MOS |
| キーワード(5)（和/英） | 衝突チェックVLSIプロセッサ / collision detection VLSI processor |
| 第 1 著者 氏名（和/英） | 羽生 貴弘 / Takahiro Hanyu |
| 第 1 著者 所属（和/英） | 東北大学大学院情報科学研究科 Graduate School of Information Sciences, Tohoku University |
| 第 2 著者 氏名（和/英） | 金川 直紀 / Naoki Kanagawa |
| 第 2 著者 所属（和/英） | 東北大学大学院情報科学研究科 Graduate School of Information Sciences, Tohoku University |
| 第 3 著者 氏名（和/英） | 亀山 充隆 / Michitaka Kameyama |
| 第 3 著者 所属（和/英） | 東北大学大学院情報科学研究科 Graduate School of Information Sciences, Tohoku University |
| 発表年月日 | 1995/5/26 |
| 資料番号 | |
| 巻番号（vol） | vol.95 |
| 号番号（no） | 72 |
| ページ範囲 | pp.- |
| ページ数 | 8 |
| 発行日 | |