| 講演名 | 1998/3/19 高速マルチレイヤ処理1チップスイッチアーキテクチャ 小林 正好, 村瀬 勉, 定村 正, |
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| 抄録(和) | 本稿では, 数百万パケット/秒の処理能力をもつマルチレイヤスイッチの機能をIチップLSIで実現するためのアーキテクチャについて述べる.プロトコル処理の面では, レイヤ2とレイヤ3の冗長処理を省略するとともにフォワーディングテーブル検索処理を統合し, フォワーディングテーブル検索回数を減少させることで高速化を図った.また, ハードウェア面では高速なフォワーディングテーブル検索を実行できる専用アドレスサーチチップを開発し, パイプライン処理によってスループット向上を図った.パイプライン処理ではシーケンサを用い, 複雑な専用処理を行う論理回路マクロとともに, 汎用的な処理の論理回路マクロを組み込むことで処理の高速性と柔軟性を両立させた. |
| 抄録(英) | In this paper, we propose multi-layer switching LSI architecture which can handle and forward both layer2 and 3 packets at a speed of several million packets per second with single LSI chip. Concerning protocol processing, in order to improve the speed of processing by reducing the number of forwarding table search, we remove a redundant table lookup and integrate layer2 and 3 forwarding table. As for packet switching engine architecture, we designed a high-speed searcher chip for IP longest prefix matching and adopt pipeline processing architecture to achieve high throughput of forwarding. In each pipeline stage, in order to optimize the tradeoff of speed and flexibility, we employ sequencers which can operate logical circuits for both generic and special purpose. |
| キーワード(和) | マルチレイヤスイッチ / テーブル検索 / パイプライン処理 / シーケンサ / 高速ルータ / ATM |
| キーワード(英) | multi-layer switch / search table / pipelining / sequencer / fast router / ATM |
| 資料番号 | |
| 発行日 |
| 研究会情報 | |
| 研究会 | SSE |
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| 開催期間 | 1998/3/19(から1日開催) |
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| 委員長氏名（和） | |
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| 副委員長氏名（英） | |
| 幹事氏名（和） | |
| 幹事氏名（英） | |
| 幹事補佐氏名（和） | |
| 幹事補佐氏名（英） | |
| 講演論文情報詳細 | |
| 申込み研究会 | Switching Systems Engineering (SSE) |
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| 本文の言語 | JPN |
| タイトル（和） | 高速マルチレイヤ処理1チップスイッチアーキテクチャ |
| サブタイトル（和） | |
| タイトル（英） | High-Speed Protocol Processing Architecture for Giga-bit Multi-layer Switch LSI |
| サブタイトル（和） | |
| キーワード(1)（和/英） | マルチレイヤスイッチ / multi-layer switch |
| キーワード(2)（和/英） | テーブル検索 / search table |
| キーワード(3)（和/英） | パイプライン処理 / pipelining |
| キーワード(4)（和/英） | シーケンサ / sequencer |
| キーワード(5)（和/英） | 高速ルータ / fast router |
| キーワード(6)（和/英） | ATM / ATM |
| 第 1 著者 氏名（和/英） | 小林 正好 / Masayoshi Kobayashi |
| 第 1 著者 所属（和/英） | NEC C&C メディア研究所 C&C Media Research Laboratories, NEC Corporation |
| 第 2 著者 氏名（和/英） | 村瀬 勉 / Tutomu Murase |
| 第 2 著者 所属（和/英） | NEC C&C メディア研究所 C&C Media Research Laboratories, NEC Corporation |
| 第 3 著者 氏名（和/英） | 定村 正 / Tadashi Jomura |
| 第 3 著者 所属（和/英） | NEC LSI事業本部システムマイクロ事業部 System Micro Division, Network LSI Department, NEC Corporation |
| 発表年月日 | 1998/3/19 |
| 資料番号 | |
| 巻番号（vol） | vol.97 |
| 号番号（no） | 617 |
| ページ範囲 | pp.- |
| ページ数 | 6 |
| 発行日 | |