講演名 1998/4/24
Bus Instruction Set Computer型プロセッサBISC-1
丸子 健一, 山下 幸彦,
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抄録(和) BISC(Bus Instruction Set Computer)とよばれるマイクロプロセッサの新しいアーキテクチャが提案されている.これは, 命令を本質的にプロセッサの内部バスによるレジスタ回転送だけに限るものである.このため, 機能の追加変更に対して命令セットの変更が不要なため, 容易に様々な機能を追加することができるという利点をもつ.現在, 2重化されたシステム-整数用バスを持つBISC-1の論理設計を進めている.本論文では, まず, BISC-1の基本構成と仕様ついて説明を行なう.次に, BISC-1で算術論理演算, メモリアクセス, 分岐・コールを行なう方法を述べる.
抄録(英) A new architecture of a microprocessor called BISC (Bus Instruction Set Computer) was proposed. This type of processor has instructions only for data transfer between internal registers through internal buses. Therefore, since we don't need to change the instruction set when we add or modify functions of the processor, it has the advantage that various functions can be added easily. Presently, we proceed with logic design of BISC-1 which has a double system and integer bus. In this paper, we explain a basic constitution and specifications of BISC-1 and also describe the way to do arithemetic logic operation, memory access, branch and call.
キーワード(和) マイクロプロセッサ / アーキテクチャ / CISC / RISC / BISC
キーワード(英) microprocessor / architecture / CISC / RISC / BISC
資料番号
発行日

研究会情報
研究会 CPSY
開催期間 1998/4/24(から1日開催)
開催地(和)
開催地(英)
テーマ(和)
テーマ(英)
委員長氏名(和)
委員長氏名(英)
副委員長氏名(和)
副委員長氏名(英)
幹事氏名(和)
幹事氏名(英)
幹事補佐氏名(和)
幹事補佐氏名(英)

講演論文情報詳細
申込み研究会 Computer Systems (CPSY)
本文の言語 JPN
タイトル(和) Bus Instruction Set Computer型プロセッサBISC-1
サブタイトル(和)
タイトル(英) Bus Instruction Set Computer BISC-1
サブタイトル(和)
キーワード(1)(和/英) マイクロプロセッサ / microprocessor
キーワード(2)(和/英) アーキテクチャ / architecture
キーワード(3)(和/英) CISC / CISC
キーワード(4)(和/英) RISC / RISC
キーワード(5)(和/英) BISC / BISC
第 1 著者 氏名(和/英) 丸子 健一 / Kenichi Maruko
第 1 著者 所属(和/英) 東京工業大学理工学研究科電気・電子工学専攻
Cource of Electrical and Electronic Engineering, Graduate School of Science and Engineering
第 2 著者 氏名(和/英) 山下 幸彦 / Yukihiko Yamashita
第 2 著者 所属(和/英) 東京工業大学工学部開発システム工学科
Department of International Development Engineering, Faculty Engineering Tokyo Institute of Technology
発表年月日 1998/4/24
資料番号
巻番号(vol) vol.98
号番号(no) 25
ページ範囲 pp.-
ページ数 8
発行日