講演名 2003/1/21
FPGAとPCの連携によるSystem On a Chipの検証手法
中村 祐一, 細川 晃平,
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抄録(和) 本稿では、System on a Chip (SoC)のシステム検証手法を提案する。提案手法はFPGAを使ったHWベースのモデリング手法とPC上のソフトウエアによるモデリング手段を組み合わせることによって、全体をFPGAでモデリング化するフルチップエミュレータより少ないFPGAの個数で構成できるため安価で、全体を計算機上のソフトウェアシミュレーションでモデル化する場合と比べて高速に実行することができる。FPGAとPCを通信する回路は単純な直接接続になっており、FPGAとPCにモデル化した回路構造に依存しない。また、この通信回路の構成を変更することによってさまざまなFPGAとPCの協調手法が実現できる。3つのLSI設計においてこの検証手法を適用した結果、3個のFPGAで0.5MHzから16MHzの動作周波数でのシステム検証を行なうことができた。
抄録(英) This paper describes a new verification method for Systems on a Chip. The proposed method integrates FPGA based modeling using an emulation engine and software based modeling on a PC. The communication between the FPGA emulation and the PC is implemented by simple bus architecture. The proposed method achieves low cost, easy debugging, rich portability, and high verification speed. For a cheap verification environment, it must be implemented by at least the number of FPGAs. The method was applied to 3 verification projects involving the design of real chips. In these projects, this verification methodology completes system verification at 0.5-16MHz using at most 3 FPGAs and a Windows PC.
キーワード(和) SoC / システム検証 / FPGA
キーワード(英) SoC / System Verification / FPGA
資料番号 VLD2002-124,CPSY2002-77
発行日

研究会情報
研究会 VLD
開催期間 2003/1/21(から1日開催)
開催地(和)
開催地(英)
テーマ(和)
テーマ(英)
委員長氏名(和)
委員長氏名(英)
副委員長氏名(和)
副委員長氏名(英)
幹事氏名(和)
幹事氏名(英)
幹事補佐氏名(和)
幹事補佐氏名(英)

講演論文情報詳細
申込み研究会 VLSI Design Technologies (VLD)
本文の言語 JPN
タイトル(和) FPGAとPCの連携によるSystem On a Chipの検証手法
サブタイトル(和)
タイトル(英) A Verification Method for System On a Chip by using Combined Approach of FPGA Emulation and PC Software
サブタイトル(和)
キーワード(1)(和/英) SoC / SoC
キーワード(2)(和/英) システム検証 / System Verification
キーワード(3)(和/英) FPGA / FPGA
第 1 著者 氏名(和/英) 中村 祐一 / Yuichi Nakamura
第 1 著者 所属(和/英) NECマルチメディア研究所
Multimedia Laboratories, NEC Corporation
第 2 著者 氏名(和/英) 細川 晃平 / Kouhei Hosokawa
第 2 著者 所属(和/英) NECマルチメディア研究所
Multimedia Laboratories, NEC Corporation
発表年月日 2003/1/21
資料番号 VLD2002-124,CPSY2002-77
巻番号(vol) vol.102
号番号(no) 608
ページ範囲 pp.-
ページ数 6
発行日