| 講演名 | 2004/5/14 2.8GFLOPS, 36Mポリゴン/sのFPUを搭載するデジタル家電向け組込みプロセッサコア 荒川 文男, 小沢 基一, 西井 修, 服部 俊洋, 吉永 健, 林 伴一, 清重 賢一, 岡田 崇, 西堀 雅和, 児玉 征之, 亀井 達也, 石川 誠, 入田 隆宏, 新田 祐介, 平岡 徹, |
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| 抄録(和) | SuperHアーキテクチャの組込みプロセッサコアを130 nm CMOS プロセスで開発した.ワースト条件で400MHz動作し, 250mWで720MIPSのドライストーン性能, 2.8GFLOPSの浮動小数点ピーク性能,及び36Mポリゴン/秒の基本グラフィクス性能を達成した.プロセッサコアは2命令同時発行の7段パイプライン構成で,前世代の5段パイプライン構成の約1.5倍の動作周波数を達成しながら,前世代と同等の方式性能1.8MIPS/MHzを達成した.また,様々なアプリケーションの幅広い要求に応えることができる柔軟性を持ち,特に携帯電話,デジタルカメラ,カーナビゲーションシステム等のデジタル家電に適している. |
| 抄録(英) | An embedded-processor core implemented in a 130nm CMOS process runs at 400MHz in the worst condition and achieves 720MIPS with a power of 250mW, 2.8GFLOPS and 36M polygons/s graphics performance. The processor core employs a dual-issue seven-stage pipeline architecture, and enhance the operating frequency 1.5 times higher than the previous five-stage processor core while maintaining 1.8MIPS/MHz instruction efficiency of the previous one. The processor core is flexible to meet a wide range of requirements for each type of applications, and suitable for digital consumer appliances such as cellular phones, digital still/video cameras, and car navigation systems. |
| キーワード(和) | デジタル家電 / 組込みプロセッサ / パイプライン / グラフィクス |
| キーワード(英) | Digital Consumer Appliance / Embedded Processor / Pipeline / Graphics |
| 資料番号 | ICD2004-25 |
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| 研究会情報 | |
| 研究会 | ICD |
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| 開催期間 | 2004/5/14(から1日開催) |
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| テーマ（和） | |
| テーマ（英） | |
| 委員長氏名（和） | |
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| 幹事氏名（和） | |
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| 幹事補佐氏名（和） | |
| 幹事補佐氏名（英） | |
| 講演論文情報詳細 | |
| 申込み研究会 | Integrated Circuits and Devices (ICD) |
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| 本文の言語 | JPN |
| タイトル（和） | 2.8GFLOPS, 36Mポリゴン/sのFPUを搭載するデジタル家電向け組込みプロセッサコア |
| サブタイトル（和） | |
| タイトル（英） | An Embedded Processor Core for Consumer Appliances with 2.8GFLOPS and 36M Polygons/s FPU |
| サブタイトル（和） | |
| キーワード(1)（和/英） | デジタル家電 / Digital Consumer Appliance |
| キーワード(2)（和/英） | 組込みプロセッサ / Embedded Processor |
| キーワード(3)（和/英） | パイプライン / Pipeline |
| キーワード(4)（和/英） | グラフィクス / Graphics |
| 第 1 著者 氏名（和/英） | 荒川 文男 / Fumio ARAKAWA |
| 第 1 著者 所属（和/英） | (株)日立製作所中央研究所 Central Research Laboratory, Hitachi, Ltd. |
| 第 2 著者 氏名（和/英） | 小沢 基一 / Motokazu OZAWA |
| 第 2 著者 所属（和/英） | (株)日立製作所中央研究所 Central Research Laboratory, Hitachi, Ltd. |
| 第 3 著者 氏名（和/英） | 西井 修 / Osamu NISHII |
| 第 3 著者 所属（和/英） | スーパーエイチジャパン(株) SuperH (Japan), Ltd. |
| 第 4 著者 氏名（和/英） | 服部 俊洋 / Toshihiro HATTORI |
| 第 4 著者 所属（和/英） | スーパーエイチジャパン(株) SuperH (Japan), Ltd. |
| 第 5 著者 氏名（和/英） | 吉永 健 / Takeshi YOSHINAGA |
| 第 5 著者 所属（和/英） | スーパーエイチジャパン(株) SuperH (Japan), Ltd. |
| 第 6 著者 氏名（和/英） | 林 伴一 / Tomoichi HAYASHI |
| 第 6 著者 所属（和/英） | スーパーエイチジャパン(株) SuperH (Japan), Ltd. |
| 第 7 著者 氏名（和/英） | 清重 賢一 / Yoshikazu KIYOSHIGE |
| 第 7 著者 所属（和/英） | スーパーエイチジャパン(株) SuperH (Japan), Ltd. |
| 第 8 著者 氏名（和/英） | 岡田 崇 / Takashi OKADA |
| 第 8 著者 所属（和/英） | (株)日立製作所中央研究所 Central Research Laboratory, Hitachi, Ltd. |
| 第 9 著者 氏名（和/英） | 西堀 雅和 / Masakazu NISHIBORI |
| 第 9 著者 所属（和/英） | (株)ルネサステクノロジ Renesas Technology Corp. |
| 第 10 著者 氏名（和/英） | 児玉 征之 / Tomoyuki KODAMA |
| 第 10 著者 所属（和/英） | (株)日立製作所中央研究所 Central Research Laboratory, Hitachi, Ltd. |
| 第 11 著者 氏名（和/英） | 亀井 達也 / Tatsuya KAMEI |
| 第 11 著者 所属（和/英） | (株)ルネサステクノロジ Renesas Technology Corp. |
| 第 12 著者 氏名（和/英） | 石川 誠 / Makoto ISHIKAWA |
| 第 12 著者 所属（和/英） | (株)日立製作所中央研究所 Central Research Laboratory, Hitachi, Ltd. |
| 第 13 著者 氏名（和/英） | 入田 隆宏 / Takahiro IRITA |
| 第 13 著者 所属（和/英） | (株)ルネサステクノロジ Renesas Technology Corp. |
| 第 14 著者 氏名（和/英） | 新田 祐介 / Yusuke NITTA |
| 第 14 著者 所属（和/英） | (株)ルネサステクノロジ Renesas Technology Corp. |
| 第 15 著者 氏名（和/英） | 平岡 徹 / Toru HIRAOKA |
| 第 15 著者 所属（和/英） | スーパーエイチジャパン(株) SuperH (Japan), Ltd. |
| 発表年月日 | 2004/5/14 |
| 資料番号 | ICD2004-25 |
| 巻番号（vol） | vol.104 |
| 号番号（no） | 67 |
| ページ範囲 | pp.- |
| ページ数 | 6 |
| 発行日 | |