| 講演名 | 2003/12/12 差分光再構成型ゲートアレイに使用するダイナミック再構成回路(回路技術(一般,超高速・低電力・高機能を目指した新アーキテクチャ)) 藤目 竜二, 渡邊 実, 小林 史典, |
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| PDFダウンロードページ | PDFダウンロードページへ |
| 抄録(和) | |
| 抄録(英) | A new dynamic reconfiguration circuit for Optically Differential Reconfigurable Gate Arrays (ODRGAs) is proposed to reduce the area occupied by its reconfiguration circuit on a VLSI chip. A dynamic circuit technique is partially introduced into our previously proposed reconfiguration circut using a static technique and the implementation area of the circuit is reduced 42% compared with that of a static technique. This paper shows a new dynamic reconfiguration circuit, its layout for 0.35 um CMOS process, and HSPICE simulation results. |
| キーワード(和) | |
| キーワード(英) | ODRGAs / FPGAs / VLSIs / Optical Reconfiguration |
| 資料番号 | ICD2003-192(2003-12) |
| 発行日 |
| 研究会情報 | |
| 研究会 | ICD |
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| 開催期間 | 2003/12/12(から1日開催) |
| 開催地（和） | |
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| 委員長氏名（和） | |
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| 幹事氏名（和） | |
| 幹事氏名（英） | |
| 幹事補佐氏名（和） | |
| 幹事補佐氏名（英） | |
| 講演論文情報詳細 | |
| 申込み研究会 | Integrated Circuits and Devices (ICD) |
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| 本文の言語 | JPN |
| タイトル（和） | 差分光再構成型ゲートアレイに使用するダイナミック再構成回路(回路技術(一般,超高速・低電力・高機能を目指した新アーキテクチャ)) |
| サブタイトル（和） | |
| タイトル（英） | A dynamic reconfiguration circuit for Optically Differential Reconfigurable Gate Arrays |
| サブタイトル（和） | |
| キーワード(1)（和/英） | / ODRGAs |
| 第 1 著者 氏名（和/英） | 藤目 竜二 / Ryuji Fujime |
| 第 1 著者 所属（和/英） | 九州工業大学情報工学部 Kyushu Institute of Technology |
| 第 2 著者 氏名（和/英） | 渡邊 実 / Minoru Watanabe |
| 第 2 著者 所属（和/英） | 九州工業大学情報工学部 Kyushu Institute of Technology |
| 第 3 著者 氏名（和/英） | 小林 史典 / Fuminori Kobayashi |
| 第 3 著者 所属（和/英） | 九州工業大学情報工学部 Kyushu Institute of Technology |
| 発表年月日 | 2003/12/12 |
| 資料番号 | ICD2003-192(2003-12) |
| 巻番号（vol） | vol.103 |
| 号番号（no） | 510 |
| ページ範囲 | pp.- |
| ページ数 | 4 |
| 発行日 | |