| 講演名 | 2018-11-15 S/H回路のクロック信号の位相・周波数を変化させることによるサブサンプリングPLLの位相制御手法 和田 平(三菱電機), 水谷 浩之(三菱電機), 田島 賢一(三菱電機), |
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| 抄録(和) | APAAシステムにおいて，アンテナ素子の送信信号間の位相差を制御する手法の1つとして，LO波を生成するPLLの出力信号の位相差を制御する方式がある．本方式のPLLには，位相差の制御機能の他に，レーダ性能や通信品質の向上のため，低位相雑音特性が求められる．本稿では，低位相雑音化に有利なサブサンプリングPLLにおいて，その要素回路であるS/H回路に入力するクロック信号の位相と周波数を変化させることにより，PLLの出力信号の位相制御を行う手法を提案する．提案する手法において，サブサンプリングPLLの出力信号の位相は，クロック信号の位相とクロック信号の次数n（nは整数であり，クロック信号と出力信号の周波数比）の積で表すことができ，クロック信号の位相と周波数を変化させることで位相制御が可能となる．ここでは，市販部品を用いてサブサンプリングPLLを試作し，実測による原理検証を行った．その結果，所望の位相制御が得られ，提案手法の有効性を確認した．このとき，計算結果と測定結果の位相誤差は2.13deg. p-pである． |
| 抄録(英) | A phase control method of PLL that generates a LO signal was reported as controlling a phase difference between transmitted signals in an APAA system. In addition, low phase noise performance is required for the PLL in order to improve radar performance and communication quality in the APAA system. In this paper, phase control method for subsampling PLL by varying phase and frequency of clock signal of S/H circuit is proposed. In the proposed method, a phase of an output signal of the subsampling PLL is expressed by the product of a phase of the clock signal and a frequency ratio of the clock signal and the output signal. The proposed method enables the phase control by varying the phase and frequency of the clock signal. Experimental results show the desired phase control performance. A measured maximum phase difference between calculated and experimental results was 2.13degree p-p. |
| キーワード(和) | サブサンプリングPLL / 位相制御 / S/H回路 |
| キーワード(英) | Subsampling PLL / Phase control / S/H circuit |
| 資料番号 | MW2018-97 |
| 発行日 | 2018-11-08 (MW) |
| 研究会情報 | |
| 研究会 | MW |
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| 開催期間 | 2018/11/15(から2日開催) |
| 開催地（和） | 福江文化会館 |
| 開催地（英） | Fukue Cultural Hall |
| テーマ（和） | マイクロ波/一般 |
| テーマ（英） | Microwave Technologies |
| 委員長氏名（和） | 村口 正弘(東京理科大) |
| 委員長氏名（英） | Masahiro Muraguchi(TUS) |
| 副委員長氏名（和） | 古神 義則(宇都宮大) / 岡崎 浩司(NTTドコモ) / 田島 賢一(三菱電機) |
| 副委員長氏名（英） | Yoshinori Kogami(Utsunomiya Univ.) / Hiroshi Okazaki(NTT DOCOMO) / Kenichi Tajima(Mitsubishi Electric) |
| 幹事氏名（和） | 中村 宝弘(日立) / 清水 隆志(宇都宮大) |
| 幹事氏名（英） | Takahiro Nakamura(HITACHI) / Takashi Shimizu(Utsunomiya Univ.) |
| 幹事補佐氏名（和） | 本良 瑞樹(東北大) / 吉田 賢史(鹿児島大) |
| 幹事補佐氏名（英） | Mizuki Motoyoshi(Tohoku Univ.) / Satoshi Yoshida(Kagoshima Univ.) |
| 講演論文情報詳細 | |
| 申込み研究会 | Technical Committee on Microwaves |
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| 本文の言語 | JPN |
| タイトル（和） | S/H回路のクロック信号の位相・周波数を変化させることによるサブサンプリングPLLの位相制御手法 |
| サブタイトル（和） | |
| タイトル（英） | Phase Control Method for Subsampling PLL by Varying Phase and Frequency of Clock Signal of S/H Circuit |
| サブタイトル（和） | |
| キーワード(1)（和/英） | サブサンプリングPLL / Subsampling PLL |
| キーワード(2)（和/英） | 位相制御 / Phase control |
| キーワード(3)（和/英） | S/H回路 / S/H circuit |
| 第 1 著者 氏名（和/英） | 和田 平 / Osamu Wada |
| 第 1 著者 所属（和/英） | 三菱電機株式会社(略称：三菱電機) Mitsubishi Electric Corporation(略称：Mitsubishi Electric Corp.) |
| 第 2 著者 氏名（和/英） | 水谷 浩之 / Hiroyuki Mizutani |
| 第 2 著者 所属（和/英） | 三菱電機株式会社(略称：三菱電機) Mitsubishi Electric Corporation(略称：Mitsubishi Electric Corp.) |
| 第 3 著者 氏名（和/英） | 田島 賢一 / Kenichi Tajima |
| 第 3 著者 所属（和/英） | 三菱電機株式会社(略称：三菱電機) Mitsubishi Electric Corporation(略称：Mitsubishi Electric Corp.) |
| 発表年月日 | 2018-11-15 |
| 資料番号 | MW2018-97 |
| 巻番号（vol） | vol.118 |
| 号番号（no） | MW-308 |
| ページ範囲 | pp.31-34(MW), |
| ページ数 | 4 |
| 発行日 | 2018-11-08 (MW) |