| 講演名 | 2016-05-11 劣勾配法の遅延解析への応用 宮下 弘(北九州市大), 川原口 高太郎(北九州市大), |
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| 抄録(和) | |
| 抄録(英) | |
| キーワード(和) | |
| キーワード(英) | |
| 資料番号 | VLD2016-1 |
| 発行日 | 2016-05-04 (VLD) |
| 研究会情報 | |
| 研究会 | VLD / IPSJ-SLDM |
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| 開催期間 | 2016/5/11(から1日開催) |
| 開催地（和） | 北九州国際会議場 |
| 開催地（英） | Kitakyushu International Conference Center |
| テーマ（和） | システム設計および一般 |
| テーマ（英） | System Design, etc. |
| 委員長氏名（和） | 松永 裕介(九大) / 福井 正博(立命館大) |
| 委員長氏名（英） | Yusuke Matsunaga(Kyushu Univ.) / Masahiro Fukui(Ritsumeikan Univ.) |
| 副委員長氏名（和） | 竹中 崇(NEC) |
| 副委員長氏名（英） | Takashi Takenana(NEC) |
| 幹事氏名（和） | 冨山 宏之(立命館大) / 福田 大輔(富士通研) / 横山 昌生(シャープ) / 高島 康裕(北九州市大) / 西出 岳央(東芝) |
| 幹事氏名（英） | Hiroyuki Tomiyama(Ritsumeikan Univ.) / Daisuke Fukuda(Fujitsu Labs.) / Masao Yokoyama(Sharp) / Yasuhiro Takashima(Kitakyushu City Univ.) / Takeo Nishide(Toshiba) |
| 幹事補佐氏名（和） | 谷口 一徹(立命館大) |
| 幹事補佐氏名（英） | Ittetsu Taniguchi(Ritsumeikan Univ.) |
| 講演論文情報詳細 | |
| 申込み研究会 | Technical Committee on VLSI Design Technologies / Special Interest Group on System and LSI Design Methodology |
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| 本文の言語 | JPN |
| タイトル（和） | 劣勾配法の遅延解析への応用 |
| サブタイトル（和） | |
| タイトル（英） | An Application of Subgradient Method to Delay Analysis |
| サブタイトル（和） | |
| キーワード(1)（和/英） | |
| 第 1 著者 氏名（和/英） | 宮下 弘 / Hiroshi Miyashita |
| 第 1 著者 所属（和/英） | 北九州市立大学(略称：北九州市大) The University of Kitakyushu(略称：The Univ. of Kitakyushu) |
| 第 2 著者 氏名（和/英） | 川原口 高太郎 / Koutaro Kawaraguchi |
| 第 2 著者 所属（和/英） | 北九州市立大学(略称：北九州市大) The University of Kitakyushu(略称：The Univ. of Kitakyushu) |
| 発表年月日 | 2016-05-11 |
| 資料番号 | VLD2016-1 |
| 巻番号（vol） | vol.116 |
| 号番号（no） | VLD-21 |
| ページ範囲 | pp.1-4(VLD), |
| ページ数 | 4 |
| 発行日 | 2016-05-04 (VLD) |