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講演名 |
2022-08-08 16:35
[招待講演]A 3.3-GHz 4.6-mW Fractional-N Type-II Hybrid Switched-Capacitor Sampling PLL Using CDAC-Embedded Digital Integral Path with -80-dBc Reference Spur ○Zule Xu・Masaru Osada・Tetsuya Iizuka(UTokyo) |
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SDM2022-43 ICD2022-11 |
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技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) |
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