情報・システム-リコンフィギャラブルシステム(開催日:2009/09/10)

タイトル/著者/発表日/資料番号
表紙

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[発表日]2009/9/10
[資料番号]
目次

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[発表日]2009/9/10
[資料番号]
FPGAを用いた回転パターンの実時間検出(応用1)

谷田 吉史,  丸山 勉,  

[発表日]2009/9/10
[資料番号]RECONF2009-19
ロジックエレメントを節約したFPGAラベリング(応用1)

伊藤 靖朗,  中野 浩嗣,  

[発表日]2009/9/10
[資料番号]RECONF2009-20
FPGAアレイCubeを用いたレーベンシュタイン距離計算の性能評価(応用1)

吉見 真聡,  三木 光範,  西川 由理,  設樂 明宏,  天野 英晴,  メンサー オスカー,  

[発表日]2009/9/10
[資料番号]RECONF2009-21
FPGAによる電源電圧制御回路の実装及び制御精度の評価(応用1)

副島 政人,  酒見 隼也,  柴田 裕一郎,  黒川 不二雄,  濱田 剛,  正田 備也,  小栗 清,  

[発表日]2009/9/10
[資料番号]RECONF2009-22
配線性を利用する低消費電力指向のクラスタリング及び配置手法(デバイスアーキテクチャ1)

今泉 真哉,  飯田 全広,  末吉 敏則,  

[発表日]2009/9/10
[資料番号]RECONF2009-23
実装効率改善へ向けたP同値類に基づくLUTの論理出現率に関する調査(デバイスアーキテクチャ1)

新谷 政樹,  加藤 宏太,  尼崎 太樹,  飯田 全広,  末吉 敏則,  

[発表日]2009/9/10
[資料番号]RECONF2009-24
電力を再構成可能なFlex Power FPGAチップの設計と評価(デバイスアーキテクチャ1)

日置 雅和,  河並 崇,  松本 洋平,  堤 利幸,  中川 格,  関川 敏弘,  小池 帆平,  

[発表日]2009/9/10
[資料番号]RECONF2009-25
Dua-Vthセルの利用による動的リコンフィギャラブルプロセッサのリーク電力削減の評価(デバイスアーキテクチャ1)

天野 英晴,  平井 啓一郎,  佐野 徹,  加東 勝,  齊藤 貴樹,  

[発表日]2009/9/10
[資料番号]RECONF2009-26
YAWARA : 自己最適化計算機システム・プロジェクト

馬場 敬信,  大津 金光,  横田 隆史,  

[発表日]2009/9/10
[資料番号]RECONF2009-27
ビットシリアル演算器を用いた再構成型プロセッサDS-HIEにおけるデータフロー生成の最適化手法の提案(設計手法)

西永 康弘,  梅田 賢一,  谷川 一哉,  弘中 哲夫,  

[発表日]2009/9/10
[資料番号]RECONF2009-28
再構成型プロセッサDS-HIEにおける入出力データ転送機構の検討(設計手法)

梅田 賢一,  西永 康弘,  谷川 一哉,  弘中 哲夫,  

[発表日]2009/9/10
[資料番号]RECONF2009-29
動的再構成可能プロセッサDAPDNA-2へのアプリケーション実装手法の比較・評価(設計手法)

古島 直道,  渡邊 誠也,  名古屋 彰,  

[発表日]2009/9/10
[資料番号]RECONF2009-30
小容量FPGAによるスケーラブルなシステム評価環境の構築手法(応用2)

渡邉 伸平,  高前田 伸也,  姜 軒,  三好 健文,  吉瀬 謙二,  

[発表日]2009/9/10
[資料番号]RECONF2009-31
小型組込みシステムと教育のためのFPGA向けTiny Processing System(応用2)

中野 浩嗣,  伊藤 靖朗,  川上 賢介,  重本 耕司,  

[発表日]2009/9/10
[資料番号]RECONF2009-32
メニーコアSoC用形状適応型ネットワークオンチップの検討(応用2)

廉田 浩,  若谷 彰良,  

[発表日]2009/9/10
[資料番号]RECONF2009-33
ネットワークテストベッドGtrcNET-10p3におけるパケットキャプチャおよびルータ機能の実装(応用2)

児玉 祐悦,  高野 了成,  岡崎 史裕,  工藤 知宏,  

[発表日]2009/9/10
[資料番号]RECONF2009-34
再構成デバイスMPLDの高密度実装に適した構成手法(デバイスアーキテクチャ2)

戸口 博昭,  淺枝 昌則,  小田 裕太郎,  平川 直樹,  谷川 一哉,  弘中 哲夫,  佐藤 正幸,  石黒 隆,  

[発表日]2009/9/10
[資料番号]RECONF2009-35
LEDR/4相2線プロトコルコンバータを用いた非同期FPGAの構成(デバイスアーキテクチャ2)

石原 翔太,  小松 与志也,  張山 昌論,  亀山 充隆,  

[発表日]2009/9/10
[資料番号]RECONF2009-36
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