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研究会 発表日時 開催地 タイトル・著者 抄録 資料番号
ICD, CPSY, CAS
(共催)
2017-12-14
10:40
沖縄 アートホテル石垣島 統計的コンパレータを用いたレベルクロス検出手法の性能解析
杉山泰基飯塚哲也東大)・山口隆弘アドバンテスト研)・名倉 徹浅田邦博東大CAS2017-66 ICD2017-54 CPSY2017-63
レベルクロス検出手法にもとづくADCでは電圧ではなく時間を量子化する。クロック周波数を2倍としたとき、通常のADCではS... [more] CAS2017-66 ICD2017-54 CPSY2017-63
pp.15-20
ICD, CPSY, CAS
(共催)
2017-12-14
15:10
沖縄 アートホテル石垣島 時間計測アプリケーションに向けた抵抗レスで面積利用効率の高い超低電力フルオンチップ弛張発振器
浅野大樹廣瀬哲也尾崎年洋黒木修隆沼 昌宏神戸大CAS2017-98 ICD2017-86 CPSY2017-95
本稿では,時間計測アプリケーションに向けた抵抗レスで
面積利用効率の高い超低電力フルオンチップ弛張発振器を提案する.
... [more]
CAS2017-98 ICD2017-86 CPSY2017-95
p.141
ICD, CPM, ED, EID, EMD, MRIS, OME, SCE, SDM
(共催)
QIT
(併催) [詳細]
2017-01-31
15:00
広島 みやじま杜の宿(広島) 時間計測アプリケーションに向けた超低電力フルオンチップ電流比較型RC発振器
浅野大樹廣瀬哲也椿 啓志三好太朗尾崎年洋黒木修隆沼 昌宏神戸大EMD2016-85 MR2016-57 SCE2016-63 EID2016-64 ED2016-128 CPM2016-129 SDM2016-128 ICD2016-116 OME2016-97
本稿では,製造プロセスのばらつき,電源電圧の変動,そして温度変化 (PVT ばらつき) に対して安定であり,小面積で低電... [more] EMD2016-85 MR2016-57 SCE2016-63 EID2016-64 ED2016-128 CPM2016-129 SDM2016-128 ICD2016-116 OME2016-97
pp.81-86
ICD, SDM
(共催)
ITE-IST
(連催) [詳細]
2016-08-01
10:00
大阪 中央電気倶楽部 高速起動を特徴とした間欠動作型VLSIシステム用32-MHzオンチップクロック源回路
浅野大樹廣瀬哲也三好太朗椿 啓志尾崎年洋黒木修隆沼 昌宏神戸大SDM2016-49 ICD2016-17
本稿では,高速起動を特徴とした間欠動作型VLSIシステム用32-MHzオンチップクロック源回路を提案する.提案回路は,従... [more] SDM2016-49 ICD2016-17
pp.3-8
ICD, CPSY
(共催)
2015-12-18
16:45
京都 京都工芸繊維大学 Hill-Climbing法を用いたパルス幅制御PLLのPVTばらつきへの自動適応
都井 敬名倉 徹飯塚哲也浅田邦博東大ICD2015-95 CPSY2015-108
 [more] ICD2015-95 CPSY2015-108
pp.135-140
MW
(第二種研究会)
2014-11-26
- 2014-11-28
海外 KMITL, Bangkok, Thailand A PVT-Robust VCO with Tail-Current Modulation Scheme
Aravind Tharayil NarayananWei DengKenichi OkadaAkira MatsuzawaTokodai
This paper proposes a VCO topology in which the tail-current... [more]
VLD, DC, IPSJ-SLDM
(連催)
ICD, CPM
(共催)
CPSY, RECONF
(併催) [詳細]
2014-11-26
09:15
大分 ビーコンプラザ(別府国際コンベンションセンター) タイミングエラーへの耐性を持つフリップフロップ設計
鈴木大渡史 又華戸川 望早大)・宇佐美公良芝浦工大)・柳澤政生早大VLD2014-79 DC2014-33
集積回路の微細化の影響により,回路のばらつきが大きくなっており,設計に必要な電源電圧やクロック周波数のマージンが増大して... [more] VLD2014-79 DC2014-33
pp.45-50
ICD, SDM
(共催)
2014-08-05
15:20
北海道 北海道大学 情報教育館(札幌市) 時間計測アプリケーションに向けた超低電力弛張発振回路
椿 啓志廣瀬哲也尾崎年洋黒木修隆沼 昌宏神戸大SDM2014-80 ICD2014-49
本稿では,時間計測アプリケーションに向けた超低電力弛張発振回路を提案する.一般に,弛張発振回路はコンパレータのオフセット... [more] SDM2014-80 ICD2014-49
pp.99-104
DC 2011-02-14
11:25
東京 機械振興会館 統計的タイミング解析を用いたばらつき考慮テストメソドロジ
新谷道広畠山一実相京 隆半導体理工学研究センターDC2010-62
LSI の微細化と高速化に伴い,プロセスばらつきの影響でチップのスペックを超えてしまうパラメトリック不良の増大が懸念され... [more] DC2010-62
pp.21-26
ICD, SDM
(共催)
2007-08-23
15:25
北海道 北見工業大学 厚膜MOS電源スイッチを用いた高速電源遮断技術によるモバイルプロセッサの低電力化
福岡一樹小澤 治森 涼五十嵐康人佐々木敏夫倉石 孝安 義彦石橋孝一郎ルネサステクノロジSDM2007-153 ICD2007-81
厚膜ゲート酸化膜MOS電源スイッチを用いた高速電源遮断技術を提案する.本手法はPVT変動による突入電流,復帰時間のばらつ... [more] SDM2007-153 ICD2007-81
pp.69-73
ICD, VLD
(共催)
2006-03-10
15:35
沖縄 メルパルク沖縄 ワースト条件をなくした低電圧SoC向けオンチップPVT制御システムの提案
行天隆幸森下 玄ルネサステクノロジ)・岡本真子大王電機)・堂阪勝己有本和民ルネサステクノロジ
本稿では,オンチップで低電圧時にワースト条件でのマージンを持たせた新しいPVT制御システムとして、AVM(Adaptiv... [more] VLD2005-132 ICD2005-249
pp.61-66
SIP, ICD, IE, IPSJ-SLDM
(共催)
2005-10-21
09:00
宮城 作並温泉一の坊 CMOS LC-VCOの位相雑音最小化
宮下大輔石黒仁揮香西昌平小林弘幸間島秀明阿川謙一濱田基嗣東芝
CMOS LC-VCOの位相雑音を最小化する振幅制御回路を提案し、0.18-μm CMOSプロセスで試作した。提案回路に... [more] SIP2005-115 ICD2005-134 IE2005-79
pp.1-5
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