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| 研究会 | 発表日時 | 開催地 | タイトル・著者 | 抄録 | 資料番号 | |
| HWS, VLD (共催) |
2019-02-27 15:45 |
沖縄 | 沖縄県青年会館 | 制限付温度依存クロックスキューによるタイミング補正 ○金子峰雄（北陸先端大）  VLD2018-103 HWS2018-66 |
信号遅延の温度依存性により、順序回路の正しい動作のためのタイミング条件を満たす温度範囲が制限される。FF による信号ラッ... [more] | VLD2018-103 HWS2018-66 pp.61-66 |
| VLD | 2017-03-02 15:00 |
沖縄 | 沖縄県青年会館 | マルチ・ドメイン・スキュー割り当てを考慮した資源割り当てとドメイン分割 ○李 暁光・金子峰雄（北陸先端大） VLD2016-118 |
データパス回路において，レジスタへのクロック信号到着時刻をずらすことにより，動作速度の向上が図れる．また，精度を要するス... [more] | VLD2016-118 pp.85-90 |
| VLD | 2017-03-02 15:50 |
沖縄 | 沖縄県青年会館 | スキュー調整を考慮した高位合成のMILP定式化 ○志村甲斐・金子峰雄（北陸先端大） VLD2016-120 |
動作向上のために積極的にクロックスキューを利用する回路設計が提案されている． しかし，クロックスキュー調整による動作速... [more] |
VLD2016-120 pp.97-102 |
| VLD, DC, IPSJ-SLDM (連催) ICD, CPM (共催) CPSY, RECONF (併催) [詳細] |
2015-12-02 17:35 |
長崎 | 長崎県勤労福祉会館 | 配線遅延とクロックスキューを利用したフロアプラン指向FPGA高位合成手法 ○藤原晃一・川村一志・柳澤政生・戸川 望（早大） VLD2015-54 DC2015-50 |
FPGAでは近年プロセスの微細化が進み，配線遅延とクロックスキューが回路の動作周波数を著しく悪くする恐れがある． 従っ... [more] |
VLD2015-54 DC2015-50 pp.99-104 |
| VLD | 2014-03-05 16:10 |
沖縄 | 沖縄県青年会館 | マルチドメインクロックスキュースケジューリングを用いたFPGAへの一般同期回路の実装 ○増井達哉・小平行秀（会津大） VLD2013-167 |
現在，様々な分野でASICでの回路実装に代わり，FPGAへの回路実装が用いられている．しかし，一般的には，FPGAに実装... [more] | VLD2013-167 pp.183-188 |
| VLD, DC, IPSJ-SLDM (連催) ICD, CPM (共催) CPSY, RECONF (併催) [詳細] |
2012-11-27 13:50 |
福岡 | 九州大学百年講堂 | HDRアーキテクチャを対象とした同時実行指向スケジューリングを用いたクロック設計考慮低電力化高位合成手法 ○赤坂宏行・柳澤政生・戸川 望（早大） VLD2012-81 DC2012-47 |
現在LSIの小型化や高性能化に伴い携帯端末の需要が増加し，電池の耐久性や端末の発熱問題が発生している．また，LSI設計プ... [more] | VLD2012-81 DC2012-47 pp.129-134 |
| SIP, CAS, VLD (共催) |
2009-07-01 14:50 |
北海道 | 釧路市生涯学習センター | 制御タイミングのばらつきを考慮した資源共有とスケジュール手法 ○井上恵介・金子峰雄・岩垣 剛（北陸先端大） CAS2009-5 VLD2009-10 SIP2009-22 |
本稿では，制御タイミング（マルチプレクサの切り替えタイミングとレジスタへの書き込みタイミング）のばらつきに耐性を有するデ... [more] | CAS2009-5 VLD2009-10 SIP2009-22 pp.25-30 |
| VLD | 2009-03-11 16:15 |
沖縄 | 沖縄県男女共同参画センター | クロック周期短縮のための挿入遅延量を抑えた回路への遅延挿入法 ○谷 修平・小平行秀・高橋篤司（東工大） VLD2008-135 |
従来のクロックの同時分配を前提とする完全同期方式の下で合成された論理回路に対し，クロック分配回路を一般同期化することで回... [more] | VLD2008-135 pp.53-58 |
| CAS, SIP, VLD (共催) |
2007-06-22 11:30 |
北海道 | 北海道東海大学 札幌キャンパス マルチメディアホール | Power Constrained IP Core Wrapper Design with Partitioned Clock Domains ○Thomas Edison Yu・Tomokazu Yoneda（NAIST）・Danella Zhao（Unive. of Louisiana）・Hideo Fujiwara（NAIST） CAS2007-25 VLD2007-41 SIP2007-55 |
[more] | CAS2007-25 VLD2007-41 SIP2007-55 pp.37-42 |
| NS, IN (併催) |
2007-03-08 08:00 |
沖縄 | 沖縄コンベンションセンター | 宅内ネットワークで放送信号の低ジッタ転送を実現するパケットスケジューリング手法 ○上村和宏・星野春男（NHK） NS2006-158 |
ブロードバンドネットワークの普及に伴い，IPを用いて映像を配信するIPTVの技術的検討が進んでいる．一方，家庭ではPCや... [more] | NS2006-158 pp.1-6 |
| SDM, VLD (共催) |
2006-09-25 13:55 |
東京 | 機械振興会館 | クロックスケジューリングを用いたLSIのピーク電力削減手法 ○高橋洋介・高橋篤司（東工大） |
LSIの大規模化に伴うピーク電力の増加は，ゲートの不安定動作や誤動作の原因となるため，その削減が大きな課題となっている．... [more] | VLD2006-35 SDM2006-156 pp.7-12 |
| ICD, VLD (共催) |
2006-03-09 11:30 |
沖縄 | メルパルク沖縄 | クラスタ分割を用いたスケジューリング法の効率化 ○砂走裕一・小平行秀・高橋篤司（東工大） |
準同期式回路のクロック合成において，レイアウト中で位置的に近い複数のレジスタを一つのクラスタにまとめ同一のクロックタイミ... [more] | VLD2005-113 ICD2005-230 pp.31-36 |
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