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| 研究会 | 発表日時 | 開催地 | タイトル・著者 | 抄録 | 資料番号 | |
| ICD, CPSY, CAS (共催) |
2017-12-14 09:50 |
沖縄 | アートホテル石垣島 | 遅延制御バッファにより周波数追従範囲を拡大した高速起動完全デジタルCDR回路の設計 ○陳 明翰・飯塚哲也・名倉 徹・浅田邦博（東大）  CAS2017-64 ICD2017-52 CPSY2017-61 |
待機時にダイナミック電力を消費せず、かつ待機状態から瞬時に起動することが可能な高速起動完全デジタルCDR回路を提案する。... [more] | CAS2017-64 ICD2017-52 CPSY2017-61 pp.3-8 |
| ICD, MW (共催) |
2016-03-04 14:45 |
広島 | 広島大学 | A Design of 0.7-V 400-MHz All-Digital Phase-Locked Loop for Implantable Biomedical Devices ○Jungnam Bae・Saichandrateja Radhapuram・Ikkyun Jo・Weimin Wang（Osaka Univ.）・Takao Kihara（Osaka Institute of Tech.）・Toshimasa Matsuoka（Osaka Univ.） MW2015-212 ICD2015-135 |
[more] | MW2015-212 ICD2015-135 pp.217-222 |
| VLD, DC, IPSJ-SLDM (連催) ICD, CPM (共催) CPSY, RECONF (併催) [詳細] |
2015-12-02 14:10 |
長崎 | 長崎県勤労福祉会館 | フラクショナル位相選択法によりジッタ特性を改善した高速起動完全デジタルCDR回路の設計 ○峠 仁人・飯塚哲也・名倉 徹（東大）・三浦 賢・村上芳道（ザインエレクトロニクス）・浅田邦博（東大） CPM2015-130 ICD2015-55 |
待機電力が極めて低く、かつ待機状態からの瞬時の起動が可能な高速起動完全デジタルCDR 回路を提案す る。提案するCDR... [more] |
CPM2015-130 ICD2015-55 pp.17-22 |
| ICD, ITE-IST (連催) |
2013-07-04 09:55 |
北海道 | サン・リフレ函館 | TDC一体型DLLを用いた高速ロック・低消費電力完全デジタルCDR回路 ○浦野雄貴・尹 元柱・小平 薫・徐 照男・黒田忠広・石黒仁揮（慶大） ICD2013-25 |
本研究ではNRZ信号のみならず，パルスベースの通信にも利用することのできるTDC一体型DLLを用いた完全デジタルCDRを... [more] | ICD2013-25 pp.7-12 |
| CAS | 2013-01-29 10:15 |
大分 | 別府国際コンベンションセンター | タイムインタリーブ型A/D変換器の高速オールデジタル補正 ○野崎 剛（富士通マイクロソリューションズ）・吉岡正人（富士通研）・薛 宗陽（富士通マイクロソリューションズ）・梅田定美（富士通セミコンダクター）・塚本三六（富士通研） CAS2012-81 |
イムインタリーブ型A/D変換器は、複数のA/D変換器が交互に動作することで、容易に高速変換を実現できる方式である。しかし... [more] | CAS2012-81 pp.89-94 |
| ICD | 2012-12-18 13:30 |
東京 | 東工大蔵前会館 ロイアルブルーホール | ［招待講演］CMOSアナデジ混載回路とその応用 ○香西昌平（東芝） ICD2012-118 |
近年のアナログCMOS集積回路はデジタル回路との関わりが密接になり、様々なことが可能となった。そのCMOS回路、特にデジ... [more] | ICD2012-118 pp.115-120 |
| ICD, ITE-IST (連催) |
2010-07-22 15:50 |
大阪 | 常翔学園大阪センター | ［招待講演］時間窓動作TDCを内蔵した2.1-2.8GHz低雑音デジタルPLL ○前多 正・東海林貴司（ルネサス エレクトロニクス）・狐塚正樹（NEC）・岡田光司（ルネサス エレクトロニクス）・深石宗生（NEC） ICD2010-29 |
2.1-2.8GHz帯で動作する低雑音・低消費電力な全デジタルPLLについて述べた。PLLの位相雑音を低減するために、２... [more] | ICD2010-29 pp.49-54 |
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