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研究会 発表日時 開催地 タイトル・著者 抄録 資料番号
CAS, SIP, MSS, VLD
(共催)
2018-06-15
15:05
北海道 北海道大学フロンティア応用科学研究棟 多目的遺伝的アルゴリズムを用いた概略的な配置手法
白米山晶平藤吉邦洋東京農工大CAS2018-29 VLD2018-32 SIP2018-49 MSS2018-29
LSIレイアウト設計では、配線長を最小化することを主な目的としてモジュールを配置することを問題としている。
この問題の... [more]
CAS2018-29 VLD2018-32 SIP2018-49 MSS2018-29
pp.149-154
VLD, DC
(共催)
CPM, ICD, IE
(共催)
CPSY, RECONF
(併催) [詳細]
2016-11-29
10:55
大阪 立命館大学大阪いばらきキャンパス 集合対間配線問題のための配線の付け替えによる配線長差最小化手法
原 秀太郎藤吉邦洋東京農工大VLD2016-57 DC2016-51
集合対間配線問題はプリント基板の設計などで生じる配線問題で、
最長の配線と最短の配線の
長さの差(配線長差)を最小化... [more]
VLD2016-57 DC2016-51
pp.79-84
VLD, DC, IPSJ-SLDM
(連催)
ICD, CPM
(共催)
CPSY, RECONF
(併催) [詳細]
2014-11-26
15:35
大分 ビーコンプラザ(別府国際コンベンションセンター) 集合対間配線における総配線長および配線長差の削減手法
中谷勇太高橋篤司東工大VLD2014-87 DC2014-41
プリント基板上の配線問題のひとつである集合対間配線問題では,
接続要求は端子集合に与えられる.
プリント基板の設計で... [more]
VLD2014-87 DC2014-41
pp.111-116
VLD 2014-03-04
09:15
沖縄 沖縄県青年会館 集合対間配線に対する配線長差削減アルゴリズムの改良
山本祐作高橋篤司東工大VLD2013-142
近年の回路の高速化に伴い,
信号の伝搬遅延を高い精度で実現することが求められている.
プリント基板(PCB)の配線設... [more]
VLD2013-142
pp.49-54
VLD, DC, IPSJ-SLDM
(連催)
ICD, CPM
(共催)
CPSY, RECONF
(併催) [詳細]
2011-11-30
10:05
宮崎 ニューウェルシティ宮崎 PCB一層配線における集合対間配線のフローを用いた配線長差削減アルゴリズム
山本祐作高橋篤司阪大VLD2011-87 DC2011-63
近年の回路の高速化に伴い,
信号の伝搬遅延を高い精度で実現することが求められている.
プリント基板(PCB)の配線設... [more]
VLD2011-87 DC2011-63
pp.203-208
VLD 2011-09-26
15:55
福島 会津大学 産学イノベーションセンター(UBIC) 3Dシアター 集合対間配線問題に関する一考察
高橋篤司阪大VLD2011-44
本稿は,接続要求が端子間には与えられず,2つの端子集合の間に与えられる集合対間配線問題おいて,主に総配線長最小の条件のも... [more] VLD2011-44
pp.23-28
SIP, CAS, VLD
(共催)
2009-07-02
13:10
北海道 釧路市生涯学習センター Stable-LSE法を用いた3次元配置手法
鍬農雅友船津直登高島康裕北九州市大CAS2009-17 VLD2009-22 SIP2009-34
本稿では,3 次元LSI における配置手法として,総配線長と総重なり体積の最小化を目的としたStable-LSE法に基づ... [more] CAS2009-17 VLD2009-22 SIP2009-34
pp.91-96
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