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研究会 発表日時 開催地 タイトル・著者 抄録 資料番号
CPSY, DC
(共催)
IPSJ-ARC
(連催) [詳細]
2020-07-31
17:30
ONLINE オンライン開催 機能等価な有限状態機械生成に基づく面積削減指向コントローラ拡大法
辻川敦也細川利典日大)・吉村正義京都産大CPSY2020-15 DC2020-15
近年,コントローラ拡大はレジスタ転送レベルにおけるテスト容易化設計やセキュリティ設計に用い られている.コントローラ... [more] CPSY2020-15 DC2020-15
pp.93-98
KBSE 2020-01-25
15:25
東京 機械振興会館 仮想時間とデバイスの状態分布によるIoTソフトウェアのためのモデルベーステストの高速化
田辺弘太郎東大)・田辺良則鶴見大)・萩谷昌己東大KBSE2019-44
Modbatはモデルベーステストを行うツールであり、拡張有限状態オートマトンを用いてモデリングを行う。本研究では、Mod... [more] KBSE2019-44
pp.37-42
DC 2018-02-20
11:40
東京 機械振興会館 kサイクルテストに基づく有限状態機械のテスト生成法
木下湧矢細川利典日大)・藤原秀雄阪学院大DC2017-81
半導体集積技術の発達に伴い,VLSIの大規模化,複雑化が急速に進んでいる.これに伴い,効率の良い順序回路のテスト生成技術... [more] DC2017-81
pp.25-30
VLD 2012-03-06
15:05
大分 ビーコンプラザ 動作レベル・レジスタ転送レベル混在設計記述向け高位合成手法
吉田浩章藤田昌宏東大/JSTVLD2011-128
高位合成技術を利用した設計手法では抽象度の高い動作レベル記述によって設計を行うため,高い生産性をもたらすことが可能である... [more] VLD2011-128
pp.49-54
VLD, IPSJ-SLDM
(連催)
2010-05-19
16:10
福岡 北九州国際会議場 順序回路のソフトエラー耐性評価における高精度な近似評価手法
城林直樹赤峰悠介吉村正義松永裕介九大VLD2010-2
ソフトエラー耐性を考慮した論理回路の設計においてソフトエラー耐性評価手法
が必要となる.順序回路における評価手法の1... [more]
VLD2010-2
pp.25-30
VLD, IPSJ-SLDM
(連催)
2010-05-19
16:35
福岡 北九州国際会議場 有限状態機械の分割に基づく定常状態確率の近似計算手法
長谷川 創赤峰悠介吉村正義松永裕介九大VLD2010-3
順序回路のソフトエラー耐性を評価する手法の一つとして,マルコフモデルを用いて状態遷移の振る舞いを解析し評価する手法が提案... [more] VLD2010-3
pp.31-36
VLD 2010-03-12
13:55
沖縄 沖縄県男女共同参画センター 順序回路のソフトエラー耐性評価手法の状態数削減による高速化
赤峰悠介吉村正義松永裕介九大VLD2009-126
ソフトエラー耐性を考慮した論理回路の設計では,ソフトエラー耐性評価手法が必要となる.著者らは,順序回路を対象とした評価手... [more] VLD2009-126
pp.163-168
VLD, DC, IPSJ-SLDM
(連催)
ICD, CPM
(共催)
CPSY, RECONF
(併催) [詳細]
2009-12-03
10:00
高知 高知市文化プラザ 順序回路のソフトエラー耐性評価における近似手法の計算精度および実行時間の評価
赤峰悠介吉村正義松永裕介九大VLD2009-49 DC2009-36
ソフトエラー耐性を考慮した論理回路の設計ではソフトエラー耐性評価手法が必要となる.順序回路を対象とした評価手法の一つとし... [more] VLD2009-49 DC2009-36
pp.55-60
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