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研究会 発表日時 開催地 タイトル・著者 抄録 資料番号
LOIS, SITE, ISEC
(共催)
2023-11-10
14:00
広島 サテライトキャンパスひろしま 502大講義室
(ハイブリッド開催,主:現地開催,副:オンライン開催)
アンロールド実装されたブロック暗号に対するサイドチャネル攻撃と差分解読の関係性の検討
東 哲平上野 嶺本間尚文東北大ISEC2023-69 SITE2023-63 LOIS2023-27
本稿では,アンロールド実装のブロック暗号に対して相関電力解析(CPA)を行う際に用いられる差分攻撃の理論的考察を行う.ア... [more] ISEC2023-69 SITE2023-63 LOIS2023-27
pp.98-102
EMM, BioX, ISEC, SITE, ICSS, HWS
(共催)
IPSJ-CSEC, IPSJ-SPT
(連催)
(連催) [詳細]
2023-07-25
09:20
北海道 北海道自治労会館 AEGIS Familyに対するSATを用いた差分解析
白矢琢朗兵庫県立大)・阪本光星三菱電機)・五十部孝典兵庫県立大ISEC2023-45 SITE2023-39 BioX2023-48 HWS2023-45 ICSS2023-42 EMM2023-45
本稿ではソフトウェア上で高速に実行する高速認証暗号方式である,AEGIS-128/128L/256に対して充足可能性問題... [more] ISEC2023-45 SITE2023-39 BioX2023-48 HWS2023-45 ICSS2023-42 EMM2023-45
pp.202-207
EMM, BioX, ISEC, SITE, ICSS, HWS
(共催)
IPSJ-CSEC, IPSJ-SPT
(連催)
(連催) [詳細]
2023-07-25
10:20
北海道 北海道自治労会館 複数ブランチ構造に対する最大差分特性確率について
髙 和真兵庫県立大)・阪本光星三菱電機)・五十部孝典兵庫県立大ISEC2023-48 SITE2023-42 BioX2023-51 HWS2023-48 ICSS2023-45 EMM2023-48
低遅延疑似ランダム関数 Orthros のような複数ブランチ構造の設計は,内部状態が大きいため,差分攻撃に 対して強いク... [more] ISEC2023-48 SITE2023-42 BioX2023-51 HWS2023-48 ICSS2023-45 EMM2023-48
pp.221-228
RCC, ISEC, IT, WBS
(共催)
2023-03-15
15:45
山口 山口大学常盤キャンパス
(ハイブリッド開催,主:現地開催,副:オンライン開催)
線形差分解析におけるSalsaの新たな差分ペア
李 君如宮地充子阪大IT2022-133 ISEC2022-112 WBS2022-130 RCC2022-130
Salsa20 は 2005 年に D.J.Bernstein によって設計されたストリーム暗号であって,その安全性に関... [more] IT2022-133 ISEC2022-112 WBS2022-130 RCC2022-130
pp.412-418
SS, KBSE
(共催)
IPSJ-SE
(連催) [詳細]
2022-07-29
14:55
北海道 北海道自治労会館(札幌)
(ハイブリッド開催,主:現地開催,副:オンライン開催)
変更前後のアクティビティ図の差分解析手法
岡本隼人大森隆行・○大西 淳立命館大SS2022-13 KBSE2022-23
ソフトウェア開発時に、アクティビティ図が変更されることがあるが、ある開発者が変更した際に、他の開発者が変更箇所や変更内容... [more] SS2022-13 KBSE2022-23
pp.73-78
ICSS, IPSJ-SPT
(連催)
2022-03-08
14:00
ONLINE オンライン開催 ソフトウェア差分に着目したIoT機器サプライチェーンセキュリティ上の課題発見と大規模実態調査
白石周碁吉元亮太岡山大)・塩治榮太朗秋山満昭NTT)・山内利宏岡山大/JSTさきがけICSS2021-76
IoT機器の普及に伴ってIoT機器を標的とした攻撃によるセキュリティインシデントの発生が増加しているにも関わらず,既存の... [more] ICSS2021-76
pp.105-110
WBS, IT, ISEC
(共催)
2021-03-04
10:15
ONLINE オンライン開催 Salsa20の入力/出力差分の新たな線形バイアスの解析
渡辺 瞭宮地充子阪大IT2020-120 ISEC2020-50 WBS2020-39
暗号技術の中でもストリーム暗号であるSalsa20は,TLS 1.3に選定されたChaCha20の前身であり,その安全性... [more] IT2020-120 ISEC2020-50 WBS2020-39
pp.52-57
IT 2011-07-21
14:00
岡山 岡山大学 共通鍵暗号HyRALのブーメラン攻撃耐性評価
井上知也金子敏信東京理科大IT2011-10
HyRALは2010年1月SCISにおいて(株)ローレルインテリジェントシステムズの平田によって提案されたブロック暗号で... [more] IT2011-10
pp.1-6
ISEC, IT, WBS
(共催)
2011-03-04
09:25
大阪 大阪大学 Triviumに対するセットアップタイミング違反にもとづく新しい故障差分攻撃
李 奇五味澤重友岩本 貢太田和夫崎山一男電通大IT2010-118 ISEC2010-122 WBS2010-97
本論文はストリーム暗号であるTrivium に対してセットアップタイム違反に基づく新しい故障差分解析(DFA)を報告する... [more] IT2010-118 ISEC2010-122 WBS2010-97
pp.333-339
ISEC, SITE, ICSS
(共催)
IPSJ-CSEC
(連催) [詳細]
2009-07-03
10:45
秋田 秋田大学 ハッシュ関数Lesamnta-256における差分攻撃耐性の評価について
五十嵐保隆金子敏信東京理科大ISEC2009-28 SITE2009-20 ICSS2009-42
次世代ハッシュ関数SHA-3の候補であるLesamnta-256を取り上げ、その構成要素である攪拌関数と鍵ス
ケジュー... [more]
ISEC2009-28 SITE2009-20 ICSS2009-42
pp.147-152
VLD 2009-03-12
09:40
沖縄 沖縄県男女共同参画センター Domino-RSL方式を用いたDES暗号回路実装と電力差分解析(DPA)攻撃に対する耐性の検証
小島憲司奥山一樹牧野友輝藤野 毅立命館大VLD2008-140
耐タンパー性を備えた暗号回路を実現するためには,電力差分解析( Differential Power Analysis:... [more] VLD2008-140
pp.83-88
VLD 2009-03-12
10:05
沖縄 沖縄県男女共同参画センター FPGA実装された暗号回路に対するビット値に着目した電力差分解析(DPA)実験
奥山一樹小島憲司牧野友輝藤野 毅立命館大VLD2008-141
サイドチャネル攻撃評価用FPGAボード(SASEBO)とオシロスコープを使用すると,ブロック暗号回路動作時の消費電力の統... [more] VLD2008-141
pp.89-94
WBS, IT, ISEC
(共催)
2009-03-10
09:50
北海道 公立はこだて未来大学(函館) 擬似等価鍵を用いたRC4 PRGAの内部状態の状態遷移解析(1)
助川昌泰宮地充子北陸先端大IT2008-80 ISEC2008-138 WBS2008-93
本稿では RC4 の PRGA の鍵系列に着目し研究を行った.
PRGAの初期内部状態に差分をもつ2つの内部状態の状態... [more]
IT2008-80 ISEC2008-138 WBS2008-93
pp.231-237
ISEC 2007-12-19
10:20
東京 機械振興会館 AESのテーブルネットワーク型FPGA実装における耐電力解析テーブル設計法
鳥越 慎横浜国大)・高橋芳夫横浜国大/NTTデータ)・松本 勉横浜国大ISEC2007-114
暗号実装時に対処が必要な脅威である電力差分解析は,暗号処理時のデバイスの消費電力を測定し,統計処理を行うことで鍵を特定す... [more] ISEC2007-114
pp.11-18
VLD, DC, IPSJ-SLDM
(共催)
CPSY, RECONF, IPSJ-ARC
(併催) [詳細]
2007-11-20
11:20
福岡 北九州国際会議場 暗号回路の電力差分解析攻撃に対して耐性があるドミノ型RSL回路の提案
豊田善靖木戸健太下林義明藤野 毅立命館大VLD2007-77 DC2007-32
耐タンパー性を備えた暗号回路を実現するためには、サイドチャネル攻撃に対する対策が必要である。特に電力差分解析( Diff... [more] VLD2007-77 DC2007-32
pp.43-48
ISEC, SITE, IPSJ-CSEC
(共催)
2007-07-20
09:55
北海道 公立はこだて未来大学 暗号回路のFPGA実装における簡易DPA対策
宋 長勲阿部公輝電通大ISEC2007-45
DPA対策手法の1つであるRandom Switching Logicは乱数によりゲートごとの信号遷移を均等化してデータ... [more] ISEC2007-45
pp.1-8
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