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 9件中 1~9件目  /   
研究会 発表日時 開催地 タイトル・著者 抄録 資料番号
HWS, ICD
(共催) [詳細]
2019-11-01
14:15
大阪 DNPなんばSSビル 剰余数系を用いた同種写像暗号ハードウェアアーキテクチャの設計に関する検討
船越秀隼上野 嶺本間尚文東北大
(ご登録済みです.開催日以降に掲載されます) [more]
CPSY, VLD, RECONF
(共催)
IPSJ-SLDM
(連催) [詳細]
2013-01-16
14:10
神奈川 慶応義塾大学 日吉キャンパス SD数の2値符号化による算術演算回路の最適化設計と性能評価
小林拓矢茂木和弘魏 書剛群馬大
冗長な数表現を持つSD(Signed-Digit)数の一つである冗長2進表現をディジタル回路に用いるには,各桁で用いられ... [more] VLD2012-114 CPSY2012-63 RECONF2012-68
pp.39-44
VLD, CPSY, RECONF
(共催)
IPSJ-SLDM
(連催) [詳細]
2012-01-26
10:50
神奈川 慶応義塾大学 日吉キャンパス SD数演算を用いた剰余数系-重み数系変換アルゴリズム
新井聖哉田中勇樹魏 書剛群馬大
剰余数系は,並列で処理を行うことにより高速な演算を可能にするが,非重み数系であるため,重み数系への出力には変換が必要とな... [more] VLD2011-110 CPSY2011-73 RECONF2011-69
pp.111-116
RECONF, VLD, CPSY
(共催)
IPSJ-SLDM
(連催) [詳細]
2011-01-17
15:45
神奈川 慶應義塾大学日吉キャンパス 最小SD数表現を用いた剰余演算とFIRフィルタ回路への応用
陳 睿田中勇樹魏 書剛群馬大
2進signed-digit (SD)数を用いた剰余演算が提案されている。従来の2進数を用いた剰余演算に比べて、演算速度... [more] VLD2010-96 CPSY2010-51 RECONF2010-65
pp.75-80
VLD, CPSY, RECONF
(共催)
IPSJ-SLDM
(連催) [詳細]
2010-01-26
15:55
神奈川 慶應義塾大学日吉キャンパス SD数演算を用いた剰余数系-2進数系変換アルゴリズム
姜 長雋魏 書剛群馬大
SD(Signed-Digit)数演算を剰余数演算に導入することにより、剰余数系における算術演算が高速に行われる。本論文... [more] VLD2009-80 CPSY2009-62 RECONF2009-65
pp.71-76
VLD, CPSY, RECONF
(共催)
IPSJ-SLDM
(連催) [詳細]
2010-01-26
16:20
神奈川 慶應義塾大学日吉キャンパス SD数表現を用いた剰余演算回路設計とその性能評価
張 明達魏 書剛群馬大
 [more] VLD2009-81 CPSY2009-63 RECONF2009-66
pp.77-82
DC 2009-02-16
11:30
東京 機械振興会館 算盤アーキテクチャを用いた10進加算器とその剰余演算への応用
飯島唯仁魏 書剛群馬大
従来、10進数を計算機上で扱うときは、BCD数表現が用いられる。それはBCD数を用いることによって、10進数の演算回路を... [more] DC2008-71
pp.19-23
VLD, CPSY, RECONF, IPSJ-SLDM
(共催)
2007-01-17
14:50
東京 慶応大学(日吉) SD数剰余加算を用いた剰余除算回路の構成
賈 鵬魏 書剛群馬大
本稿では、剰余除算を高速に行うため、SD(Signed-Digit)数表現を用いた剰余
数加算を導入する。まず、2進数... [more]
VLD2006-88 CPSY2006-59 RECONF2006-59
pp.19-24
CPSY, VLD, IPSJ-SLDM
(共催)
2005-01-26
17:20
神奈川 慶應義塾大学 日吉キャンパス SD数演算を用いた剰余数系ー重み数系変換回路
小川由真陳 土爽清魏 書剛群馬大
SD(Signed-Digit)数演算を剰余数演算に導入することにより、剰余数系にお
ける算術演算が高速に行われる。特... [more]
VLD2004-123 CPSY2004-89
pp.79-84
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