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| 研究会 | 発表日時 | 開催地 | タイトル・著者 | 抄録 | 資料番号 | |
| QIT (第二種研究会) |
2019-11-19 16:00 |
東京 | 学習院大学 | 効率的な量子剰余加算回路の提案とその実装 ○大西健斗（東大/慶大）・田中智樹（三菱UFJフィナンシャル・グループ/三菱UFJ銀行/慶大）・宇野隼平（みずほ情報総研/慶大）・山本直樹（慶大）・國廣 昇（筑波大） |
本稿では，Shorアルゴリズムを構成する量子加算回路および量子剰余加算について，従来よりも効率的な実装を行ったうえで，量... [more] | |
| VLD, CPSY, RECONF (共催) IPSJ-SLDM (連催) [詳細] |
2010-01-26 16:20 |
神奈川 | 慶應義塾大学日吉キャンパス | SD数表現を用いた剰余演算回路設計とその性能評価 ○張 明達・魏 書剛（群馬大）  VLD2009-81 CPSY2009-63 RECONF2009-66 |
[more] | VLD2009-81 CPSY2009-63 RECONF2009-66 pp.77-82 |
| VLD, CPSY, RECONF, IPSJ-SLDM (共催) |
2007-01-17 14:50 |
東京 | 慶応大学（日吉） | SD数剰余加算を用いた剰余除算回路の構成 ○賈 鵬・魏 書剛（群馬大） |
本稿では、剰余除算を高速に行うため、SD(Signed-Digit)数表現を用いた剰余 数加算を導入する。まず、２進数... [more] |
VLD2006-88 CPSY2006-59 RECONF2006-59 pp.19-24 |
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