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研究会 発表日時 開催地 タイトル・著者 抄録 資料番号
HWS 2018-04-13
13:55
福岡 九州大学医学部 百年講堂 パイプライン型剰余乗算器を用いたペアリング計算器のFPGA実装による消費エネルギー評価
長浜佑介藤本大介・○坂本純一松本 勉横浜国大HWS2018-5
ペアリング計算を行う専用ハードウェアのFPGA 実装に関する公表論文においては,消費エネルギーでの観点からの考察があまり... [more] HWS2018-5
pp.23-28
HWS
(第二種研究会)
2017-09-15
16:55
東京 東京大学生産技術研究所 パイプライン型剰余乗算器で構成する254ビット素数BN曲線上のoptimal ateペアリング計算ハードウェアのFPGA実装評価
長浜佑介横浜国大)・藤本大介奈良先端大)・松本 勉横浜国大
32bit分割のパイプライン型剰余乗算器と拡張ユークリッド互除法を用いた逆元演算器で構成するペアリング計算ハードウェアを... [more]
EMM, ISEC, SITE, ICSS
(共催)
IPSJ-CSEC, IPSJ-SPT
(併催)
(連催) [詳細]
2016-07-15
14:55
山口 中市コミュニティーホール Nac パイプライン型剰余乗算器と逆元演算器で構成する254bit素数ペアリング計算ハードウェアの高速実装法
藤本大介長浜佑介松本 勉横浜国大ISEC2016-36 SITE2016-30 ICSS2016-36 EMM2016-44
 [more] ISEC2016-36 SITE2016-30 ICSS2016-36 EMM2016-44
pp.223-228
IT, ISEC, WBS
(共催)
2016-03-10
14:30
東京 電気通信大学 254ビット素数の自乗を位数とする有限体乗算器を32ビット単位パイプライン化モンゴメリ乗算を用いて構成するアーキテクチャ
長浜佑介藤本大介松本 勉横浜国大IT2015-116 ISEC2015-75 WBS2015-99
高機能暗号を構成するためのひとつの要素として,ペアリングがある.126ビットセキュリティレベル程度のペアリングは,埋め込... [more] IT2015-116 ISEC2015-75 WBS2015-99
pp.95-100
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