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HWS 2020-04-07 ONLINE オンライン開催 FPGA向け二値化ニューラルネットワークへの電磁波解析攻撃の検討
ヴィッレ ウリマウル伊東 燦上野 嶺東北大)・Shivam BhasinDirmanto JapNanyang Technological Univ.)・本間尚文東北大HWS2020-5
 [more] HWS2020-5
pp.25-28
ISEC, SITE, ICSS, EMM, HWS, BioX
(共催)
IPSJ-CSEC, IPSJ-SPT
(共催)
(連催) [詳細]
2019-07-24
14:10
高知 高知工科大学 乗法的オフセットに基づく高効率AESハードウェアアーキテクチャの設計
上野 嶺東北大)・森岡澄夫インターステラテクノロジズ)・三浦典之松田航平永田 真神戸大)・Shivam Bhasin南洋理工大)・Yves MathieuTarik GrabaJean-Luc Dangerフランス国立高等電気通信学校)・本間尚文東北大ISEC2019-58 SITE2019-52 BioX2019-50 HWS2019-53 ICSS2019-56 EMM2019-61
本稿では高効率AES ハードウェアアーキテクチャの設計を示す.提案アーキテクチャはレジスタリタイミングや命令順序交換に加... [more] ISEC2019-58 SITE2019-52 BioX2019-50 HWS2019-53 ICSS2019-56 EMM2019-61
pp.375-382
EMCJ, IEE-EMC
(連催)
2014-06-20
10:35
兵庫 神戸大 CMOS暗号回路におけるシリコン基板からのサイドチャネル漏洩
藤本大介三浦典之永田 真神戸大)・林 優一本間尚文東北大)・シバム バシーンジャンルック ダンジェテレコムパリテックEMCJ2014-10
暗号回路において電源,グラウンドを流れる電流により内部状態が推定できてしまうサイドチャネル攻撃が問題となっている.CMO... [more] EMCJ2014-10
pp.1-6
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