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研究会 発表日時 開催地 タイトル・著者 抄録 資料番号
VLD, DC, IPSJ-SLDM
(連催)
ICD, CPM
(共催)
CPSY, RECONF
(併催) [詳細]
2015-12-03
15:00
長崎 長崎県勤労福祉会館 テスト容易でオンライン誤り検出可能な桁上げ選択加算器
鬼頭信貴中京大
テストが容易で,さらに動作中に故障による回路出力の誤りを検出可能(オンライン誤り検出可能)な桁上げ選択加算器を提案する.... [more] VLD2015-72 DC2015-68
pp.225-230
CPSY, DC
(共催)
IPSJ-EMB, IPSJ-SLDM
(共催)
(連催) [詳細]
2015-03-07
13:25
鹿児島 奄美市社会福祉協議会 会議室(2F・4F) 部分二重化を用いたオンライン誤り検出可能な浮動小数点乗算器の設計と評価
鬼頭信貴中京大)・秋元一志高木直史京大
完全な二重化を行う代わりに面積の小さなTruncated乗算器を仮数のチェック用に用いるオンライン誤り検出可能な部分二重... [more] CPSY2014-181 DC2014-107
pp.125-130
DC 2014-06-20
15:35
東京 機械振興会館 部分二重化を用いた微小誤りを許容するオンライン誤り検出可能な浮動小数点乗算器
鬼頭信貴中京大)・秋元一志高木直史京大
本稿では数値的に小さな誤りを許容するオンライン誤り検出可能な浮動小数点乗算器を提案する.
提案乗算器では浮動小数点乗算... [more]
DC2014-15
pp.33-38
CPSY, DC
(共催)
IPSJ-SLDM, IPSJ-EMB
(共催)
(連催) [詳細]
2013-03-14
15:05
長崎 対馬市交流センター 会議室 桁上げビットの二重化によるセルフチェッキング桁上げ先見加算器
三苫晃弘京大)・鬼頭信貴中京大)・高木直史京大
本稿では,回路内の単一縮退故障による誤りを検出する,セルフチェッキング桁上げ先見加算器を提案する.提案する加算器は,桁上... [more] CPSY2012-98 DC2012-104
pp.277-282
CPSY, DC
(共催)
IPSJ-SLDM, IPSJ-EMB
(共催)
(連催) [詳細]
2013-03-14
15:30
長崎 対馬市交流センター 会議室 部分二重化を用いたオンライン誤り検出可能な乗算器
秋元一志京大)・鬼頭信貴中京大)・高木直史京大
故障の影響による数値の誤差が小さいオンライン誤り検出可能な乗算器の構成を提案する.提案する乗算器は,演算のための乗算器と... [more] CPSY2012-99 DC2012-105
pp.283-287
VLD, DC, IPSJ-SLDM
(連催)
ICD, CPM
(共催)
CPSY, RECONF
(併催) [詳細]
2012-11-28
16:50
福岡 九州大学百年講堂 桁上げ生成二重化によるフォールトセキュアな並列プレフィックス加算器の構成法
鬼頭信貴中京大)・高木直史京大
本稿では,様々な構造のプレフィックス加算器を構成可能な,フォールトセキュアなプレフィックス加算器の構成法を示す.
本手... [more]
VLD2012-106 DC2012-72
pp.273-278
SCE 2012-07-19
11:10
東京 機械振興会館地下3階1号室 SFQ回路を用いたビットスライス浮動小数点加算器
大桃由紀雄成瀬遥平京大)・鬼頭信貴中京大)・高木直史高木一義京大
単一磁束量子(SFQ)回路は低消費電力性,高速動作性に優れる.
現在,高性能コンピュータ用のSFQによる実現に適した演... [more]
SCE2012-11
pp.13-17
SCE 2012-07-19
11:35
東京 機械振興会館地下3階1号室 SFQ回路を用いた2ビット・ビットスライス半精度浮動小数点乗算器の設計
成瀬遥平京大)・鬼頭信貴中京大)・高木直史京大
単一磁束量子(SFQ)回路は,低消費電力性,高速性に優れ,次世代デバイスとして実用化されることが期待されている.
SF... [more]
SCE2012-12
pp.19-23
SCE 2011-07-13
15:40
東京 機械振興会館 SFQ回路を用いた高スループットなビットスライス乗算器
成瀬遥平鬼頭信貴高木直史京大
単一磁束量子(SFQ)回路は,低消費電力性,高速性に優れ,次世代デバイスとして実用化されることが期待されている.SFQ回... [more] SCE2011-9
pp.47-52
CPSY, DC
(共催)
IPSJ-SLDM, IPSJ-EMB
(併催)
(連催) [詳細]
2011-03-18
10:55
沖縄 宮古島マリンターミナル(まりんぴあ宮古) 単一磁束量子論理回路のためのタイミング故障のモデル化とテスト手法の検討
鬼頭信貴京大)・高木一義名大)・高木直史京大
単一磁束量子回路(SFQ回路)は超伝導体を用いた超高速な回路であり,
現在,SFQ回路を用いたスーパーコンピュータ構築... [more]
CPSY2010-74 DC2010-73
pp.51-56
SCE 2010-07-22
11:35
東京 機械振興会館 単一磁束量子論理回路のための故障モデルとテストパターン生成手法の検討
鬼頭信貴京大)・田中雅光高木一義名大)・高木直史京大
本研究では,製造後のSFQ回路が正常に動作することを確認するためのテストの
手法について議論する.
SFQ回路は高速... [more]
SCE2010-19
pp.31-35
DC 2008-06-20
14:15
東京 機械振興会館 全加算器で構成したマルチオペランド加算器のテスト生成
鬼頭信貴高木直史名大
全加算器からなる桁上げ保存加算器で構成したマルチオペランド加算器がレベルテスト可能であることをテスト設計法を示すことで明... [more] DC2008-14
pp.19-22
VLD, DC, IPSJ-SLDM
(共催)
CPSY, RECONF, IPSJ-ARC
(併催) [詳細]
2007-11-21
14:15
福岡 北九州国際会議場 種々の部分積加算構造に対応したテスト容易な乗算器の設計手法
鬼頭信貴高木直史名大
テスト容易な乗算器の設計手法を示す.
乗算器の部分積加算部を3種類のブロックを組み合わせて設計する.
ブロックの組み... [more]
VLD2007-83 DC2007-38
pp.7-12
ICD, VLD
(共催)
2007-03-09
08:40
沖縄 メルパルク沖縄 4-2加算木を用いたテスト容易な乗算器
鬼頭信貴花井健輔高木直史名大
近年,VLSIの大規模化に伴いVLSIのテストのコストが上昇しており,テストコストの削減が求められている.4-2加算木を... [more] VLD2006-140 ICD2006-231
pp.1-6
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