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研究会 発表日時 開催地 タイトル・著者 抄録 資料番号
VLD 2016-03-01
15:10
沖縄 沖縄県青年会館 フロアプラン指向高位合成を用いたレジスタ分散型アーキテクチャ回路のFPGA実装
藤原晃一川村一志五十嵐啓太柳澤政生戸川 望早大
近年,様々なアプリケーションに対しFPGAの利用が急速拡大するに伴って,FPGA向け高位合成の需要が高まっている.
F... [more]
VLD2015-127
pp.93-98
VLD, DC, IPSJ-SLDM
(連催)
ICD, CPM
(共催)
CPSY, RECONF
(併催) [詳細]
2015-12-02
17:35
長崎 長崎県勤労福祉会館 配線遅延とクロックスキューを利用したフロアプラン指向FPGA高位合成手法
藤原晃一川村一志柳澤政生戸川 望早大
FPGAでは近年プロセスの微細化が進み,配線遅延とクロックスキューが回路の動作周波数を著しく悪くする恐れがある.
従っ... [more]
VLD2015-54 DC2015-50
pp.99-104
VLD, DC, IPSJ-SLDM
(連催)
ICD, CPM
(共催)
CPSY, RECONF
(併催) [詳細]
2014-11-26
14:45
大分 ビーコンプラザ(別府国際コンベンションセンター) FPGAの配線遅延特性を利用したフロアプラン指向高位合成手法
藤原晃一柳澤政生戸川 望早大
近年,画像処理や通信プロトコル処理などデータを高速処理する必要がある場面で,高位合成を利用し た FPGA 設計が増加し... [more] VLD2014-85 DC2014-39
pp.99-104
CAS, SIP, MSS, VLD, SIS
(共催) [詳細]
2014-07-11
14:00
北海道 北海道大学 フロアプランを考慮したマルチプレクサ入力数制限FPGA向け高位合成手法
藤原晃一阿部晋矢川村一志柳澤政生戸川 望早大
 [more] CAS2014-41 VLD2014-50 SIP2014-62 MSS2014-41 SIS2014-41
pp.219-224
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