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研究会 発表日時 開催地 タイトル・著者 抄録 資料番号
HWS, VLD
(共催) [詳細]
2020-03-05
11:20
沖縄 沖縄県青年会館
(開催中止,技報発行あり)
遅延故障に起因する回路寿命分布の確率的高速推定手法
富山葉月増田 豊石原 亨名大VLD2019-113 HWS2019-86
集積回路設計では,面積,電力,性能等の制約下において,遅延故障を起こさずに,正常な動作を保つこ
とが求められる.遅延故... [more]
VLD2019-113 HWS2019-86
pp.113-118
HWS, VLD
(共催) [詳細]
2020-03-06
17:15
沖縄 沖縄県青年会館
(開催中止,技報発行あり)
ニューラルネットワークの集積ナノフォトニクス実装に適した回路構造探索
服部直樹増田 豊石原 亨名大)・塩見 準京大)・新家昭彦納富雅也NTTVLD2019-137 HWS2019-110
集積ナノフォトニクス技術の急速な発展を背景に,集積ナノフォトニクスに基づいてニューラルネットワークを構築する光ニューラル... [more] VLD2019-137 HWS2019-110
pp.251-256
HWS, VLD
(共催)
2019-02-28
14:55
沖縄 沖縄県青年会館 [記念講演]BDDに基づく光論理回路の素子数削減と消費電力低減
松尾亮祐塩見 準石原 亨小野寺秀俊京大)・新家昭彦納富雅也NTTVLD2018-116 HWS2018-79
 [more] VLD2018-116 HWS2018-79
pp.139-144
VLD, HWS
(併催)
2018-03-02
11:20
沖縄 沖縄県青年会館 選択的活性化によるスタンダードセルメモリの低消費エネルギー化
塩見 準石原 亨小野寺秀俊京大VLD2017-124
オンチップメモリは集積回路のエネルギー効率に大きな影響を与える.本稿では,スタンダードセルメモリ(Standard-Ce... [more] VLD2017-124
pp.211-216
VLD, CAS, MSS, SIP
(共催)
2016-06-17
10:10
青森 弘前市立観光館 光パスゲート論理に基づく並列加算回路の提案と光電混載回路シミュレータによる動作検証
石原 亨京大)・新家昭彦NTT)・井上弘士九大)・野崎謙悟納富雅也NTTCAS2016-20 VLD2016-26 SIP2016-54 MSS2016-20
 [more] CAS2016-20 VLD2016-26 SIP2016-54 MSS2016-20
pp.109-114
VLD 2016-03-01
17:30
沖縄 沖縄県青年会館 [記念講演]サブスレッショルド領域で動作するラッチ回路の動作安定性解析
鎌苅竜也塩見 準石原 亨小野寺秀俊京大VLD2015-131
多くの記憶素子の基本要素として利用されるラッチ回路は集積回路設計にかかせない重要な回路である.
本稿は,ラッチ回路の... [more]
VLD2015-131
p.117
VLD 2015-03-03
15:50
沖縄 沖縄県青年会館 [記念講演]ニアスレッショルド回路設計のための基本定理
塩見 準・○石原 亨小野寺秀俊京大VLD2014-172
ニアスレッショルド電圧動作はマイクロプロセッサのエネルギー効率を劇的に改善する有効な手法である.
本稿では経路遅延が対... [more]
VLD2014-172
pp.109-114
RECONF, CPSY, VLD
(共催)
IPSJ-SLDM
(連催) [詳細]
2015-01-29
17:40
神奈川 慶應義塾大学 日吉キャンパス 電源電圧としきい値電圧の同時最適化が集積回路の消費エネルギーに与える影響の解析
竹下俊宏西澤真一Islam AKM Mahfuzul石原 亨小野寺秀俊京大VLD2014-129 CPSY2014-138 RECONF2014-62
トランジスタの電源電圧としきい値電圧をアプリケーションやチップの動作状況に応じて適切に設定することにより,集積回路の消費... [more] VLD2014-129 CPSY2014-138 RECONF2014-62
pp.111-116
VLD, DC, IPSJ-SLDM
(連催)
ICD, CPM
(共催)
CPSY, RECONF
(併催) [詳細]
2011-11-28
11:20
宮崎 ニューウェルシティ宮崎 超高速応答を実現するハードウェア割り込み処理機構
丸山修孝カーネロンシリコン)・石原 亨京大)・高田広章名大)・安浦寛人九大VLD2011-57 DC2011-33
割り込み処理機構をハードウェア化することにより超高速割り込み応答性能を実現する手法を提案する. 機械制御のように数マイク... [more] VLD2011-57 DC2011-33
pp.31-36
ICD, IE, SIP
(共催)
IPSJ-SLDM
(連催) [詳細]
2011-10-25
15:05
宮城 一の坊(仙台) キャッシュウェイ割り当てとコード配置の同時最適化によるメモリアクセスエネルギーの削減
高田純司九大)・石原 亨京大)・井上弘士九大SIP2011-76 ICD2011-79 IE2011-75
本稿ではシングルコアプロセッサで実行されるマルチタスクにおいて,キャッシュウェイの割り当てとコード配置を同時に最適化する... [more] SIP2011-76 ICD2011-79 IE2011-75
pp.89-94
DC, CPSY, IPSJ-SLDM, IPSJ-EMB
(共催)
2009-03-05
15:15
新潟 佐渡島開発総合センター Non-uniform Selective Way Cacheの動的制御による組込みプロセッサの省エネルギー化
石飛百合子石原 亨安浦寛人九大CPSY2008-90 DC2008-81
本稿はNon-uniform Selective Way Cache(NSWC)の動的ウェイ切り替えによる組
込みプロ... [more]
CPSY2008-90 DC2008-81
pp.13-18
DC, CPSY, IPSJ-SLDM, IPSJ-EMB
(共催)
2009-03-05
15:45
新潟 佐渡島開発総合センター シングルサイクルアクセス可能な二階層キャッシュアーキテクチャ
山口誠一朗石原 亨安浦寛人九大CPSY2008-91 DC2008-82
組込みプロセッサのメモリサブシステムの消費エネルギーを削減するために,プロセッサコアとL1キャッシュメモリ(以下,キャッ... [more] CPSY2008-91 DC2008-82
pp.19-24
DC, CPSY, IPSJ-SLDM, IPSJ-EMB
(共催)
2009-03-05
16:15
新潟 佐渡島開発総合センター OSから解析可能な無線通信端末の消費電力モデルとその生成手法
石原 亨奥平拓見久住憲嗣九大)・神山 剛関根和寿片桐雅二NTTドコモCPSY2008-92 DC2008-83
本稿では、携帯電話等の無線通信端末の消費電力モデルとその生成手法を提案する。従来の消費電力モデルの多くは、論理ゲートや演... [more] CPSY2008-92 DC2008-83
pp.25-30
VLD, IPSJ-SLDM
(共催)
2008-05-09
11:40
兵庫 神戸大学 Analysis of Effects of Input Arrival Time Variations on On-Chip Bus Power Consumption
Masanori MuroyamaTohru IshiharaHiroto YasuuraKyushu Univ.VLD2008-9
本稿では,入力信号の到着時間がばらついているときのオンチップバスの電力を解析する.プロセスの寸法が縮小するに従い,配線間... [more] VLD2008-9
pp.13-18
DC, CPSY, IPSJ-SLDM, IPSJ-EMB
(共催)
2008-03-27
08:45
鹿児島 屋久島 離島総合開発センター 負荷変動に瞬時適応可能なマルチパフォーマンスプロセッサの設計と評価
山口誠一朗大山裕一郎九大)・国武勇次九工大)・松村忠幸石飛百合子山口聖貴李 東勲金田裕介九大)・舟木敏正九工大)・室山真徳石原 亨佐藤寿倫九大DC2007-84 CPSY2007-80
動的可変電圧プロセッサ(以下DVSプロセッサ)の代用となるマルチパフォーマンスプロセッサについて述べる.マルチパフォーマ... [more] DC2007-84 CPSY2007-80
pp.1-6
VLD, DC, IPSJ-SLDM
(共催)
CPSY, RECONF, IPSJ-ARC
(併催) [詳細]
2007-11-20
10:05
福岡 北九州国際会議場 マルチタスク組込みアプリケーションの低消費エネルギー化のためのメモリ管理技術
山口誠一朗室山真徳石原 亨安浦寛人九大
携帯情報機器をはじめとした組込みシステムではメモリ・システムのエネルギー削減が強く求められている.キャッシュ・メモリより... [more] VLD2007-74 DC2007-29
pp.25-29
VLD, DC, IPSJ-SLDM
(共催)
CPSY, RECONF, IPSJ-ARC
(併催) [詳細]
2007-11-20
10:30
福岡 北九州国際会議場 組込みプロセッサのエネルギー消費を最小化するコード配置問題のILPモデル
石飛百合子石原 亨安浦寛人九大
本稿では,CPU コア,オンチップメモリおよびオフチップメモリの総消費エネルギーを最適化するコード配置問題の定義および定... [more] VLD2007-75 DC2007-30
pp.31-36
VLD, DC, IPSJ-SLDM
(共催)
CPSY, RECONF, IPSJ-ARC
(併催) [詳細]
2007-11-20
15:35
福岡 北九州国際会議場 製造後にタイミング補正可能なオンチップバスアーキテクチャ
山口聖貴室山真徳石原 亨安浦寛人九大
トランジスタの微細化が進むにつれて,配線に起因する遅延時間の影響が増大している.特にバス配線では複数の配線が長距離並走す... [more] VLD2007-79 DC2007-34
pp.55-60
SIP, ICD, IE
(共催)
IPSJ-SLDM
(併催) [詳細]
2007-10-26
15:10
福島 会津東山温泉 くつろぎ宿(福島) 新滝別館(新しい建物)4階コンベンションホール コード配置変更によるハイブリッドローカルメモリの消費エネルギー最小化
松村忠幸石飛百合子マジア ゴーダジ石原 亨安浦寛人九大
 [more]
ICD, VLD
(共催)
2007-03-07
17:20
沖縄 メルパルク沖縄 CMOS回路におけるタイミング歩留り最大化のためのゲートサイジング手法の提案
坂本良太室山真徳石原 亨安浦寛人九大
 [more] VLD2006-117 ICD2006-208
pp.67-72
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