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研究会 発表日時 開催地 タイトル・著者 抄録 資料番号
VLD, DC, IPSJ-SLDM
(連催)
ICD, CPM
(共催)
CPSY, RECONF
(併催) [詳細]
2012-11-28
09:25
福岡 九州大学百年講堂 Routability-oriented Common-Centroid Capacitor Array Generation
Jing LiBo YangDesign Algorithm Lab.)・○Qing DongShigetoshi NakatakeUniv. of KitakyushuVLD2012-89 DC2012-55
本論文では、高い相対精度を要求されるオンチップ容量のレイアウト生成手法について述べる。製造プロセスのばらつきに起因するシ... [more] VLD2012-89 DC2012-55
pp.171-175
IE, SIP, ICD, VLD, IPSJ-SLDM
(共催) [詳細]
2012-10-19
10:15
岩手 ホテルルイズ(盛岡)【変更】 A 9-bit 10MSps SAR ADC with Double Input Range for Supply Voltage
Gong ChenYu ZhangQing DongShigetoshi NakatakeUniv. of Kitakyushu)・Bo YangJing LiDesign Algorithm Lab.VLD2012-49 SIP2012-71 ICD2012-66 IE2012-73
本研究では、1.2V 9 ビット/10MSps 逐次比較型ADC を高精度化するためのプリチャージ方法を提案す
る。提... [more]
VLD2012-49 SIP2012-71 ICD2012-66 IE2012-73
pp.49-53
IE, SIP, ICD, VLD, IPSJ-SLDM
(共催) [詳細]
2012-10-19
14:30
岩手 ホテルルイズ(盛岡)【変更】 幾何学計画法によるSRAMマクロ合成手法
張 宇董 青中武繁寿北九州市大)・楊 波李 静設計アルゴリズム研VLD2012-54 SIP2012-76 ICD2012-71 IE2012-78
本研究では、幾何学計画法(Geometric Programming) に基づき、超微細プロセスにおける6T-SRAM ... [more] VLD2012-54 SIP2012-76 ICD2012-71 IE2012-78
pp.77-82
KBSE 2011-11-10
12:40
長野 信州大学工学部 ドメイン知識に基づくエンドユーザ向けWebアプリケーションフレームワークの試作
李 静中所武司明大KBSE2011-39
近年のインターネットの普及により、様々な業務がWebアプリケーション化されている。それに伴い、Webアプリケーションを効... [more] KBSE2011-39
pp.19-24
VLD 2011-09-26
14:00
福島 会津大学 産学イノベーションセンター(UBIC) 3Dシアター A transistor-level symmetrical layout generation method for analog device
Bo YangQing DongJing LiShigetoshi NakatakeUniv. of KitakyushuVLD2011-40
 [more] VLD2011-40
pp.1-4
VLD 2011-09-26
14:25
福島 会津大学 産学イノベーションセンター(UBIC) 3Dシアター CMOS Op-amp Circuit Synthesis with Geometric Programming Models for Layout-Dependent Effects
Yu ZhangGong ChenQing DongJing LiBo YangShigetoshi NakatakeUniv. of KitakyushuVLD2011-41
 [more] VLD2011-41
pp.5-10
VLD 2011-03-02
16:20
沖縄 沖縄県男女共同参画センター CMOSナノワットBGR回路のプロセス移行の制約再利用に関する考察
陳 功・○陰 徳龍楊 波董 青李 静中武繁寿北九州市大VLD2010-123
 [more] VLD2010-123
pp.43-47
VLD, DC, IPSJ-SLDM
(連催)
ICD, CPM
(共催)
CPSY, RECONF
(併催) [詳細]
2010-12-01
13:55
福岡 九州大学医学部百年講堂 構造化アナログレイアウト方式及び低電力設計向けトランジスタ・チャネル分割に関する解析
楊 波董 青李 静中武繁寿北九州市大VLD2010-79 DC2010-46
 [more] VLD2010-79 DC2010-46
pp.161-166
CAS, MSS, VLD, SIP
(共催)
2010-06-21
11:40
北海道 北見工大 レイアウト構造を意識したばらつきモデル化及びそのオペアンプ設計における検証
篠原宏太日高美穂子董 青李 静中武繁寿北九州市大CAS2010-7 VLD2010-17 SIP2010-28 CST2010-7
微細化・低電圧化が進むアナログ集積回路の開発においては、
トランジスタ特性のばらつき解析が重要となる。
本研究では、... [more]
CAS2010-7 VLD2010-17 SIP2010-28 CST2010-7
pp.37-41
VLD 2010-03-10
13:55
沖縄 沖縄県男女共同参画センター 規則バルク構造に基づくアナログマクロレイアウト生成手法
楊 波・○董 青李 静中武繁寿北九州市大VLD2009-100
 [more] VLD2009-100
pp.7-12
VLD, CAS, SIP
(共催)
2008-06-27
10:35
北海道 北海道大学 高等教育機能開発センター 数理計画法に基づく大規模配置最適化枠組みの提案
董 青楊 波李 静中武繁寿北九州市大CAS2008-23 VLD2008-36 SIP2008-57
 [more] CAS2008-23 VLD2008-36 SIP2008-57
pp.25-29
VLD, ICD
(共催)
2008-03-05
15:20
沖縄 沖縄県男女共同参画センター ソフトモジュールを含むアナログフロアプラン手法の提案
村田健太朗佐々木一也董 青李 静中武繁寿北九州市大VLD2007-142 ICD2007-165
MOSアナログ設計では、低電圧化が進むにつれ、トランジスタサイズが増大し、トランジスタモジュールのレイアウト構成が多様化... [more] VLD2007-142 ICD2007-165
pp.31-36
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