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| 研究会 | 発表日時 | 開催地 | タイトル・著者 | 抄録 | 資料番号 | |
| IE, ICD, VLD (共催) IPSJ-SLDM (連催) [詳細] |
2014-10-02 13:50 |
宮城 | 東北大学 さくらホール | 低電力プログラマブル遅延素子と遅延同期回路を用いた製造後クロックスキュー調整手法 ○室岡大二郎・張 宇・董 青・中武繁寿（北九州市大）  VLD2014-62 ICD2014-55 IE2014-41 |
[more] | VLD2014-62 ICD2014-55 IE2014-41 pp.13-18 |
| VLD, IPSJ-SLDM (連催) |
2014-05-29 08:55 |
福岡 | 北九州国際会議場 11会議室 | チャネル分割によるプログラマブル遅延素子の特性検証 ○室岡大二郎・永尾滉二・張 宇・中武繁寿（北九州市大） VLD2014-2 |
[more] | VLD2014-2 pp.7-12 |
| RCS, SIP (共催) |
2014-01-23 14:15 |
福岡 | 九州大学 | 2値係数バイラテラルフィルタによる画像の雑音除去 ○張 宇・浦浜喜一（九大） SIP2013-103 RCS2013-273 |
[more] | SIP2013-103 RCS2013-273 pp.107-112 |
| ITE-AIT, ITE-ME (共催) IE (連催) [詳細] |
2013-11-26 10:55 |
福岡 | 久留米高専 | 2値係数バイラテラルフィルタによる画像の計算量軽減平滑化 ○張 宇・浦浜喜一（九大） IE2013-68 |
[more] | IE2013-68 pp.39-42 |
| IE, ICD, VLD (共催) IPSJ-SLDM (連催) [詳細] |
2013-10-08 11:25 |
青森 | 弘前大学 コラボ弘大 | 多段階チャネル長分解型のプログラマブル遅延素子を伴う遅延同期回路 張 宇・李 明玉・董 青・○中武繁寿（北九州市大）・楊 波（設計アルゴリズム研） VLD2013-59 ICD2013-83 IE2013-59 |
遅延可変素子は、 様々な種類の高速集積回路において主に遅延補正やスキュー調整などの目的に利 用されている。 この論... [more] |
VLD2013-59 ICD2013-83 IE2013-59 pp.71-76 |
| VLD, IPSJ-SLDM (連催) |
2013-05-16 09:00 |
福岡 | 北九州国際会議場 | レイアウト依存効果を考慮したパラメータ化セルによる性能駆動SRAMマクロ設計手法 ○張 宇・中武繁寿（北九州市大） VLD2013-1 |
ナノスケール·プロセスでは、 Shallow Trench Isolation(STI)ストレスとウェル... [more] |
VLD2013-1 pp.1-6 |
| IE, SIP, ICD, VLD, IPSJ-SLDM (共催) [詳細] |
2012-10-19 10:15 |
岩手 | ホテルルイズ（盛岡）【変更】 | A 9-bit 10MSps SAR ADC with Double Input Range for Supply Voltage ○Gong Chen・Yu Zhang・Qing Dong・Shigetoshi Nakatake（Univ. of Kitakyushu）・Bo Yang・Jing Li（Design Algorithm Lab.） VLD2012-49 SIP2012-71 ICD2012-66 IE2012-73 |
本研究では、1.2V 9 ビット/10MSps 逐次比較型ADC を高精度化するためのプリチャージ方法を提案す る。提... [more] |
VLD2012-49 SIP2012-71 ICD2012-66 IE2012-73 pp.49-53 |
| IE, SIP, ICD, VLD, IPSJ-SLDM (共催) [詳細] |
2012-10-19 14:30 |
岩手 | ホテルルイズ（盛岡）【変更】 | 幾何学計画法によるSRAMマクロ合成手法 ○張 宇・董 青・中武繁寿（北九州市大）・楊 波・李 静（設計アルゴリズム研） VLD2012-54 SIP2012-76 ICD2012-71 IE2012-78 |
本研究では、幾何学計画法(Geometric Programming) に基づき、超微細プロセスにおける6T-SRAM ... [more] | VLD2012-54 SIP2012-76 ICD2012-71 IE2012-78 pp.77-82 |
| IPSJ-SLDM, VLD (連催) |
2012-05-31 10:20 |
福岡 | 北九州国際会議場 | GP最適化法に基づくSTI制約を考慮したコンパレータ回路エネルギーモデルの提案 ○陳 功・張 宇・楊 波・董 青・中武繁寿（北九州市大） VLD2012-8 |
低電力アナログ回路設計においては、STI ストレスによる電流ばらつきは無視できない。この論文では、 プリアンプとラッチ... [more] |
VLD2012-8 pp.43-48 |
| VLD | 2011-09-26 14:25 |
福島 | 会津大学 産学イノベーションセンター(UBIC) 3Dシアター | CMOS Op-amp Circuit Synthesis with Geometric Programming Models for Layout-Dependent Effects ○Yu Zhang・Gong Chen・Qing Dong・Jing Li・Bo Yang・Shigetoshi Nakatake（Univ. of Kitakyushu） VLD2011-41 |
[more] | VLD2011-41 pp.5-10 |
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