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研究会 発表日時 開催地 タイトル・著者 抄録 資料番号
VLD 2016-03-02
11:20
沖縄 沖縄県青年会館 Altera FPGAのための一般同期方式における部分変更機能による高速化手法
増子 駿大場琢也小平行秀会津大VLD2015-137
近年,様々な分野でASICでの回路実装に代わり,FPGAへの回路実装が用いられている.しかし,同じプロセスで回路を実装し... [more] VLD2015-137
pp.149-154
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