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研究会 発表日時 開催地 タイトル・著者 抄録 資料番号
VLD 2016-03-01
11:20
沖縄 沖縄県青年会館 タイミングエラー耐性を持つAES暗号回路の設計
吉田慎之介史 又華柳澤政生戸川 望早大VLD2015-123
近年,情報化の進展に伴い暗号回路の重要性が増加している.AESは理論的に安全な暗号技術として広く知られているが,クロック... [more] VLD2015-123
pp.73-78
VLD, DC, IPSJ-SLDM
(連催)
ICD, CPM
(共催)
CPSY, RECONF
(併催) [詳細]
2014-11-26
10:05
大分 ビーコンプラザ(別府国際コンベンションセンター) 回路面積を考慮したSuspicious Timing Error Prediction回路の挿入位置決定手法の改良と評価
吉田慎之介史 又華柳澤政生戸川 望早大VLD2014-81 DC2014-35
近年,半導体技術の進展に伴いタイミングエラー発生の危険性が増加している.STEPはタイミングエラーを事前に予測できる手法... [more] VLD2014-81 DC2014-35
pp.57-62
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