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研究会 発表日時 開催地 タイトル・著者 抄録 資料番号
VLD 2017-03-02
13:30
沖縄 沖縄県青年会館 [招待講演]CPU-FPGA密結合アーキテクチャを用いたIoTアプリケーションの高速化手法
小林悠記渡邊義和柴田誠也竹中 崇細見岳生中村祐一NEC
近年、CPUとFPGAが密結合したCPU-FPGA密結合アーキテクチャが注目を集めている。本稿では、CPU-FPGA密結... [more] VLD2016-115
p.79
RECONF 2016-09-06
09:10
富山 富山大学 [招待講演]CPU-FPGA密結合アーキテクチャを用いたIoTアプリケーションの高速化手法
小林悠記渡邊義和柴田誠也竹中 崇細見岳生中村祐一NEC
近年、CPUとFPGAが密結合したCPU-FPGA密結合アーキテクチャが注目を集めている。本稿では、CPU-FPGA密結... [more] RECONF2016-32
p.37
VLD, DC, IPSJ-SLDM
(連催)
ICD, CPM
(共催)
CPSY, RECONF
(併催) [詳細]
2012-11-26
10:30
福岡 九州大学百年講堂 組込みシステムのアーキテクチャ探索における性能ボトルネック解析
安藤友樹名大/学振)・柴田誠也NEC)・本田晋也名大)・冨山宏之立命館大)・高田広章名大
本論文では,ソフトウェアとハードウェアが混在した組込みシステムのボトルネック部 分に対し,設計制約を満たすために必要な性... [more] VLD2012-62 DC2012-28
pp.19-24
RECONF 2012-05-29
16:45
沖縄 沖縄県男女共同参画センター 高位合成によるSTPエンジン及びFPGAへのAES/ADPCMの実装と評価
石田薫史柴田誠也安藤友樹本田晋也高田広章枝廣正人名大
SoCの専用ハードウェアの代替技術として注目を集める再構成技術の性能を確かめるため,動的再構成ハードウェアであるSTPエ... [more] RECONF2012-14
pp.77-82
VLD, DC, IPSJ-SLDM
(連催)
ICD, CPM
(共催)
CPSY, RECONF
(併催) [詳細]
2011-11-29
09:00
宮崎 ニューウェルシティ宮崎 システムレベル通信モデルにおけるFIFOベース通信チャネルの効率化機構と自動合成
湊 雅登安藤友樹柴田誠也名大)・木下智雄ソリトンシステムズ)・本田晋也高田広章名大
既存のシステムレベル設計ツールSystemBuilderで定義されるデータ通信モデルにおいて,FIFOベースの通信チャネ... [more] VLD2011-67 DC2011-43
pp.91-96
RECONF 2011-09-27
09:00
愛知 名古屋大学(NCES) マルチプロセッサ対応システムレベル設計環境SystemBuilderを用いたFPGA向け設計事例
柴田誠也安藤友樹本田晋也名大)・冨山宏之立命館大)・高田広章名大
本論文では,我々がこれまで開発してきた,FPGA向け組込みマルチプロセッサシステムの設計を効率化するためのシステムレベル... [more] RECONF2011-32
pp.57-62
DC, CPSY, IPSJ-SLDM, IPSJ-EMB
(共催)
2008-03-27
09:30
鹿児島 屋久島 離島総合開発センター マルチプロセッサRTOS対応シミュレーション環境の機能拡張と効率化
相庭裕史柴田誠也古川貴士本田晋也冨山宏之高田広章名大
我々は,マルチプロセッサシミュレーション環境の精度の向上と高速化を行った.
本研究で対象としたマルチプロセッサシミュレ... [more]
DC2007-86 CPSY2007-82
pp.13-18
VLD, ICD
(共催)
2008-03-06
14:40
沖縄 沖縄県男女共同参画センター システムレベル設計環境SystemBuilderを用いたMPEG4デコーダの設計事例
柴田誠也本田晋也冨山宏之高田広章名大
本論文ではシステムレベル設計環境を用いた,動作レベル記述からのMPEG4 デコーダシステム設計事例について述べる.我々が... [more] VLD2007-151 ICD2007-174
pp.43-48
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