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| 研究会 | 発表日時 | 開催地 | タイトル・著者 | 抄録 | 資料番号 | |
| RCS, NS, USN (併催) |
2012-07-20 16:15 |
岩手 | 岩手大学 | タイミング回路におけるk次PSDのジッタへの影響 ○安部大介・若林 勇・佐野雅敏（東京理科大）  RCS2012-94 |
タイミング回路の2乗素子出力におけるk次PSDのタイミングジッタへの影響を検討した．伝送方式はPAM,ASK，およびQA... [more] | RCS2012-94 pp.115-119 |
| EMCJ, ITE-BCT (連催) |
2012-03-16 14:50 |
東京 | 機械振興会館 | 低位相雑音PLLのための位相比較器の検出感度に関する一検討 ○保原秀康・萓野良樹・井上 浩（秋田大） EMCJ2011-141 |
超広帯域無線システムなどの広帯域内での変復調の利用は新たな信号伝送や信号処理の可能性を秘めている．しかし，高周波化が進ん... [more] | EMCJ2011-141 pp.67-72 |
| CAS, CS, SIP (共催) |
2012-03-08 14:10 |
新潟 | 新潟大学駅南キャンパス「ときめいと」 | 400ppmの送受信周波数偏差に対応可能なシリアルATA用PHY ○川本高司（日立）・鈴木正人（ルネサス エレクトロニクス） CAS2011-129 SIP2011-149 CS2011-121 |
[more] | CAS2011-129 SIP2011-149 CS2011-121 pp.125-130 |
| MW | 2012-03-02 10:00 |
佐賀 | 佐賀大学 | 複数のパルス信号を用いたサブハーモニック注入同期発振器 ○堤 恒次・津留正臣・谷口英司（三菱電機） MW2011-180 |
サブハーモニック注入同期発振器において，注入信号と出力信号との周波数比が大きい場合，注入同期のロックレンジが狭くなり，位... [more] | MW2011-180 pp.71-75 |
| ICD | 2011-12-15 16:10 |
大阪 | 大阪大学会館 | ［ポスター講演］位相同期回路間における干渉ノイズのシミュレーション解析 ○丸橋 賢・水野順貴・吉村 勉・岩出秀平・牧野博之（阪工大）・松田吉雄（金沢大） ICD2011-110 |
集積回路の1チップ上に複数のPLL回路を設計した際，PLL回路間には干渉ノイズが発生する．そこで複数のPLL回路が干渉す... [more] | ICD2011-110 pp.57-58 |
| CAS, NLP (共催) |
2011-10-21 15:05 |
静岡 | 静岡大学 | 位相同期回路のカオスを用いたホワイトノイズの発生 ～ LTspiceによるシミュレーション報告 ～ ○千葉裕平・加藤享佑・今井征雄・遠藤哲郎（明大） CAS2011-57 NLP2011-84 |
位相同期回路(PLL)は,ある動作状態においてカオスを発生する.また、ある種のカオス状態にあるPLLはホワイトノイズを発... [more] | CAS2011-57 NLP2011-84 pp.141-146 |
| OPE, MW, MWP, EMT, EST (共催) IEE-EMT (連催) [詳細] |
2011-07-22 14:50 |
北海道 | 北見工業大学 | マイクロ波位相雑音の相互相殺による2つの25GHz間隔マルチキャリア光間位相同期化 ○水鳥 明・児玉敦史・古賀正文（大分大） MW2011-64 OPE2011-51 EST2011-50 MWP2011-32 |
本報告では波長の異なる2つの光源から生成した2群の25GHz間隔位相同期マルチキャリアを位相同期連結する技術を提案し，実... [more] | MW2011-64 OPE2011-51 EST2011-50 MWP2011-32 pp.145-149 |
| AP, SAT (併催) |
2011-07-15 10:25 |
長野 | 信州大学工学部(長野市) | 次世代光衛星間通信機器のBBM開発 ～ 試作ターミナル2機を用いた対向通信試験 ～ ○安藤俊行・鈴木二郎・小出来一秀・原口英介・板倉成孝・平野嘉仁（三菱電機）・花田達之・山川史郎（JAXA） SAT2011-15 |
近年，低軌道周回衛星に搭載される観測機器の高精細化に伴って衛星間でのデータ伝送容量が増加しており，数Gbps レベルの通... [more] | SAT2011-15 pp.43-48 |
| AP, MW (併催) |
2011-03-03 15:20 |
茨城 | 茨城大学 | 基準信号の遅延量を自動調整したマルチタイミング動作並列PFDによる低雑音Ku帯PLL ○堤 恒次・高橋貴紀・小牧昌彦・下沢充弘（三菱電機） MW2010-162 |
PLL出力信号のループ帯域内位相雑音を低減するには，位相周波数比較器(PFD)を並列化する構成が有効である．しかし，並列... [more] | MW2010-162 pp.57-61 |
| SIP, RCS (共催) |
2011-01-20 11:45 |
鹿児島 | 屋久島離島総合開発センター | タイミングジッタへのプリフィルタの効果 若林 勇・○浦野俊一・佐野雅敏（東京理科大） SIP2010-78 RCS2010-208 |
代表的なディジタル伝送方式のタイミングジッタはSS，SN，NNの３成分から成る．タイミング回路は2乗素子，プリフィルタお... [more] | SIP2010-78 RCS2010-208 pp.55-60 |
| ICD | 2010-12-16 15:10 |
東京 | 東京大学 先端科学技術研究センター | ［ポスター講演］CMOS技術を利用した不揮発フリップフロップの設計とFractional-N PLL周波数シンセサイザーへの応用 ○王 戈・イ ジョン ギュウ・桝井昇一（東北大） ICD2010-100 |
本発表では、Standard CMOSプロセスにより追加プロセスの必要がなく実現可能な不揮発フリップフロップ（NV-FF... [more] | ICD2010-100 pp.31-36 |
| ICD | 2010-12-16 15:10 |
東京 | 東京大学 先端科学技術研究センター | ［ポスター講演］0.5V動作6-bitスケーラブル位相補間器 ○熊木 聡・アブル ハサン ジョハリ・松原岳志（慶大）・林 勇（半導体理工学研究センター）・石黒仁揮（慶大） ICD2010-110 |
本研究では、２入力インバータを用いたスケーラブル位相補間器を提案する。 パイプラインのような構成を用いることにより、回... [more] |
ICD2010-110 p.81 |
| SS | 2010-10-15 11:00 |
岩手 | 岩手県立大学 | 等式理論を法とするDPLL遷移系について ○馬場達也・坂部俊樹・西田直樹・草刈圭一朗・酒井正彦（名大） SS2010-36 |
SMTソルバは，指定された述語理論の下で論理式の充足可能性判定を行うツールであり，配列，リスト，キューなどの多くの理論を... [more] | SS2010-36 pp.49-54 |
| ICD, ITE-IST (連催) |
2010-07-22 15:50 |
大阪 | 常翔学園大阪センター | ［招待講演］時間窓動作TDCを内蔵した2.1-2.8GHz低雑音デジタルPLL ○前多 正・東海林貴司（ルネサス エレクトロニクス）・狐塚正樹（NEC）・岡田光司（ルネサス エレクトロニクス）・深石宗生（NEC） ICD2010-29 |
2.1-2.8GHz帯で動作する低雑音・低消費電力な全デジタルPLLについて述べた。PLLの位相雑音を低減するために、２... [more] | ICD2010-29 pp.49-54 |
| ICD, ITE-IST (連催) |
2010-07-23 16:35 |
大阪 | 常翔学園大阪センター | Self-Dithered Digital Delta Sigma Modulators for Fractional-N Frequency Synthesizers ○Zule Xu・Jun Gyu Lee・Shoichi Masui（Tohoku Univ.） ICD2010-36 |
[more] | ICD2010-36 pp.121-126 |
| SCE, MW (共催) |
2010-04-23 17:10 |
東京 | 機械振興会館 | デジタル回路のみで固有周波数を切換える高速起動PLL ○中村光男・山岸明洋・原田 充・中村 誠（NTT） SCE2010-13 MW2010-13 |
立上げ時間と位相雑音のトレード・オフをシンプルな構成で克服する新位相同期ループ（PLL）を0.2μm CMOSプロセスで... [more] | SCE2010-13 MW2010-13 pp.69-73 |
| ICD | 2010-04-23 11:25 |
神奈川 | 湘南工大 | ［招待講演］高速メモリインターフェース ～ DDR/GDDR-DRAM ～ ○高井康浩（エルピーダメモリ） ICD2010-15 |
DDR/GDDR-DRAMの高速メモリインタフェースにおいて、制約の多いプロセス・デバイス技術で10Gb/s近いデータ転... [more] | ICD2010-15 pp.81-82 |
| MW | 2010-03-05 15:50 |
京都 | 龍谷大 | 分周数分解能0.5を実現する並列型デュアルモジュラスプリスケーラを搭載したPLLシンセサイザ ○中溝英之・田島賢一・林 亮司（三菱電機）・魚住俊弥（ルネサステクノロジ） MW2009-209 |
フラクショナルN-PLLシンセサイザにおいて，可変分周回路の分周数分解能を従来の1から0.5とすることでフラクショナル分... [more] | MW2009-209 pp.175-178 |
| MW | 2010-03-05 16:15 |
京都 | 龍谷大 | マルチタイミング動作並列PFD構成による低雑音Ku帯PLL-IC ○堤 恒次・高橋貴紀・下沢充弘・小牧昌彦・末松憲治（三菱電機） MW2009-210 |
PLLの出力位相雑音を低減するには，位相周波数比較器(PFD)を並列化する構成が有効である．しかし，並列化した回路で発生... [more] | MW2009-210 pp.179-182 |
| CPSY | 2009-11-20 14:10 |
京都 | キャンパスプラザ京都 | 仮想マシンマイグレーションによるストレージアクセス最適化に関する性能評価 ○豊島詩織（お茶の水女子大）・山口実靖（工学院大）・小口正人（お茶の水女子大） CPSY2009-37 |
本研究ではクラウドコンピューティングの枠組における遠隔計算機リソースを手元の仮想マシンPCクラスタから動的に利用すること... [more] | CPSY2009-37 pp.13-18 |
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