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| 研究会 | 発表日時 | 開催地 | タイトル・著者 | 抄録 | 資料番号 | |
| EMCJ | 2009-11-20 13:55 |
東京 | 青山学院大学 青山キャンパス | 遅延観測方式によるチップ内電源ノイズの観測 ○植松 裕・大坂英樹・鈴木英一・柳生正義・齊藤達也（日立）  EMCJ2009-83 |
給電系設計のためのチップ内電源ノイズ評価手法として，インバータ回路の電位変動を出力波形の遅延変動量に変換し外部でこれを観... [more] | EMCJ2009-83 pp.25-30 |
| EMCJ | 2009-06-05 10:05 |
東京 | 東京ビッグサイト（東京国際展示場） | オープンスタブ型EBG構造によるセルサイズの小型化 ○鳥屋尾 博・安道徳昭（NEC） EMCJ2009-23 |
電磁バンドギャップ（EBG）構造を電源系に適用して、電源ノイズの伝播を抑制する試みが報告されている。従来のEBG構造はバ... [more] | EMCJ2009-23 pp.7-11 |
| VLD, DC, IPSJ-SLDM (共催) ICD, CPM (共催) CPSY, RECONF (併催) [詳細] |
2008-11-19 10:50 |
福岡 | 北九州学術研究都市 | 線形計画法を用いた電源ノイズ解析高速化手法の検討 ○胡摩窪 武・鈴木五郎（北九州市大） VLD2008-89 DC2008-57 |
近年線形計画法を使用して電源ネットに関する電源ノイズ解析を行う手法が提案されている．提案されている既存手法を用いて，マイ... [more] | VLD2008-89 DC2008-57 pp.177-182 |
| VLD, DC, IPSJ-SLDM (共催) ICD, CPM (共催) CPSY, RECONF (併催) [詳細] |
2008-11-19 11:15 |
福岡 | 北九州学術研究都市 | 電流容量比を用いたデカップリング容量分配手法 ○小林 進・土居直史（NECエレクトロニクス） CPM2008-95 ICD2008-94 |
近年のLSIの高速化および低電圧化により電源ノイズの問題が顕在化しており、電源ノイズを抑制するための効果的な手段としてデ... [more] | CPM2008-95 ICD2008-94 pp.37-42 |
| ICD, SDM (共催) |
2008-07-18 09:50 |
東京 | 機械振興会館 | 突入電流バイパス電源配線を用いて1μs以内で電源復帰できるパワーゲーティング技術 ○中山耕一・川崎健一・塩田哲義・井上淳樹（富士通研） SDM2008-141 ICD2008-51 |
低消費電力SoC向けに1μs以内で電源復帰可能なパワーゲーティング技術を開発した。本技術の特徴は、電源復帰時に発生する電... [more] | SDM2008-141 ICD2008-51 pp.77-82 |
| EMCJ | 2008-01-25 13:35 |
佐賀 | 佐賀大学 | 電子機器の電源ノイズ抑制に向けたEBG構造の検討 ○安道徳昭・鳥屋尾 博・塚越常雄・原田高志（NEC） EMCJ2007-110 |
電源ノイズ抑制を目的にEBG構造の電源系への適用が報告されている．電子機器内にEBG構造を作り込む上で，その単位セルサイ... [more] | EMCJ2007-110 pp.25-30 |
| CPM, ICD (共催) |
2008-01-17 10:45 |
東京 | 機械振興会館 | スタンダードセルで構成された電源ノイズ波形測定回路の提案 ○小笠原泰弘・橋本昌宜・尾上孝雄（阪大） CPM2007-131 ICD2007-142 |
本稿ではデジタル回路素子のみで構成された電源ノイズ波形測定回路を提案する．本稿では提案回路を "ゲーテッドオシレータ" ... [more] | CPM2007-131 ICD2007-142 pp.17-22 |
| CPM, ICD (共催) |
2008-01-17 14:30 |
東京 | 機械振興会館 | ［特別招待講演］1mV電圧分解能・5ns時間分解能のオンチップ電源電圧変動モニタリング技術の提案 ○菅野雄介・近藤雄樹（日立）・入田隆宏・廣瀬健志・森 涼・安 義彦（ルネサステクノロジ）・小松成亘・水野弘之（日立） CPM2007-136 ICD2007-147 |
SoCが動作中の電源ノイズ分布を測定するためのオンチップ電源電圧変動モニタ技術を開発した。本方式は、チップ内のローカルな... [more] | CPM2007-136 ICD2007-147 pp.47-52 |
| ICD, CPM (共催) |
2007-01-18 10:15 |
東京 | 機械振興会館 | 電源ノイズによる遅延変動の測定と電源ノイズを再現するフルチップシミュレーション手法 ○小笠原泰弘・榎並孝司・橋本昌宜（阪大）・佐藤高史（東工大）・尾上孝雄（阪大） |
ナノメートル世代のプロセスでは電源電圧の低下と消費電流の増加により, 電源ノイズが深刻な問題となっている. 本稿では電源... [more] | CPM2006-132 ICD2006-174 pp.19-23 |
| EMCJ | 2006-09-01 14:25 |
大阪 | 大阪大学 | 電源ノイズシュミレーション高速化のためのCMOS出力バッファ等価回路の簡単化 ○山本純也・和田修己・久角尚史（京大） EMCJ2006-46 |
ボードレベルでのノイズシミュレーションを視野に入れた，SPICEによる電源ノイズシミュレーション高速化のための具体的な例... [more] | EMCJ2006-46 pp.13-17 |
| ICD | 2005-05-26 10:30 |
兵庫 | 神戸大学 | CMOS 90nm製造プロセスにおける組み込み型シングルチップマルチプロセッサの実現 ○川崎健一・塩田哲義・川辺幸仁・柴本 亘・佐藤厚志・橋本鉄太郎・松村宗明・岡野 廣・早川文彦・多湖真一郎・中村泰基（富士通研）・三宅英雄（富士通LSIテクノロジ）・須賀敦浩・高橋宏政・井上淳樹（富士通研） |
最高演算性能が 51.2GOPS、1GB/sのデータ転送を行えるシングルチップマルチプロセッサの製造に成功した。製品実測... [more] | ICD2005-21 pp.7-12 |
| EE | 2004-11-04 15:40 |
東京 | 機械振興会館 | CMOS-IC負荷におけるスイッチング電源ノイズのシグナル・インテグリティに及ぼす影響 ○西島健一（発紘電機）・佐藤敏郎・山沢清人（信州大） |
本報告は，CMOSロジックICを負荷とする電源として，スイッチング電源を用いた場合の伝導ノイズに関する実験的検討を行った... [more] | EE2004-39 pp.19-24 |
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