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| 研究会 | 発表日時 | 開催地 | タイトル・著者 | 抄録 | 資料番号 | |
| SIP, CAS, MSS, VLD (共催) |
2017-06-20 15:30 |
新潟 | 新潟大学五十嵐キャンパス 中央図書館ライブラリーホール | 演算器の可変レイテンシ化による処理性能と回路面積のトレードオフに関する評価 ○右近祐太・佐藤真平・高橋篤司（東工大）  CAS2017-23 VLD2017-26 SIP2017-47 MSS2017-23 |
データセンタにおいて想定されるサービスには高い精度を必要とせず，かつ計算量の多い処理が多数ある．そのため，少ないリソース... [more] | CAS2017-23 VLD2017-26 SIP2017-47 MSS2017-23 pp.119-124 |
| CPSY, RECONF, VLD (共催) IPSJ-SLDM, IPSJ-ARC (共催) (連催) [詳細] |
2017-01-25 09:25 |
神奈川 | 慶大日吉キャンパス | 典型的な回路を用いた近似演算における入力系列の演算精度への影響の調査 ○佐藤真平・右近祐太・高橋篤司（東工大） VLD2016-95 CPSY2016-131 RECONF2016-76 |
集積回路において，可変レイテンシを仮定すると回路はタイミングエラーが発生する可能性のあるクロッ ク周期で動作させること... [more] |
VLD2016-95 CPSY2016-131 RECONF2016-76 pp.165-170 |
| VLD | 2016-03-02 13:50 |
沖縄 | 沖縄県青年会館 | 動的タイミングエラー検出を用いた可変レイテンシ化による一般同期式回路の高性能化 ○中塚裕志・高橋篤司（東工大） VLD2015-140 |
完全同期方式に代わる設計方式として提案された一般同期方式では，フリップフロップへのクロックの同時到達性を仮定しない．一般... [more] | VLD2015-140 pp.167-172 |
| SDM, VLD (共催) |
2006-09-25 13:55 |
東京 | 機械振興会館 | クロックスケジューリングを用いたLSIのピーク電力削減手法 ○高橋洋介・高橋篤司（東工大） |
LSIの大規模化に伴うピーク電力の増加は，ゲートの不安定動作や誤動作の原因となるため，その削減が大きな課題となっている．... [more] | VLD2006-35 SDM2006-156 pp.7-12 |
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