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| 研究会 | 発表日時 | 開催地 | タイトル・著者 | 抄録 | 資料番号 | |
| DC | 2011-12-16 17:10 |
兵庫 | 豊岡市社会福祉協議会／城崎地区センター | 部分的にバックトラック可能な耐故障Wormholeスイッチング ○金井宏樹・北神正人（千葉大）  DC2011-75 |
並列計算機やNetwork-on-Chip(NoC)はシステムを構成する要素が多く，全体として故障が発生する確率は高くな... [more] | DC2011-75 pp.39-44 |
| VLD, DC, IPSJ-SLDM (連催) ICD, CPM (共催) CPSY, RECONF (併催) [詳細] |
2011-11-29 13:25 |
宮崎 | ニューウェルシティ宮崎 | 整数線形計画問題に基づいたネットワークオンチップにおけるフォールトトレランスのためのタスクの多重割り当て手法 ○齋藤 寛（会津大）・米田友洋（NII）・中村祐一（NEC） VLD2011-77 DC2011-53 |
本稿では与えられたNoCモデル，タスクグラフ，NoCノードの想定故障数の下，想定故障数内のNoCノードが故障しても正しく... [more] | VLD2011-77 DC2011-53 pp.147-152 |
| VLD, DC, IPSJ-SLDM (連催) ICD, CPM (共催) CPSY, RECONF (併催) [詳細] |
2011-11-30 10:55 |
宮崎 | ニューウェルシティ宮崎 | 制御回路共有化に基づく非同期細粒度パワーゲーティング手法とその応用 ○河野宇朗（東北大）・鬼沢直哉（マギル大）・松本 敦・羽生貴弘（東北大） VLD2011-89 DC2011-65 |
本稿では，近年増加しているリーク電流による消費電力(リーク電力)を削減する手法として用いられるパワーゲーティングにおいて... [more] | VLD2011-89 DC2011-65 pp.215-220 |
| VLD, DC, IPSJ-SLDM (連催) ICD, CPM (共催) CPSY, RECONF (併催) [詳細] |
2011-11-30 09:25 |
宮崎 | ニューウェルシティ宮崎 | 優先度逆転問題を軽減する優先度付きオンチップネットワークルータ ○笹川雄二郎・松谷宏紀・山崎信行（慶大） CPSY2011-50 |
半導体集積技術が進歩するに連れ，Chip multiprocessor（CMP）に搭載されるコア数が増大してきている．こ... [more] | CPSY2011-50 pp.41-46 |
| DC, CPSY (併催) |
2011-07-29 09:25 |
鹿児島 | かごしま県民交流センター | チップ間ワイヤレス接続を利用した三次元積層アーキテクチャの研究 ○佐々木瑛一・佐々木大輔・松谷宏紀・天野英晴・竹 康宏・黒田忠広（慶大）・坂本龍一・並木美太郎（東京農工大） CPSY2011-10 |
誘導結合を利用した低電力ビルディングブロック型へテロジーニアス マルチコアシステムCube-1を提案する。Cube-1... [more] |
CPSY2011-10 pp.7-12 |
| CAS | 2011-01-26 11:20 |
熊本 | 熊本大学 | On the Energy-Aware Mapping for NoCs ○Masayoshi Arai・Satoshi Tayu・Shuichi Ueno（Tokyo Inst. of Tech.） CAS2010-100 |
チップ上のコンポーネント数の増加に起因し複雑化する通信の問題を解決するため、ネットワークオンチップ（NoC）がグローバル... [more] | CAS2010-100 pp.87-92 |
| VLD, DC, IPSJ-SLDM (連催) ICD, CPM (共催) CPSY, RECONF (併催) [詳細] |
2010-11-30 10:10 |
福岡 | 九州大学医学部百年講堂 | パケット転送経路の偏りに着目した高性能非同期式ネットワークオンチップの検討 ○武安 聡・今井 雅・中村 宏（東大） VLD2010-66 DC2010-33 |
近年GALS方式の非同期式ネットワークオンチップが注目されている．ネットワークオンチップはトポロジとルーティングの規則性... [more] | VLD2010-66 DC2010-33 pp.67-72 |
| DC, CPSY (共催) |
2010-04-13 13:30 |
東京 | 東京工業大学（大岡山） | ［招待講演］非同期式計算に基づくディペンダビリティ向上へのアプローチ ○米田友洋（NII/東工大） CPSY2010-1 DC2010-1 |
集積システムの微細化・大規模化が進むにつれ，プロセスパラメータのゆらぎ等による遅延ばらつき，NBTI(Negative ... [more] | CPSY2010-1 DC2010-1 p.1 |
| CPSY, DC (共催) IPSJ-SLDM, IPSJ-EMB, IPSJ-UBI, IPSJ-MBL (併催) (連催) [詳細] |
2010-03-27 16:00 |
東京 | 八丈シーパークリゾート | NoCを利用した特定用途向けシステムのスループットを向上するIPコアトポロジ決定手法 ○打越 寛（豊橋技科大）・杉原 真（豊橋技科大/JST） CPSY2009-88 DC2009-85 |
半導体微細化の進行に起因して，配線遅延がゲート遅延よりも相対的に増加している. 今後はオンチップ通信にかかる時間が性能... [more] |
CPSY2009-88 DC2009-85 pp.321-326 |
| CPSY, DC (共催) IPSJ-SLDM, IPSJ-EMB, IPSJ-UBI, IPSJ-MBL (併催) (連催) [詳細] |
2010-03-28 13:00 |
東京 | 八丈シーパークリゾート | 低遅延リアルタイムオンチップネットワークのための先読みルータの設計 ○向後卓磨・山崎信行（慶大） CPSY2009-89 DC2009-86 |
大規模なCMP を用いて実時間システムを構築するためにはスケジューリング方式が重要である．実時間スケジューリングはプリエ... [more] | CPSY2009-89 DC2009-86 pp.465-470 |
| CPSY | 2009-11-20 15:55 |
京都 | キャンパスプラザ京都 | メニーコアプロセッサのためのネットワークトラフィックに着目したタスク配置問題の解析と考察 ○佐野伸太郎・佐野正浩・佐藤真平（東工大）・三好健文（東工大/JST）・吉瀬謙二（東工大） CPSY2009-40 |
プロセッサに搭載されるコア数が増加したメニーコアアーキテクチャでは，プログラム中の並列性を活用することで，その演算性能を... [more] | CPSY2009-40 pp.31-36 |
| CPSY, DC (併催) |
2009-08-04 - 2009-08-05 |
宮城 | フォレスト仙台 | Network-on-Chipにおけるエラー検出・訂正方式に関する研究 ○小島 悠（慶大）・松谷宏紀（東大）・鯉渕道紘（NII）・天野英晴（慶大） CPSY2009-24 |
本研究ではエラー耐性技術を用いることでエラー率を抑えつつ電圧を落とす Network-on-Chip (NoC)の低消費... [more] | CPSY2009-24 pp.85-90 |
| CPSY, DC (併催) |
2009-08-04 - 2009-08-05 |
宮城 | フォレスト仙台 | 高信頼オンチップ非同期データ転送技術に関する一検討 ○鬼沢直哉・松本 敦・羽生貴弘（東北大）・米田友洋（NII） DC2009-18 |
本稿ではチップ内におけるプロセスや温度・電源電圧などの環境のばらつき下で正しく動作する, 多値電流モード(MVCM)回路... [more] | DC2009-18 pp.1-6 |
| VLD | 2009-03-12 13:25 |
沖縄 | 沖縄県男女共同参画センター | マルチコアSoC用形状適応型ネットワークオンチップの提案 ○廉田 浩（九大）・若谷彰良（甲南大） VLD2008-146 |
マルチ/メニーコアSoCにオンチップ化された相互結合網では，結合網自身のハードウェアコストよりもその消費電力がより重要な... [more] | VLD2008-146 pp.117-122 |
| VLD | 2009-03-12 13:50 |
沖縄 | 沖縄県男女共同参画センター | 固定型ルーティングを実装したNoCの通信エネルギーを低減するハードマクロ配置手法 ○打越 寛（豊橋技科大）・杉原 真（豊橋技科大/JST） VLD2008-147 |
現在のSoC通信アーキテクチャの主流はバスであるが，配線遅延の影響でバスクロック周波数を上げることは困難であり，より高性... [more] | VLD2008-147 pp.123-128 |
| VLD | 2009-03-12 14:15 |
沖縄 | 沖縄県男女共同参画センター | リンク長及びレイテンシ制約下でのネットワークオンチップのトポロジ自動生成 ○谷田英生（東大）・吉田浩章（東大/JST）・松本剛史（東大）・藤田昌宏（東大/JST） VLD2008-148 |
半導体プロセスの微細化に伴い，SoCの性能はよりインターコネクトの性能に影響される部分が大きくなっている．多くのNoC ... [more] | VLD2008-148 pp.129-134 |
| VLD, DC, IPSJ-SLDM (共催) CPSY, RECONF, IPSJ-ARC (併催) [詳細] |
2007-11-20 15:10 |
福岡 | 北九州国際会議場 | ネットワークオンチップにおける回路面積と配線コストを考慮したチップ内通信構造最適化の一手法 ○林 大輔・村井 渉（阪大）・中田明夫（広島市大）・木谷友哉・安本慶一（奈良先端大）・東野輝夫（阪大） CPSY2007-35 |
本研究では，Processing Element(PE) 間の通信の動的な振舞いを考慮したネットワークオンチップ(NoC... [more] | CPSY2007-35 pp.1-6 |
| ICD, IPSJ-ARC (共催) |
2007-06-01 16:15 |
神奈川 | 株式会社富士通研究所 岡田記念ホール | 演算器レベル・パケット転送方式に基づく高並列VLSIプロセッサの構成 ○藤岡与周・苫米地宣裕（八戸工大）・亀山充隆（東北大） ICD2007-34 |
不規則かつ高並列な処理の演算遅れ時間を減少するためには，細粒度高並列処理が有用であるが，通常のVLIW制御方式ではルータ... [more] | ICD2007-34 pp.103-108 |
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