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研究会 発表日時 開催地 タイトル・著者 抄録 資料番号
DC, CPSY
(共催)
2009-04-21
16:35
東京 首都大秋葉原サテライトキャンパス SER評価のための論理回路におけるパルスの伝搬解析
原田翔次赤峰悠介吉村正義松永裕介九大CPSY2009-9 DC2009-9
近年のトランジスタの微細化に伴い,ソフトエラーは増加する傾向にある.
論理回路において,論理ゲートの出力にパルスが発... [more]
CPSY2009-9 DC2009-9
pp.49-54
VLD 2009-03-11
14:25
沖縄 沖縄県男女共同参画センター イニシエーション・インターバルとアロケーションの制約下における総面積最小を目的としたパイプライン・スケジューリング手法
小玉 翔松永裕介九大VLD2008-131
本稿では,パイプライン回路を対象とした動作合成における,スループット制約下での回路の総面積最小化を目的としたパイプライン... [more] VLD2008-131
pp.29-34
VLD, CPSY, RECONF, IPSJ-SLDM
(共催)
2009-01-29
14:10
神奈川 慶応義塾大学(日吉) FPGA向けテクノロジ・マッピングにおける深さ最小ネットワーク生成のための効率的なカット列挙手法
高田大河松永裕介九大
本稿では,LUT 型 FPGA 向けテクノロジ・マッピングにおいて,深さ最小なネットワークの生成を目的とした効率的なカッ... [more] VLD2008-101 CPSY2008-63 RECONF2008-65
pp.57-62
IE, SIP, IPSJ-SLDM
(共催)
2008-10-07
11:05
岩手 岩手県民情報交流センター(通称:アイーナ) 組み合わせ論理回路におけるソフトエラーの論理マスク効果の正確な見積り手法について
松永裕介九大
 [more] SIP2008-116 IE2008-80
pp.53-58
IE, SIP, IPSJ-SLDM
(共催)
2008-10-07
11:30
岩手 岩手県民情報交流センター(通称:アイーナ) FPGAを対象とした部分積加算回路の合成について
松永多苗子木村晋二早大)・松永裕介九大
 [more] SIP2008-117 IE2008-81
pp.59-64
VLD, IPSJ-SLDM
(共催)
2008-05-08
15:50
兵庫 神戸大学 マルチプレクサの削減を目的としたバインディング改善手法
小玉 翔松永裕介九大
リソース共有型の動作合成では,バインディングの結果としてレジスタや演算器の入力側に必要に応じてマルチプレクサが挿入される... [more] VLD2008-4
pp.19-24
VLD, IPSJ-SLDM
(共催)
2008-05-08
16:40
兵庫 神戸大学 スイッチング確率を考慮したprefix graph合成手法の改良について
松永多苗子木村晋二早大)・松永裕介九大
 [more] VLD2008-6
pp.31-36
RECONF, CPSY, VLD, IPSJ-SLDM
(共催)
2008-01-17
08:40
神奈川 慶應義塾大学日吉キャンパス [招待講演]ICCAD報告
松永裕介九大VLD2007-118 CPSY2007-61 RECONF2007-64
2007年11月5日から8日まで米国カリフォルニアで開催された国際会議ICCAD 2007の
概要と,おもにFPGA関... [more]
VLD2007-118 CPSY2007-61 RECONF2007-64
pp.1-6
RECONF, CPSY, VLD, IPSJ-SLDM
(共催)
2008-01-17
09:40
神奈川 慶應義塾大学日吉キャンパス FPGA向け動作合成のためのメモリバインディングとスケジューリングアルゴリズムについて
佐川由己貞方 毅松永裕介九大VLD2007-120 CPSY2007-63 RECONF2007-66
FPGA(Field Programmable Gate Array) ではメモリのサイズや数、ポート数が決っている。そ... [more] VLD2007-120 CPSY2007-63 RECONF2007-66
pp.13-18
VLD, DC, IPSJ-SLDM
(共催)
CPSY, RECONF, IPSJ-ARC
(併催) [詳細]
2007-11-22
13:50
福岡 北九州国際会議場 Ling のキャリー計算に基づく parallel prefix adder 合成について
松永多苗子木村晋二早大)・松永裕介九大
Ling adder は隣り合う2ビットずつをまとめたキャリー計算に基づく加算噐であり、このキャリー計算は prefix... [more] VLD2007-97 DC2007-52
pp.49-54
VLD, DC, IPSJ-SLDM
(共催)
CPSY, RECONF, IPSJ-ARC
(併催) [詳細]
2007-11-22
14:15
福岡 北九州国際会議場 専用演算器の使用を考慮した効率的な動作合成手法
貞方 毅松永裕介九大VLD2007-98 DC2007-53
本論文では,動作合成において専用演算器を活用することで合成結果の性能改善を効率的に図る手法を提案する.専用演算器とは,特... [more] VLD2007-98 DC2007-53
pp.55-60
VLD, DC, IPSJ-SLDM
(共催)
CPSY, RECONF, IPSJ-ARC
(併催) [詳細]
2007-11-22
15:20
福岡 北九州国際会議場 LUT型FPGA向けテクノロジ・マッピングにおける深さ制約下のLUT数削減手法
高田大河松永裕介九大
 [more] VLD2007-101 DC2007-56
pp.73-78
VLD, IPSJ-SLDM
(共催)
2007-05-11
09:55
京都 京大会館 DAG カバリング問題の下限とそれを用いた厳密アルゴリズムについて
松永裕介九大VLD2007-8
 [more] VLD2007-8
pp.7-12
VLD, IPSJ-SLDM
(共催)
2007-05-11
11:45
京都 京大会館 消費電力を考慮したprefix graph 合成手法について
松永多苗子早大)・松永裕介九大
Prefix graph は parallel prefix adder の概略構造を表現するもので、
これまでにその... [more]
VLD2007-12
pp.31-36
VLD, CPSY, RECONF, IPSJ-SLDM
(共催)
2007-01-17
17:15
東京 慶応大学(日吉) FPGA用テクノロジマッピングにおける効率的なカット列挙手法について
松永裕介九大
 [more] VLD2006-93 CPSY2006-64 RECONF2006-64
pp.49-54
VLD, DC, IPSJ-SLDM
(共催)
RECONF, CPSY, IPSJ-ARC
(併催) [詳細]
2006-11-28
11:20
福岡 北九州国際会議場 LUT段数最小かつ個数極小なLUT型FPGA向けテクノロジ・マッピング
高田大河松永裕介九大
 [more] VLD2006-59 DC2006-46
pp.47-52
VLD, DC, IPSJ-SLDM
(共催)
RECONF, CPSY, IPSJ-ARC
(併催) [詳細]
2006-11-30
09:00
福岡 北九州国際会議場 LUT型FPGAを対象とした消費電力および遅延の見積もり手法について
中村隆二松永裕介九大
 [more] VLD2006-72 DC2006-59
pp.1-6
ICD, SIP, IE, IPSJ-SLDM
(共催)
2006-10-27
09:00
宮城 宮城県・作並温泉・一の坊 効率的なブーリアンマッチングのための論理関数の新しいシグネチャについて
松永裕介九大
 [more] SIP2006-101 ICD2006-127 IE2006-79
pp.1-6
ICD, SIP, IE, IPSJ-SLDM
(共催)
2006-10-27
09:20
宮城 宮城県・作並温泉・一の坊 動的計画法を用いた parallel prefix adder 合成アルゴリズムについて
松永多苗子福岡知的クラスター研)・松永裕介九大
本論文では,遅延制約下で面積最小化を対象とした parallel prefix adder 合成問題を,遅延制約の下での... [more] SIP2006-102 ICD2006-128 IE2006-80
pp.7-12
VLD, IPSJ-SLDM
(共催)
2006-05-12
10:45
愛媛 愛媛大学 テスト生成における間接含意の効率的な生成方法
吉村正義福岡知的クラスター研)・梶原誠司九工大)・松永裕介九大
 [more] VLD2006-9
pp.19-23
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