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登録講演（開催プログラムが公開されているもの） （日付・降順）

研究会	発表日時	開催地		タイトル・著者	抄録	資料番号
RECONF	2016-05-19 16:35	神奈川	富士通研究所	光再構成型ゲートアレイの光入力 ○榛葉大樹・古川晋也（静岡大）・Ili Shairah Abdul Halim（MJIIT）・渡邊　実（静岡大）・小林史典（MJIIT） RECONF2016-14	[more]	RECONF2016-14 pp.67-70
VLD, DC, IPSJ-SLDM (共催) CPSY, RECONF, IPSJ-ARC (併催) [詳細]	2007-11-21 14:40	福岡	北九州国際会議場	動的再構成のための配置配線の一手法 ○日高　亮・小林史典（九工大）・渡辺　実（静岡大） RECONF2007-38	近年，動的再構成デバイスが実用的に使われ始めているが，時間とともに回路が変化するので，その上に構成する回路の配置配線に，... [more]	RECONF2007-38 pp.13-17
RECONF	2006-09-14 13:00	熊本	熊本大学工学部百周年記念館	光再構成ゲートアレイの製造不良耐性 ○日高　亮・渡邊　実・小林史典（九工大）	[more]	RECONF2006-20 pp.1-5
RECONF	2006-09-14 13:30	熊本	熊本大学工学部百周年記念館	差分光再構成型ゲートアレイの再構成時間・消費電力の最適化手法 ○日高　亮・渡邊　実・小林史典（九工大）	[more]	RECONF2006-21 pp.7-11
RECONF	2006-09-14 14:00	熊本	熊本大学工学部百周年記念館	液晶ホログラムを用いた光再構成型ゲートアレイ ○中田善之・渡邊　実・小林史典（九工大）	[more]	RECONF2006-22 pp.13-16
CAS	2006-01-13 10:50	宮崎	宮崎大学	位相補間によるPLLの特性改善～位相補間回路の最適化～ ○井上　学・小林史典・渡邊　実（九工大）	一般にPLL(Phase Locked Loop)は，入/出力信号の位相を立上りのタイミングで比較する．これに対し，本研... [more]	CAS2005-89 pp.13-17
ICD	2005-07-14 15:20	愛知	豊橋技術科学大学	272ゲート規模ODRGA_VLSIの実装評価 ○志岐武宣・渡邊　実・小林史典（九工大）	[more]	ICD2005-50 pp.61-65
ICD	2005-07-14 15:45	愛知	豊橋技術科学大学	複数のVCSELを用いたODRGAの再構成速度改善 ○宮野元嗣・渡邊　実・小林史典（九工大）	[more]	ICD2005-51 pp.67-70
IE, SIP, ICD, IPSJ-SLDM (共催)	2004-10-21 15:00	山形	米沢市・伝国の杜（もり）会議室	0.18um プロセスによる差分光再構成型ゲートアレイ ○渡邊　実・小林史典（九工大）	[more]	SIP2004-86 ICD2004-118 IE2004-62 pp.61-66

著作権について : 以上の論文すべての著作権は電子情報通信学会に帰属します．(許諾番号：10GA0019/12GB0052/13GB0056/17GB0034/18GB0034)

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