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| 講演名 | 2022-03-11 16:25 連結リストを用いるGarbled Circuit の効率的な構成法 ○劉 広健・森田 光（神奈川大）  IT2021-131 ISEC2021-96 WBS2021-99 RCC2021-106 |
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| 抄録 | （和） | Yao による Garbled Circuit の提案以降，秘密回路に関する多くの構成法が提案されてきた.とりわけ，論理合成手法の観点から，真理値表に対応する完全二分木で表現するよりも，BDD または ZDD によるノード削減効果が大きいので，Garbled Circuit の Table にもデータ量圧縮効果を期待して適用する提案がされている.しかしテーブル圧縮は真理値表の 0 と 1のパターンによる依存性があり，分布により圧縮手法を分ける必要があった.また，論理回路が圧縮可能であったとしても，ノードが省略されたので，Garbled Circuit への適用で削減したノードを復元できない問題も生じた.さらに，不規則に省略される入力変数に対するノードを含めた Garbled Circuit の表現手段がなかった.本稿では，BDD および ZDD の構成における分岐に着目し，Garbled Circuit を連結リスト型のデータ表現を用いる方法について考察する.この手法は BDD および ZDD のみならず完全二分木にも適用できる柔軟性がある. |
| （英） | Since the proposal of the Garbled Circuit by Yao, a number of construction methods for secret circuits have been proposed.In particular, from the point of view of logic synthesis methods, the node reduction effect of BDDs or ZDDs is greater than that of a complete binary tree corresponding to a truth table, so it has been proposed to apply it to the Table of Garbled Circuits with the expectation of a data volume compression effect.However, these table compression methods are dependent on the pattern of truth values, and it was necessary to use different methods depending on the distribution of the patterns.Even if the logic circuit to be realized is compressible, the problem of restoring the reduced nodes arose in the application to Garbled Circuits.In addition, there was no way to represent Garbled Circuits, including nodes for irregularly omitted input variables.In this paper, we focus on branching in the construction of BDDs and ZDDs, and propose and discuss a method of using Garbled Circuits as a linked-list-type data representation.This method is flexible enough to be applied not only to BDDs and ZDDs but also to conventional complete binary trees. | |
| キーワード | （和） | BDD / Garbled Circuits / ZDD / zero-suppressed decision diagrams / / / / |
| （英） | BDD / Garbled Circuits / ZDD / zero-suppressed decision diagrams / / / / | |
| 文献情報 | 信学技報, vol. 121, no. 429, ISEC2021-96, pp. 281-284, 2022年3月. | |
| 資料番号 | ISEC2021-96 | |
| 発行日 | 2022-03-03 (IT, ISEC, WBS, RCC) | |
| ISSN | Online edition: ISSN 2432-6380 | |
| 著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します．(許諾番号：10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) | |
| PDFダウンロード | IT2021-131 ISEC2021-96 WBS2021-99 RCC2021-106 |
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| 研究会情報 | |
| 研究会 | IT ISEC RCC WBS |
| 開催期間 | 2022-03-10 - 2022-03-11 |
| 開催地（和） | オンライン開催 |
| 開催地（英） | Online |
| テーマ（和） | ISEC・IT・RCC・WBS合同研究会 |
| テーマ（英） | Joint Meeting of ISEC, IT, RCC, and WBS |
| 講演論文情報の詳細 | |
| 申込み研究会 | ISEC |
| 会議コード | 2022-03-IT-ISEC-RCC-WBS |
| 本文の言語 | 日本語 |
| タイトル（和） | 連結リストを用いるGarbled Circuit の効率的な構成法 |
| サブタイトル（和） | |
| タイトル（英） | An Efficient Method for Constructing Garbled Circuits Using Linked Lists |
| サブタイトル（英） | |
| キーワード(1)（和/英） | BDD / BDD |
| キーワード(2)（和/英） | Garbled Circuits / Garbled Circuits |
| キーワード(3)（和/英） | ZDD / ZDD |
| キーワード(4)（和/英） | zero-suppressed decision diagrams / zero-suppressed decision diagrams |
| キーワード(5)（和/英） | / |
| キーワード(6)（和/英） | / |
| キーワード(7)（和/英） | / |
| キーワード(8)（和/英） | / |
| 第1著者 氏名（和/英/ヨミ） | 劉 広健 / Guangjian Liu / リュウ コウケン |
| 第1著者 所属（和/英） | 神奈川大学大学院 (略称： 神奈川大) Graduate School of Kanagawa University (略称： Graduate School of Kanagawa Univ) |
| 第2著者 氏名（和/英/ヨミ） | 森田 光 / Hikaru Morita / モリタ ヒカル |
| 第2著者 所属（和/英） | 神奈川大学大学院 (略称： 神奈川大) Graduate School of Kanagawa University (略称： Graduate School of Kanagawa Univ) |
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| 講演者 | 第1著者 |
| 発表日時 | 2022-03-11 16:25:00 |
| 発表時間 | 25分 |
| 申込先研究会 | ISEC |
| 資料番号 | IT2021-131, ISEC2021-96, WBS2021-99, RCC2021-106 |
| 巻番号（vol） | vol.121 |
| 号番号（no） | no.428(IT), no.429(ISEC), no.430(WBS), no.431(RCC) |
| ページ範囲 | pp.281-284 |
| ページ数 | 4 |
| 発行日 | 2022-03-03 (IT, ISEC, WBS, RCC) |
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